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📄 vgainterface.fit.rpt

📁 用于测试VGA运行的几个程序代码
💻 RPT
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字号:
;      - count_z[1]                                                                                 ; 0                 ; ON      ;
;      - count_z[4]                                                                                 ; 0                 ; ON      ;
;      - count_x[5]                                                                                 ; 0                 ; ON      ;
;      - count_x[0]                                                                                 ; 0                 ; ON      ;
;      - count_y[1]                                                                                 ; 0                 ; ON      ;
;      - count_y[3]                                                                                 ; 0                 ; ON      ;
;      - count_y[2]                                                                                 ; 0                 ; ON      ;
;      - count_y[0]                                                                                 ; 0                 ; ON      ;
;      - address[0]                                                                                 ; 0                 ; ON      ;
;      - address[1]                                                                                 ; 0                 ; ON      ;
;      - address[2]                                                                                 ; 0                 ; ON      ;
;      - address[3]                                                                                 ; 0                 ; ON      ;
;      - address[4]                                                                                 ; 0                 ; ON      ;
;      - address[5]                                                                                 ; 0                 ; ON      ;
;      - address[6]                                                                                 ; 0                 ; ON      ;
;      - address[7]                                                                                 ; 0                 ; ON      ;
;      - address[8]                                                                                 ; 0                 ; ON      ;
;      - address[9]                                                                                 ; 0                 ; ON      ;
;      - address[10]                                                                                ; 0                 ; ON      ;
;      - address[11]                                                                                ; 0                 ; ON      ;
;      - address[12]                                                                                ; 0                 ; ON      ;
;      - address[13]                                                                                ; 0                 ; ON      ;
;      - count_x[7]                                                                                 ; 0                 ; ON      ;
;      - count_x[4]                                                                                 ; 0                 ; ON      ;
;      - count_x[1]                                                                                 ; 0                 ; ON      ;
;      - count_y[4]                                                                                 ; 0                 ; ON      ;
;      - count_x[3]                                                                                 ; 0                 ; ON      ;
;      - count_x[2]                                                                                 ; 0                 ; ON      ;
;      - count_x[6]                                                                                 ; 0                 ; ON      ;
;      - count_z[0]                                                                                 ; 0                 ; ON      ;
;      - count_z[3]                                                                                 ; 0                 ; ON      ;
; clock0                                                                                            ;                   ;         ;
;      - clock_25mhz                                                                                ; 0                 ; ON      ;
;      - tsinghua:u1|altsyncram:altsyncram_component|altsyncram_qcr:auto_generated|ram_block1a1     ; 0                 ; ON      ;
;      - tsinghua:u1|altsyncram:altsyncram_component|altsyncram_qcr:auto_generated|ram_block1a2     ; 0                 ; ON      ;
;      - tsinghua:u1|altsyncram:altsyncram_component|altsyncram_qcr:auto_generated|ram_block1a0     ; 0                 ; ON      ;
;      - tsinghua:u1|altsyncram:altsyncram_component|altsyncram_qcr:auto_generated|ram_block1a3     ; 0                 ; ON      ;
;      - tsinghua:u1|altsyncram:altsyncram_component|altsyncram_qcr:auto_generated|address_reg_a[1] ; 0                 ; ON      ;
;      - tsinghua:u1|altsyncram:altsyncram_component|altsyncram_qcr:auto_generated|address_reg_a[0] ; 0                 ; ON      ;
; clock2                                                                                            ;                   ;         ;
;      - count_z[2]                                                                                 ; 0                 ; ON      ;
;      - count_z[1]                                                                                 ; 0                 ; ON      ;
;      - count_z[4]                                                                                 ; 0                 ; ON      ;
;      - count_z[0]                                                                                 ; 0                 ; ON      ;
;      - count_z[3]                                                                                 ; 0                 ; ON      ;
+---------------------------------------------------------------------------------------------------+-------------------+---------+


+------------------------------------------------------------------------------------------------------------+
; Control Signals                                                                                            ;
+----------------+---------------+---------+--------------+--------+----------------------+------------------+
; Name           ; Location      ; Fan-Out ; Usage        ; Global ; Global Resource Used ; Global Line Name ;
+----------------+---------------+---------+--------------+--------+----------------------+------------------+
; address[0]~74  ; LC_X15_Y11_N4 ; 14      ; Clock enable ; no     ; --                   ; --               ;
; clock0         ; PIN_123       ; 7       ; Clock        ; yes    ; Global clock         ; GCLK7            ;
; clock2         ; PIN_124       ; 5       ; Clock        ; yes    ; Global clock         ; GCLK2            ;
; clock_25mhz    ; LC_X11_Y9_N2  ; 44      ; Clock        ; yes    ; Global clock         ; GCLK1            ;
; process10~356  ; LC_X15_Y11_N8 ; 4       ; Clock enable ; no     ; --                   ; --               ;
; reduce_nor~111 ; LC_X12_Y11_N6 ; 12      ; Clock enable ; no     ; --                   ; --               ;
; reset          ; PIN_1         ; 49      ; Async. clear ; yes    ; Global clock         ; GCLK3            ;
+----------------+---------------+---------+--------------+--------+----------------------+------------------+


+--------------------------------------------------------------------------------+
; Global & Other Fast Signals                                                    ;
+-------------+--------------+---------+----------------------+------------------+
; Name        ; Location     ; Fan-Out ; Global Resource Used ; Global Line Name ;
+-------------+--------------+---------+----------------------+------------------+
; clock0      ; PIN_123      ; 7       ; Global clock         ; GCLK7            ;
; clock2      ; PIN_124      ; 5       ; Global clock         ; GCLK2            ;
; clock_25mhz ; LC_X11_Y9_N2 ; 44      ; Global clock         ; GCLK1            ;
; reset       ; PIN_1        ; 49      ; Global clock         ; GCLK3            ;
+-------------+--------------+---------+----------------------+------------------+


+---------------------------------+
; Non-Global High Fan-Out Signals ;
+----------------+----------------+
; Name           ; Fan-Out        ;
+----------------+----------------+
; address[0]~74  ; 14             ;
; reduce_nor~111 ; 12             ;
; count_z[4]     ; 10             ;
; count_y[1]     ; 9              ;
; count_z[2]     ; 9              ;
; count_z[1]     ; 8              ;
; process11~63   ; 7              ;
; reduce_nor~108 ; 7              ;
; count_z[3]     ; 6              ;
; add~30COUT     ; 5              ;
; count_x[8]     ; 5              ;
; add~40COUT     ; 4              ;
; count_z[0]     ; 4              ;
; address[11]    ; 4              ;
; address[10]    ; 4              ;
; address[9]     ; 4              ;
; address[8]     ; 4              ;
; address[7]     ; 4              ;
; address[6]     ; 4              ;
; address[5]     ; 4              ;
; address[4]     ; 4              ;
; address[3]     ; 4              ;
; address[2]     ; 4              ;
; address[1]     ; 4              ;
; address[0]     ; 4              ;
; count_x[6]     ; 4              ;
; process10~356  ; 4              ;
; count_x[5]     ; 4              ;
; count_x[7]     ; 4              ;
; count_y[5]     ; 4              ;
; count_y[6]     ; 4              ;
; count_y[7]     ; 4              ;
; count_x[9]     ; 4              ;
; vga_v_sync     ; 4              ;
; vga_h_sync     ; 4              ;
; process10~357  ; 3              ;
; count_y[2]     ; 3              ;
; count_y[3]     ; 3              ;
; count_x[3]     ; 3              ;
; count_x[2]     ; 3              ;
; count_x[1]     ; 3              ;
; count_x[0]     ; 3              ;
; count_x[4]     ; 3              ;
; count_z[0]~187 ; 3              ;
; count_y[8]     ; 3              ;
; process10~348  ; 2              ;
; count_y[4]     ; 2              ;
; count_y[0]     ; 2              ;
; vga_green~107  ; 2              ;
; process10~78   ; 2              ;
+----------------+----------------+


+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter RAM Summary                                                                                                                                                                                                                                                          ;
+--------------------------------------------------------------------------------------+------+------+--------------+--------------+--------------+--------------+-------+---------------------+------+------------------+----------------------------------------------------+
; Name                                                                                 ; Type ; Mode ; Port A Depth ; Port A Width ; Port B Depth ; Port B Width ; Size  ; Implementation Bits ; M4Ks ; MIF              ; Location                                           ;
+--------------------------------------------------------------------------------------+------+------+--------------+--------------+--------------+--------------+-------+---------------------+------+------------------+----------------------------------------------------+
; tsinghua:u1|altsyncram:altsyncram_component|altsyncram_qcr:auto_generated|ALTSYNCRAM ; AUTO ; ROM  ; 16384        ; 1            ; --           ; --           ; 16384 ; 16384               ; 4    ; vgainterface.mif ; M4K_X13_Y10, M4K_X13_Y13, M4K_X13_Y11, M4K_X13_Y12 ;
+--------------------------------------------------------------------------------------+------+------+--------------+--------------+--------------+--------------+-------+---------------------+------+------------------+----------------------------------------------------+


+----------------------------------------------------+
; Interconnect Usage Summary                         ;

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