freqtest.fit.rpt
来自「基于fpga和sopc的用VHDL语言编写的EDA频率测试与FPGA单片机通讯」· RPT 代码 · 共 611 行 · 第 1/5 页
RPT
611 行
; Base pin-out file on sameframe device ; Off ;
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+------------------+
; Fitter Equations ;
+------------------+
The equations can be found in D:/EDA_SOPC6_12/Chpt12_Multi/EP1C6_13_7A_Ftest/FREQTEST.fit.eqn.
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; Floorplan View ;
+----------------+
Floorplan report data cannot be output to ASCII.
Please use Quartus II to view the floorplan report data.
+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in D:/EDA_SOPC6_12/Chpt12_Multi/EP1C6_13_7A_Ftest/FREQTEST.pin.
+------------------------------------------------------+
; Fitter Resource Usage Summary ;
+--------------------------------+---------------------+
; Resource ; Usage ;
+--------------------------------+---------------------+
; Logic cells ; 109 / 5,980 ( 1 % ) ;
; Registers ; 77 / 6,523 ( 1 % ) ;
; Total LABs ; 21 / 598 ( 3 % ) ;
; Logic elements in carry chains ; 32 ;
; User inserted logic cells ; 0 ;
; Virtual pins ; 0 ;
; I/O pins ; 27 / 185 ( 14 % ) ;
; -- Clock pins ; 2 / 2 ( 100 % ) ;
; Global signals ; 8 ;
; M4Ks ; 0 / 20 ( 0 % ) ;
; Total memory bits ; 0 / 92,160 ( 0 % ) ;
; Total RAM block bits ; 0 / 92,160 ( 0 % ) ;
; Global clocks ; 8 / 8 ( 100 % ) ;
; Maximum fan-out node ; TESTCTL:U1|Div2CLK ;
; Maximum fan-out ; 66 ;
; Total fan-out ; 448 ;
; Average fan-out ; 3.25 ;
+--------------------------------+---------------------+
+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+--------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+--------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; CLK ; 153 ; 3 ; 35 ; 12 ; 1 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; DIN[0] ; 184 ; 2 ; 32 ; 21 ; 0 ; 3 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; DIN[1] ; 185 ; 2 ; 32 ; 21 ; 1 ; 3 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; DIN[2] ; 186 ; 2 ; 32 ; 21 ; 2 ; 3 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; DIN[3] ; 187 ; 2 ; 30 ; 21 ; 0 ; 3 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; FSIN ; 28 ; 1 ; 0 ; 12 ; 2 ; 4 ; 0 ; yes ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; P37 ; 218 ; 2 ; 14 ; 21 ; 2 ; 3 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; SEL[0] ; 216 ; 2 ; 14 ; 21 ; 0 ; 16 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; SEL[1] ; 195 ; 2 ; 28 ; 21 ; 1 ; 15 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; SEL[2] ; 188 ; 2 ; 30 ; 21 ; 1 ; 6 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; SEL[3] ; 215 ; 2 ; 16 ; 21 ; 2 ; 6 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
+--------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+-------------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+----------+--------------+--------------+------------------+-------------+----------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Output Register ; Output Enable Register ; Power Up High ; Slow Slew Rate ; PCI I/O Enabled ; Open Drain ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Termination ; Location assigned by ;
+-------------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+----------+--------------+--------------+------------------+-------------+----------------------+
; DATAOUT[0] ; 141 ; 3 ; 35 ; 8 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ;
; DATAOUT[10] ; 167 ; 3 ; 35 ; 16 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ;
; DATAOUT[11] ; 168 ; 3 ; 35 ; 17 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ;
; DATAOUT[1] ; 158 ; 3 ; 35 ; 13 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ;
; DATAOUT[2] ; 159 ; 3 ; 35 ; 13 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ;
; DATAOUT[3] ; 160 ; 3 ; 35 ; 14 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ;
; DATAOUT[4] ; 161 ; 3 ; 35 ; 14 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ;
; DATAOUT[5] ; 162 ; 3 ; 35 ; 15 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ;
; DATAOUT[6] ; 163 ; 3 ; 35 ; 15 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ;
; DATAOUT[7] ; 164 ; 3 ; 35 ; 15 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ;
; DATAOUT[8] ; 165 ; 3 ; 35 ; 16 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ;
; DATAOUT[9] ; 166 ; 3 ; 35 ; 16 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ;
; DLOW[0] ; 180 ; 3 ; 35 ; 20 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ;
; DLOW[1] ; 181 ; 2 ; 34 ; 21 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ;
; DLOW[2] ; 182 ; 2 ; 34 ; 21 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ;
; DLOW[3] ; 183 ; 2 ; 34 ; 21 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ;
+-------------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+----------+--------------+--------------+------------------+-------------+----------------------+
+------------------------------------------------------------+
; I/O Bank Usage ;
+----------+------------------+---------------+--------------+
; I/O Bank ; Usage ; VCCIO Voltage ; VREF Voltage ;
+----------+------------------+---------------+--------------+
; 1 ; 3 / 44 ( 6 % ) ; 3.3V ; -- ;
; 2 ; 12 / 48 ( 25 % ) ; 3.3V ; -- ;
; 3 ; 14 / 45 ( 31 % ) ; 3.3V ; -- ;
; 4 ; 0 / 48 ( 0 % ) ; 3.3V ; -- ;
+----------+------------------+---------------+--------------+
+--------------------------------------------------------------------------------------------------------------------+
; All Package Pins ;
+----------+------------+----------+----------------+--------+--------------+---------+------------+-----------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; Dir. ; I/O Standard ; Voltage ; I/O Type ; User Assignment ;
+----------+------------+----------+----------------+--------+--------------+---------+------------+-----------------+
; 1 ; 0 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 2 ; 1 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 3 ; 2 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 4 ; 3 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 5 ; 4 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 6 ; 5 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 7 ; 6 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 8 ; 7 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 9 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ;
; 10 ; ; 1 ; GND ; gnd ; ; ; -- ; ;
; 11 ; 8 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 12 ; 9 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 13 ; 10 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 14 ; 11 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 15 ; 12 ; 1 ; GND* ; ; ; ; Row I/O ; ;
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