📄 stm8s105c_s.lsr
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STMicroelectronics assembler v4.52 (C)1987-2012 Mon May 28 00:44:23 2012
Page 1 Assembler
f:\单片机\stm\实验\stm8资料\stm8s实验 asm源程序\第三次课 定时器和led驱动\timer2 10s定时器\stm8s105c_s.asm
1 stm8/
2
3 ; STM8S105C_S.asm
4
5 ; Copyright (c) 2003-2011 STMicroelectronics
6
7 ; STM8S105C_S
8
9 000000 BYTES ; following addresses are 8-bit
;length
10
11 segment byte at 0-7F 'periph'
12
13
14 000000 WORDS ; following addresses are 16-bit
; length
15
16 segment byte at 5000 'periph2'
17
18
19 ; Port A at 0x5000
20 ;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;
;;;;;;
21 005000 .PA_ODR DS.B 1 ; Port A data output latch
;register
22 005001 .PA_IDR DS.B 1 ; Port A input pin value
;register
23 005002 .PA_DDR DS.B 1 ; Port A data direction
;register
24 005003 .PA_CR1 DS.B 1 ; Port A control register 1
25 005004 .PA_CR2 DS.B 1 ; Port A control register 2
26
27 ; Port B at 0x5005
28 ;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;
;;;;;;
29 005005 .PB_ODR DS.B 1 ; Port B data output latch
;register
30 005006 .PB_IDR DS.B 1 ; Port B input pin value
;register
31 005007 .PB_DDR DS.B 1 ; Port B data direction
;register
32 005008 .PB_CR1 DS.B 1 ; Port B control register 1
33 005009 .PB_CR2 DS.B 1 ; Port B control register 2
34
35 ; Port C at 0x500a
36 ;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;
;;;;;;
37 00500A .PC_ODR DS.B 1 ; Port C data output latch
;register
38 00500B .PC_IDR DS.B 1 ; Port C input pin value
;register
39 00500C .PC_DDR DS.B 1 ; Port C data direction
;register
40 00500D .PC_CR1 DS.B 1 ; Port C control register 1
41 00500E .PC_CR2 DS.B 1 ; Port C control register 2
42
43 ; Port D at 0x500f
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44 ;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;
;;;;;;
45 00500F .PD_ODR DS.B 1 ; Port D data output latch
;register
46 005010 .PD_IDR DS.B 1 ; Port D input pin value
;register
47 005011 .PD_DDR DS.B 1 ; Port D data direction
;register
48 005012 .PD_CR1 DS.B 1 ; Port D control register 1
49 005013 .PD_CR2 DS.B 1 ; Port D control register 2
50
51 ; Port E at 0x5014
52 ;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;
;;;;;;
53 005014 .PE_ODR DS.B 1 ; Port E data output latch
;register
54 005015 .PE_IDR DS.B 1 ; Port E input pin value
;register
55 005016 .PE_DDR DS.B 1 ; Port E data direction
;register
56 005017 .PE_CR1 DS.B 1 ; Port E control register 1
57 005018 .PE_CR2 DS.B 1 ; Port E control register 2
58 005019 reserved1 DS.B 5 ; unused
59
60 ; Port G at 0x501e
61 ;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;
;;;;;;
62 00501E .PG_ODR DS.B 1 ; Port G data output latch
;register
63 00501F .PG_IDR DS.B 1 ; Port G input pin value
;register
64 005020 .PG_DDR DS.B 1 ; Port G data direction
;register
65 005021 .PG_CR1 DS.B 1 ; Port G control register 1
66 005022 .PG_CR2 DS.B 1 ; Port G control register 2
67 005023 reserved2 DS.B 55 ; unused
68
69 ; Flash at 0x505a
70 ;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;
;;;;;;
71 00505A .FLASH_CR1 DS.B 1 ; Flash control register 1
72 00505B .FLASH_CR2 DS.B 1 ; Flash control register 2
73 00505C .FLASH_NCR2 DS.B 1 ; Flash complementary control
;register 2
74 00505D .FLASH_FPR DS.B 1 ; Flash protection register
75 00505E .FLASH_NFPR DS.B 1 ; Flash complementary protection
; register
76 00505F .FLASH_IAPSR DS.B 1 ; Flash in-application
;programming status register
77 005060 reserved3 DS.B 2 ; unused
78 005062 .FLASH_PUKR DS.B 1 ; Flash Program memory
;unprotection register
79 005063 reserved4 DS.B 1 ; unused
80 005064 .FLASH_DUKR DS.B 1 ; Data EEPROM unprotection
;register
81 005065 reserved5 DS.B 59 ; unused
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STMicroelectronics assembler v4.52 (C)1987-2012 Mon May 28 00:44:23 2012
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83 ; External Interrupt Control Register (ITC) at 0x50a0
84 ;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;
;;;;;;
85 0050A0 .EXTI_CR1 DS.B 1 ; External interrupt control
;register 1
86 0050A1 .EXTI_CR2 DS.B 1 ; External interrupt control
;register 2
87 0050A2 reserved6 DS.B 17 ; unused
88
89 ; Reset (RST) at 0x50b3
90 ;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;
;;;;;;
91 0050B3 .RST_SR DS.B 1 ; Reset status register 1
92 0050B4 reserved7 DS.B 12 ; unused
93
94 ; Clock Control (CLK) at 0x50c0
95 ;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;;
;;;;;;
96 0050C0 .CLK_ICKR DS.B 1 ; Internal clock control
;register
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