📄 mcucpld.fit.rpt
字号:
+---------------------------------+
; Non-Global High Fan-Out Signals ;
+----------+----------------------+
; Name ; Fan-Out ;
+----------+----------------------+
; PSel[0] ; 32 ;
; PSel[1] ; 32 ;
; PP[0] ; 4 ;
; PP[1] ; 4 ;
; PP[2] ; 4 ;
; PP[3] ; 4 ;
; PP[4] ; 4 ;
; PP[5] ; 4 ;
; PP[6] ; 4 ;
; PP[7] ; 4 ;
; SD[0]~94 ; 2 ;
; SD[1]~90 ; 2 ;
; SD[2]~86 ; 2 ;
; SD[3]~82 ; 2 ;
; SD[4]~78 ; 2 ;
; SD[5]~74 ; 2 ;
; SD[6]~70 ; 2 ;
; SD[7]~66 ; 2 ;
; SC[0]~94 ; 2 ;
; SC[1]~90 ; 2 ;
; SC[2]~86 ; 2 ;
; SC[3]~82 ; 2 ;
; SC[4]~78 ; 2 ;
; SC[5]~74 ; 2 ;
; SC[6]~70 ; 2 ;
; SC[7]~66 ; 2 ;
; SB[0]~94 ; 2 ;
; SB[1]~90 ; 2 ;
; SB[2]~86 ; 2 ;
; SB[3]~82 ; 2 ;
; SB[4]~78 ; 2 ;
; SB[5]~74 ; 2 ;
; SB[6]~70 ; 2 ;
; SB[7]~66 ; 2 ;
; SA[0]~94 ; 2 ;
; SA[1]~90 ; 2 ;
; SA[2]~86 ; 2 ;
; SA[3]~82 ; 2 ;
; SA[4]~78 ; 2 ;
; SA[5]~74 ; 2 ;
; SA[6]~70 ; 2 ;
; SA[7]~66 ; 2 ;
+----------+----------------------+
+------------------------------------------------+
; Interconnect Usage Summary ;
+----------------------------+-------------------+
; Interconnect Resource Type ; Usage ;
+----------------------------+-------------------+
; Output enables ; 0 / 6 ( 0 % ) ;
; PIA buffers ; 66 / 288 ( 22 % ) ;
; PIAs ; 74 / 288 ( 25 % ) ;
+----------------------------+-------------------+
+----------------------------------------------------------------------------+
; LAB External Interconnect ;
+----------------------------------------------+-----------------------------+
; LAB External Interconnects (Average = 9.25) ; Number of LABs (Total = 5) ;
+----------------------------------------------+-----------------------------+
; 0 - 1 ; 3 ;
; 2 - 3 ; 0 ;
; 4 - 5 ; 1 ;
; 6 - 7 ; 0 ;
; 8 - 9 ; 0 ;
; 10 - 11 ; 0 ;
; 12 - 13 ; 0 ;
; 14 - 15 ; 0 ;
; 16 - 17 ; 1 ;
; 18 - 19 ; 3 ;
+----------------------------------------------+-----------------------------+
+----------------------------------------------------------------------+
; LAB Macrocells ;
+----------------------------------------+-----------------------------+
; Number of Macrocells (Average = 4.00) ; Number of LABs (Total = 5) ;
+----------------------------------------+-----------------------------+
; 0 ; 3 ;
; 1 ; 1 ;
; 2 ; 0 ;
; 3 ; 0 ;
; 4 ; 0 ;
; 5 ; 0 ;
; 6 ; 0 ;
; 7 ; 1 ;
; 8 ; 3 ;
+----------------------------------------+-----------------------------+
+------------------------------------------------------------------------+
; Logic Cell Interconnection ;
+-----+------------+-----------------------------------+-----------------+
; LAB ; Logic Cell ; Input ; Output ;
+-----+------------+-----------------------------------+-----------------+
; D ; LC64 ; PP[0], SD[0]~94, PSel[0], PSel[1] ; SD[0]~94, PD[0] ;
; D ; LC61 ; PP[1], SD[1]~90, PSel[0], PSel[1] ; SD[1]~90, PD[1] ;
; D ; LC59 ; PP[2], SD[2]~86, PSel[0], PSel[1] ; SD[2]~86, PD[2] ;
; D ; LC57 ; PP[3], SD[3]~82, PSel[0], PSel[1] ; SD[3]~82, PD[3] ;
; D ; LC56 ; PP[4], SD[4]~78, PSel[0], PSel[1] ; SD[4]~78, PD[4] ;
; D ; LC53 ; PP[5], SD[5]~74, PSel[0], PSel[1] ; SD[5]~74, PD[5] ;
; D ; LC51 ; PP[6], SD[6]~70, PSel[0], PSel[1] ; SD[6]~70, PD[6] ;
; D ; LC49 ; PP[7], SD[7]~66, PSel[0], PSel[1] ; SD[7]~66, PD[7] ;
; E ; LC65 ; PP[0], SC[0]~94, PSel[0], PSel[1] ; SC[0]~94, PC[0] ;
; E ; LC67 ; PP[1], SC[1]~90, PSel[0], PSel[1] ; SC[1]~90, PC[1] ;
; E ; LC69 ; PP[2], SC[2]~86, PSel[0], PSel[1] ; SC[2]~86, PC[2] ;
; E ; LC72 ; PP[3], SC[3]~82, PSel[0], PSel[1] ; SC[3]~82, PC[3] ;
; E ; LC73 ; PP[4], SC[4]~78, PSel[0], PSel[1] ; SC[4]~78, PC[4] ;
; E ; LC75 ; PP[5], SC[5]~74, PSel[0], PSel[1] ; SC[5]~74, PC[5] ;
; E ; LC77 ; PP[6], SC[6]~70, PSel[0], PSel[1] ; SC[6]~70, PC[6] ;
; E ; LC80 ; PP[7], SC[7]~66, PSel[0], PSel[1] ; SC[7]~66, PC[7] ;
; F ; LC94 ; PP[7], SB[7]~66, PSel[0], PSel[1] ; SB[7]~66, PB[7] ;
; G ; LC109 ; PP[0], SB[0]~94, PSel[0], PSel[1] ; SB[0]~94, PB[0] ;
; G ; LC107 ; PP[1], SB[1]~90, PSel[0], PSel[1] ; SB[1]~90, PB[1] ;
; G ; LC105 ; PP[2], SB[2]~86, PSel[0], PSel[1] ; SB[2]~86, PB[2] ;
; G ; LC104 ; PP[3], SB[3]~82, PSel[0], PSel[1] ; SB[3]~82, PB[3] ;
; G ; LC101 ; PP[4], SB[4]~78, PSel[0], PSel[1] ; SB[4]~78, PB[4] ;
; G ; LC99 ; PP[5], SB[5]~74, PSel[0], PSel[1] ; SB[5]~74, PB[5] ;
; G ; LC97 ; PP[6], SB[6]~70, PSel[0], PSel[1] ; SB[6]~70, PB[6] ;
; H ; LC128 ; PP[0], SA[0]~94, PSel[0], PSel[1] ; SA[0]~94, PA[0] ;
; H ; LC126 ; PP[1], SA[1]~90, PSel[0], PSel[1] ; SA[1]~90, PA[1] ;
; H ; LC125 ; PP[2], SA[2]~86, PSel[0], PSel[1] ; SA[2]~86, PA[2] ;
; H ; LC123 ; PP[3], SA[3]~82, PSel[0], PSel[1] ; SA[3]~82, PA[3] ;
; H ; LC120 ; PP[4], SA[4]~78, PSel[0], PSel[1] ; SA[4]~78, PA[4] ;
; H ; LC118 ; PP[5], SA[5]~74, PSel[0], PSel[1] ; SA[5]~74, PA[5] ;
; H ; LC117 ; PP[6], SA[6]~70, PSel[0], PSel[1] ; SA[6]~70, PA[6] ;
; H ; LC115 ; PP[7], SA[7]~66, PSel[0], PSel[1] ; SA[7]~66, PA[7] ;
+-----+------------+-----------------------------------+-----------------+
+-----------------+
; Fitter Messages ;
+-----------------+
Info: *******************************************************************
Info: Running Quartus II Fitter
Info: Version 4.2 Build 157 12/07/2004 SJ Full Version
Info: Processing started: Wed Dec 13 10:01:35 2006
Info: Command: quartus_fit --import_settings_files=off --export_settings_files=off MCUCPLD -c MCUCPLD
Info: Selected device EPM7128SLC84-15 for design "MCUCPLD"
Info: Quartus II Fitter was successful. 0 errors, 0 warnings
Info: Processing ended: Wed Dec 13 10:01:37 2006
Info: Elapsed time: 00:00:02
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