📄 counter.fit.rpt
字号:
; 8 ; 7 ;
+--------------------------+----------------+
+----------------------------------------------+
; Local Routing Interconnect ;
+-----------------------------+----------------+
; Local Routing Interconnects ; Number of LABs ;
+-----------------------------+----------------+
; 0 ; 68 ;
; 1 ; 0 ;
; 2 ; 0 ;
; 3 ; 0 ;
; 4 ; 0 ;
; 5 ; 0 ;
; 6 ; 4 ;
+-----------------------------+----------------+
+---------------------------------------------+
; LAB External Interconnect ;
+----------------------------+----------------+
; LAB External Interconnects ; Number of LABs ;
+----------------------------+----------------+
; 0 ; 58 ;
; 1 ; 4 ;
; 2 ; 3 ;
; 3 ; 0 ;
; 4 ; 0 ;
; 5 ; 0 ;
; 6 ; 4 ;
; 7 ; 0 ;
; 8 ; 3 ;
+----------------------------+----------------+
+----------------------------------------------------------------------------------------+
; Row Interconnect ;
+-----------------------------------------------------------------------------------------
; Row ; Interconnect Used ; Left Half Interconnect Used ; Right Half Interconnect Used ;
+-------+-------------------+-----------------------------+------------------------------+
; A ; 1 / 96 ( 1 % ) ; 0 / 48 ( 0 % ) ; 0 / 48 ( 0 % ) ;
; B ; 10 / 96 ( 10 % ) ; 29 / 48 ( 60 % ) ; 0 / 48 ( 0 % ) ;
; C ; 0 / 96 ( 0 % ) ; 0 / 48 ( 0 % ) ; 0 / 48 ( 0 % ) ;
; Total ; 11 / 288 ( 3 % ) ; 29 / 144 ( 20 % ) ; 0 / 144 ( 0 % ) ;
+-------+-------------------+-----------------------------+------------------------------+
+---------------------------+
; LAB Column Interconnect ;
+----------------------------
; Col. ; Interconnect Used ;
+-------+-------------------+
; 1 ; 1 / 24 ( 4 % ) ;
; 2 ; 0 / 24 ( 0 % ) ;
; 3 ; 0 / 24 ( 0 % ) ;
; 4 ; 0 / 24 ( 0 % ) ;
; 5 ; 1 / 24 ( 4 % ) ;
; 6 ; 0 / 24 ( 0 % ) ;
; 7 ; 0 / 24 ( 0 % ) ;
; 8 ; 0 / 24 ( 0 % ) ;
; 9 ; 0 / 24 ( 0 % ) ;
; 10 ; 1 / 24 ( 4 % ) ;
; 11 ; 1 / 24 ( 4 % ) ;
; 12 ; 1 / 24 ( 4 % ) ;
; 13 ; 0 / 24 ( 0 % ) ;
; 14 ; 1 / 24 ( 4 % ) ;
; 15 ; 1 / 24 ( 4 % ) ;
; 16 ; 1 / 24 ( 4 % ) ;
; 17 ; 1 / 24 ( 4 % ) ;
; 18 ; 1 / 24 ( 4 % ) ;
; 19 ; 1 / 24 ( 4 % ) ;
; 20 ; 0 / 24 ( 0 % ) ;
; 21 ; 0 / 24 ( 0 % ) ;
; 22 ; 0 / 24 ( 0 % ) ;
; 23 ; 0 / 24 ( 0 % ) ;
; 24 ; 0 / 24 ( 0 % ) ;
; Total ; 11 / 576 ( 1 % ) ;
+-------+-------------------+
+---------------------------+
; LAB Column Interconnect ;
+----------------------------
; Col. ; Interconnect Used ;
+-------+-------------------+
; 1 ; 0 / 24 ( 0 % ) ;
; Total ; 0 / 24 ( 0 % ) ;
+-------+-------------------+
+---------------------------------------------------+
; Fitter Resource Usage Summary ;
+----------------------------------------------------
; Resource ; Usage ;
+------------------------------+--------------------+
; Logic cells ; 65 / 576 ( 11 % ) ;
; Registers ; 32 / 576 ( 5 % ) ;
; Logic cells in carry chains ; 24 ;
; User inserted logic cells ; 0 ;
; I/O pins ; 12 / 59 ( 20 % ) ;
; -- Clock pins ; 0 ;
; -- Dedicated input pins ; 0 / 4 ( 0 % ) ;
; Global signals ; 3 ;
; EABs ; 0 / 3 ( 0 % ) ;
; Total memory bits ; 0 / 12,288 ( 0 % ) ;
; Total RAM block bits ; 0 / 12,288 ( 0 % ) ;
; Maximum fan-out node ; clk2 ;
; Maximum fan-out ; 16 ;
; Total fan-out ; 167 ;
; Average fan-out ; 2.17 ;
+------------------------------+--------------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Resource Utilization by Entity ;
+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------
; Compilation Hierarchy Node ; Logic Cells ; Registers ; Memory Bits ; Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Carry Chain LCs ; Full Hierarchy Name ;
+----------------------------------------+-------------+-----------+-------------+------+--------------+-------------------+------------------+-----------------+--------------------------------------------------------------------+
; |counter ; 65 (41) ; 32 ; 0 ; 12 ; 33 (17) ; 24 (24) ; 8 (0) ; 24 (0) ; |counter ;
; |lpm_add_sub:i_rtl_1| ; 8 (0) ; 0 ; 0 ; 0 ; 8 (0) ; 0 (0) ; 0 (0) ; 8 (0) ; |counter|lpm_add_sub:i_rtl_1 ;
; |addcore:adder| ; 8 (1) ; 0 ; 0 ; 0 ; 8 (1) ; 0 (0) ; 0 (0) ; 8 (1) ; |counter|lpm_add_sub:i_rtl_1|addcore:adder ;
; |a_csnbuffer:result_node| ; 7 (7) ; 0 ; 0 ; 0 ; 7 (7) ; 0 (0) ; 0 (0) ; 7 (7) ; |counter|lpm_add_sub:i_rtl_1|addcore:adder|a_csnbuffer:result_node ;
; |lpm_add_sub:i_rtl_2| ; 8 (0) ; 0 ; 0 ; 0 ; 8 (0) ; 0 (0) ; 0 (0) ; 8 (0) ; |counter|lpm_add_sub:i_rtl_2 ;
; |addcore:adder| ; 8 (1) ; 0 ; 0 ; 0 ; 8 (1) ; 0 (0) ; 0 (0) ; 8 (1) ; |counter|lpm_add_sub:i_rtl_2|addcore:adder ;
; |a_csnbuffer:result_node| ; 7 (7) ; 0 ; 0 ; 0 ; 7 (7) ; 0 (0) ; 0 (0) ; 7 (7) ; |counter|lpm_add_sub:i_rtl_2|addcore:adder|a_csnbuffer:result_node ;
; |lpm_counter:q1_rtl_0| ; 8 (0) ; 8 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 8 (0) ; 8 (0) ; |counter|lpm_counter:q1_rtl_0 ;
; |alt_counter_f10ke:wysi_counter| ; 8 (8) ; 8 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 8 (8) ; 8 (8) ; |counter|lpm_counter:q1_rtl_0|alt_counter_f10ke:wysi_counter ;
+----------------------------------------+-------------+-----------+-------------+------+--------------+-------------------+------------------+-----------------+--------------------------------------------------------------------+
+-------------------------------+
; Delay Chain Summary ;
+--------------------------------
; Name ; Pin Type ; Pad to Core ;
+------+----------+-------------+
; a ; Input ; OFF ;
; b ; Input ; OFF ;
; clk2 ; Input ; OFF ;
; clk1 ; Input ; OFF ;
; y[0] ; Output ; OFF ;
; y[1] ; Output ; OFF ;
; y[2] ; Output ; OFF ;
; y[3] ; Output ; OFF ;
; y[4] ; Output ; OFF ;
; y[5] ; Output ; OFF ;
; y[6] ; Output ; OFF ;
; y[7] ; Output ; OFF ;
+------+----------+-------------+
+---------------+
; Pin-Out File ;
+---------------+
The pin-out file can be found in e:/Documents and Settings/user/My Documents/pxh/2/counter.pin.
+------------------+
; Fitter Messages ;
+------------------+
Info: *******************************************************************
Info: Running Quartus II Fitter
Info: Version 4.0 Build 190 1/28/2004 SJ Full Version
Info: Processing started: Thu Nov 01 15:37:58 2007
Info: Command: quartus_fit --import_settings_files=off --export_settings_files=off counter -c counter
Info: Selected device EPF10K10LC84-4 for design counter
Info: Timing requirements not specified -- optimizing all clocks equally to maximize operation frequency
Info: Inserted 8 logic cells in first fitting attempt
Info: Started fitting attempt 1 on Thu Nov 01 2007 at 15:37:59
Info: Fitter placement preparation operations beginning
Info: Fitter placement preparation operations ending: elapsed time = 0 seconds
Info: Fitter placement operations beginning
Info: Fitter placement operations ending: elapsed time = 0 seconds
Info: Fitter routing operations beginning
Info: Fitter routing operations ending: elapsed time = 0 seconds
Info: Quartus II Fitter was successful. 0 errors, 0 warnings
Info: Processing ended: Thu Nov 01 15:38:01 2007
Info: Elapsed time: 00:00:02
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