ledwater.hier_info

VHDL接口电路实用源程序

|ledwater
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clk => cnt[20].CLK
clk => cnt[19].CLK
clk => cnt[18].CLK
clk => cnt[17].CLK
clk => cnt[16].CLK
clk => cnt[15].CLK
clk => cnt[14].CLK
clk => cnt[13].CLK
clk => cnt[12].CLK
clk => cnt[11].CLK
clk => cnt[10].CLK
clk => cnt[9].CLK
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clk => cnt[7].CLK
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clk => cnt[5].CLK
clk => cnt[4].CLK
clk => cnt[3].CLK
clk => cnt[2].CLK
clk => cnt[1].CLK
clk => cnt[0].CLK
clk => dataout_tmp[11].CLK
clk => dataout_tmp[10].CLK
clk => dataout_tmp[9].CLK
clk => dataout_tmp[8].CLK
clk => dataout_tmp[7].CLK
clk => dataout_tmp[6].CLK
clk => dataout_tmp[5].CLK
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clk => dataout_tmp[1].CLK
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clk => cnt[22].CLK
rst => process0~0.IN0
dataout[0] <= dataout_tmp[0].DB_MAX_OUTPUT_PORT_TYPE
dataout[1] <= dataout_tmp[1].DB_MAX_OUTPUT_PORT_TYPE
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dataout[3] <= dataout_tmp[3].DB_MAX_OUTPUT_PORT_TYPE
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dataout[6] <= dataout_tmp[6].DB_MAX_OUTPUT_PORT_TYPE
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dataout[11] <= dataout_tmp[11].DB_MAX_OUTPUT_PORT_TYPE