timescale.v

来自「fpga-jpeg-verilog在fpga平台使用verilog语言进行jpe」· Verilog 代码 · 共 3 行

3 行

`timescale 1ns / 10ps

timescale.v - 源码说明

本页面展示了「fpga-jpeg-verilog在fpga平台使用verilog语言进行jpeg算法实现」中的 timescale.v 源码文件，采用 Verilog 编程语言编写，共 3 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

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