ddr_command.versim_xlate
来自「一个小测试程序希望,朋友有所帮助,赶快下吧@@!!VERILOG」· VERSIM_XLATE 代码 · 共 3 行
VERSIM_XLATE
3 行
ddr_command.versim_xlate -- generated only for ProjNav status tracking
Simulation Model Target: Generic_Verilog
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