📄 rs232.fit.rpt
字号:
; dataoutCounter[0] ; Output ; -- ; -- ; -- ; -- ;
; dataoutCounter[1] ; Output ; -- ; -- ; -- ; -- ;
; dataoutCounter[2] ; Output ; -- ; -- ; -- ; -- ;
; dataoutCounter[3] ; Output ; -- ; -- ; -- ; -- ;
; SendCountReset ; Output ; -- ; -- ; -- ; -- ;
+-------------------+----------+---------------+---------------+-----------------------+-----+
+------------------------------------------------------------+
; Pad To Core Delay Chain Fanout ;
+------------------------------+-------------------+---------+
; Source Pin / Fanout ; Pad To Core Index ; Setting ;
+------------------------------+-------------------+---------+
; sending ; ; ;
; - outRegister[0]~reg ; 0 ; ON ;
; - data_to_urst~0 ; 0 ; ON ;
; - outRegister[1]~reg ; 0 ; ON ;
; - outRegister[2]~reg ; 0 ; ON ;
; - outRegister[3]~reg ; 0 ; ON ;
; - outRegister[4]~reg ; 0 ; ON ;
; - outRegister[5]~reg ; 0 ; ON ;
; - outRegister[6]~reg ; 0 ; ON ;
; - dataoutCounter[0]~reg ; 0 ; ON ;
; - dataoutCounter[1]~reg ; 0 ; ON ;
; - dataoutCounter[2]~reg ; 0 ; ON ;
; - SendCountReset~reg ; 0 ; ON ;
; - dataoutCounter[3]~99 ; 0 ; ON ;
; dataoutset ; ; ;
; - outRegister[0]~reg ; 0 ; ON ;
; - outRegister[1]~reg ; 0 ; ON ;
; - outRegister[2]~reg ; 0 ; ON ;
; - outRegister[3]~reg ; 0 ; ON ;
; - outRegister[4]~reg ; 0 ; ON ;
; - outRegister[5]~reg ; 0 ; ON ;
; - outRegister[6]~reg ; 0 ; ON ;
; - outRegister[7]~reg ; 0 ; ON ;
; Cpudata[0] ; ; ;
; - outRegister[0]~reg ; 1 ; ON ;
; dataoutclk ; ; ;
; Cpudata[1] ; ; ;
; - outRegister[1]~reg ; 0 ; ON ;
; Cpudata[2] ; ; ;
; - outRegister[2]~reg ; 0 ; ON ;
; Cpudata[3] ; ; ;
; - outRegister[3]~reg ; 0 ; ON ;
; Cpudata[4] ; ; ;
; - outRegister[4]~reg ; 1 ; ON ;
; Cpudata[5] ; ; ;
; - outRegister[5]~reg ; 1 ; ON ;
; Cpudata[6] ; ; ;
; - outRegister[6]~reg ; 0 ; ON ;
; Cpudata[7] ; ; ;
; - outRegister[7]~reg ; 0 ; ON ;
+------------------------------+-------------------+---------+
+--------------------------------------------------------------------------------------------+
; Control Signals ;
+------------+----------+---------+-------+--------+----------------------+------------------+
; Name ; Location ; Fan-Out ; Usage ; Global ; Global Resource Used ; Global Line Name ;
+------------+----------+---------+-------+--------+----------------------+------------------+
; dataoutclk ; PIN_17 ; 13 ; Clock ; yes ; Global clock ; GCLK3 ;
+------------+----------+---------+-------+--------+----------------------+------------------+
+---------------------------------------------------------------------------+
; Global & Other Fast Signals ;
+------------+----------+---------+----------------------+------------------+
; Name ; Location ; Fan-Out ; Global Resource Used ; Global Line Name ;
+------------+----------+---------+----------------------+------------------+
; dataoutclk ; PIN_17 ; 13 ; Global clock ; GCLK3 ;
+------------+----------+---------+----------------------+------------------+
+---------------------------------+
; Non-Global High Fan-Out Signals ;
+-----------------------+---------+
; Name ; Fan-Out ;
+-----------------------+---------+
; sending ; 13 ;
; dataoutset ; 8 ;
; SendCountReset~reg ; 5 ;
; dataoutCounter[2]~reg ; 4 ;
; dataoutCounter[0]~reg ; 4 ;
; _~50 ; 3 ;
; dataoutCounter[3]~reg ; 3 ;
; dataoutCounter[1]~reg ; 3 ;
; outRegister[7]~reg ; 2 ;
; outRegister[6]~reg ; 2 ;
; outRegister[5]~reg ; 2 ;
; outRegister[4]~reg ; 2 ;
; outRegister[3]~reg ; 2 ;
; outRegister[2]~reg ; 2 ;
; outRegister[1]~reg ; 2 ;
; outRegister[0]~reg ; 2 ;
; Cpudata[7] ; 1 ;
; Cpudata[6] ; 1 ;
; Cpudata[5] ; 1 ;
; Cpudata[4] ; 1 ;
; Cpudata[3] ; 1 ;
; Cpudata[2] ; 1 ;
; Cpudata[1] ; 1 ;
; Cpudata[0] ; 1 ;
; dataoutCounter[3]~99 ; 1 ;
; data_to_urst~0 ; 1 ;
+-----------------------+---------+
+----------------------------------------------------+
; Interconnect Usage Summary ;
+----------------------------+-----------------------+
; Interconnect Resource Type ; Usage ;
+----------------------------+-----------------------+
; C4s ; 29 / 8,840 ( < 1 % ) ;
; Direct links ; 3 / 11,506 ( < 1 % ) ;
; Global clocks ; 1 / 8 ( 12 % ) ;
; LAB clocks ; 1 / 156 ( < 1 % ) ;
; LUT chains ; 1 / 2,619 ( < 1 % ) ;
; Local interconnects ; 29 / 11,506 ( < 1 % ) ;
; M4K buffers ; 0 / 468 ( 0 % ) ;
; R4s ; 25 / 7,520 ( < 1 % ) ;
+----------------------------+-----------------------+
+--------------------------------------------------------------------------+
; LAB Logic Elements ;
+--------------------------------------------+-----------------------------+
; Number of Logic Elements (Average = 8.00) ; Number of LABs (Total = 2) ;
+--------------------------------------------+-----------------------------+
; 1 ; 0 ;
; 2 ; 0 ;
; 3 ; 0 ;
; 4 ; 0 ;
; 5 ; 0 ;
; 6 ; 1 ;
; 7 ; 0 ;
; 8 ; 0 ;
; 9 ; 0 ;
; 10 ; 1 ;
+--------------------------------------------+-----------------------------+
+------------------------------------------------------------------+
; LAB-wide Signals ;
+------------------------------------+-----------------------------+
; LAB-wide Signals (Average = 1.00) ; Number of LABs (Total = 2) ;
+------------------------------------+-----------------------------+
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