📄 lvds.fit.rpt
字号:
; Enable Bus-Hold Circuitry ; Off ; Off ;
; Auto Global Memory Control Signals ; Off ; Off ;
; Auto Packed Registers -- Stratix II/Cyclone II ; Auto ; Auto ;
; Auto Delay Chains ; On ; On ;
; Auto Merge PLLs ; On ; On ;
; Ignore PLL Mode When Merging PLLs ; Off ; Off ;
; Fitter Effort ; Auto Fit ; Auto Fit ;
; Physical Synthesis Effort Level ; Normal ; Normal ;
; Auto Global Clock ; On ; On ;
; Auto Global Register Control Signals ; On ; On ;
; Always Enable Input Buffers ; Off ; Off ;
+------------------------------------------------+--------------------------------+--------------------------------+
+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in D:/altera/lvds/lvds.pin.
+----------------------------------------------------------------------------------------------------------------------------+
; Fitter Resource Usage Summary ;
+---------------------------------------------+------------------------------------------------------------------------------+
; Resource ; Usage ;
+---------------------------------------------+------------------------------------------------------------------------------+
; Total logic elements ; 432 / 4,608 ( 9 % ) ;
; -- Combinational with no register ; 74 ;
; -- Register only ; 152 ;
; -- Combinational with a register ; 206 ;
; ; ;
; Logic element usage by number of LUT inputs ; ;
; -- 4 input functions ; 147 ;
; -- 3 input functions ; 43 ;
; -- <=2 input functions ; 90 ;
; -- Register only ; 152 ;
; ; ;
; Logic elements by mode ; ;
; -- normal mode ; 239 ;
; -- arithmetic mode ; 41 ;
; ; ;
; Total registers ; 360 / 4,608 ( 8 % ) ;
; Total LABs ; 34 / 288 ( 12 % ) ;
; User inserted logic elements ; 0 ;
; Virtual pins ; 0 ;
; I/O pins ; 26 / 142 ( 18 % ) ;
; -- Clock pins ; 1 / 4 ( 25 % ) ;
; Number of I/O registers ; 2 ;
; Global signals ; 8 ;
; M4Ks ; 1 / 26 ( 4 % ) ;
; Total memory bits ; 2,304 / 119,808 ( 2 % ) ;
; Total RAM block bits ; 4,608 / 119,808 ( 4 % ) ;
; Embedded Multiplier 9-bit elements ; 0 / 26 ( 0 % ) ;
; PLLs ; 1 / 2 ( 50 % ) ;
; Global clocks ; 8 / 8 ( 100 % ) ;
; Maximum fan-out node ; altera_internal_jtag~TCKUTAPclkctrl ;
; Maximum fan-out ; 198 ;
; Highest non-global fan-out signal ; sld_signaltap:auto_signaltap_0|sld_ela_control:ela_control|trigger_setup_ena ;
; Highest non-global fan-out ; 70 ;
; Total fan-out ; 2212 ;
; Average fan-out ; 2.75 ;
+---------------------------------------------+------------------------------------------------------------------------------+
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+---------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+---------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; clk_i ; 23 ; 1 ; 0 ; 6 ; 0 ; 1 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; reset_n ; 89 ; 4 ; 19 ; 0 ; 0 ; 17 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; rx_i ; 176 ; 2 ; 17 ; 14 ; 1 ; 1 ; 1 ; no ; yes ; no ; no ; no ; Off ; LVDS ; Off ; User ;
; rx_i(n) ; 175 ; 2 ; 17 ; 14 ; 0 ; 0 ; 1 ; no ; yes ; no ; no ; no ; Off ; LVDS ; Off ; Fitter ;
+---------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+-----------------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Output Register ; Output Enable Register ; Power Up High ; PCI I/O Enabled ; Open Drain ; TRI Primitive ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Termination ; Location assigned by ; Load ;
+-----------------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+------+
; data_reveive[0] ; 74 ; 4 ; 12 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; data_reveive[1] ; 80 ; 4 ; 17 ; 0 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; data_reveive[2] ; 75 ; 4 ; 12 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; data_reveive[3] ; 76 ; 4 ; 14 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; data_reveive[4] ; 77 ; 4 ; 14 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; data_reveive[5] ; 133 ; 3 ; 28 ; 8 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; data_reveive[6] ; 72 ; 4 ; 9 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; data_reveive[7] ; 70 ; 4 ; 9 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; tr_reg[0] ; 143 ; 3 ; 28 ; 10 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; tr_reg[1] ; 138 ; 3 ; 28 ; 9 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; tr_reg[2] ; 84 ; 4 ; 17 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; tr_reg[3] ; 142 ; 3 ; 28 ; 10 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; tr_reg[4] ; 137 ; 3 ; 28 ; 9 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; tr_reg[5] ; 135 ; 3 ; 28 ; 9 ; 2 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; tr_reg[6] ; 139 ; 3 ; 28 ; 10 ; 3 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; tr_reg[7] ; 134 ; 3 ; 28 ; 8 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; 0 pF ;
; tx_o ; 180 ; 2 ; 14 ; 14 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVDS ; Maximum Current ; Off ; User ; 0 pF ;
; tx_o(n) ; 179 ; 2 ; 14 ; 14 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVDS ; Maximum Current ; Off ; Fitter ; 0 pF ;
+-----------------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+------+
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