iq_pn_gen._prj

来自「FPGA/CPLD集成开发环境ise的使用详解示例代码7」· _PRJ 代码 · 共 5 行

_PRJ

5 行

insert  `timescale 1ns/1ns
include 
include iq_pn_gen.v
include D:/Xilinx/verilog/src/iSE/unisim_comp.v

iq_pn_gen._prj - 源码说明

本页面展示了「FPGA/CPLD集成开发环境ise的使用详解示例代码7」中的 iq_pn_gen._prj 源码文件，采用 _PRJ 编程语言编写，共 5 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

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