📄 count_25.txt
字号:
module count_25(clk,reset,cnt_25);
output [4:0]cnt_25;
input clk,reset;
reg [4:0]cnt_25;
always @ ( posedge clk or posedge reset)
begin
if( reset)
cnt_25 <= 5'b00000;
else
if( cnt_25 == 5'b00000)
cnt_25 <= 5'b11000;
else
cnt_25<= cnt_25 - 5'b00001;
end
endmodule
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