📄 da.fit.rpt
字号:
Fitter report for da
Fri Jul 30 13:43:42 2004
Version 4.0 Build 214 3/25/2004 Service Pack 1 SJ Full Version
---------------------
; Table of Contents ;
---------------------
1. Legal Notice
2. Fitter Summary
3. Fitter Settings
4. Fitter Device Options
5. Fitter Equations
6. Floorplan View
7. Input Pins
8. Output Pins
9. All Package Pins
10. Control Signals
11. Global & Other Fast Signals
12. Non-Global High Fan-Out Signals
13. LAB
14. Local Routing Interconnect
15. LAB External Interconnect
16. Row Interconnect
17. LAB Column Interconnect
18. LAB Column Interconnect
19. Fitter Resource Usage Summary
20. Fitter Resource Utilization by Entity
21. Delay Chain Summary
22. Pin-Out File
23. Fitter Messages
----------------
; Legal Notice ;
----------------
Copyright (C) 1991-2004 Altera Corporation
Any megafunction design, and related netlist (encrypted or decrypted),
support information, device programming or simulation file, and any other
associated documentation or information provided by Altera or a partner
under Altera's Megafunction Partnership Program may be used only
to program PLD devices (but not masked PLD devices) from Altera. Any
other use of such megafunction design, netlist, support information,
device programming or simulation file, or any other related documentation
or information is prohibited for any other purpose, including, but not
limited to modification, reverse engineering, de-compiling, or use with
any other silicon devices, unless such use is explicitly licensed under
a separate agreement with Altera or a megafunction partner. Title to the
intellectual property, including patents, copyrights, trademarks, trade
secrets, or maskworks, embodied in any such megafunction design, netlist,
support information, device programming or simulation file, or any other
related documentation or information provided by Altera or a megafunction
partner, remains with Altera, the megafunction partner, or their respective
licensors. No other licenses, including any licenses needed under any third
party's intellectual property, are provided herein.
+---------------------------------------------------------------+
; Fitter Summary ;
+-----------------------+---------------------------------------+
; Fitter Status ; Successful - Fri Jul 30 13:43:42 2004 ;
; Revision Name ; da ;
; Top-level Entity Name ; da ;
; Family ; ACEX1K ;
; Device ; EP1K30TC144-3 ;
; Total logic elements ; 17 / 1,728 ( < 1 % ) ;
; Total pins ; 21 / 102 ( 20 % ) ;
; Total memory bits ; 0 / 24,576 ( 0 % ) ;
; Total PLLs ; 0 ;
+-----------------------+---------------------------------------+
+------------------------------------------------------------------------------------------------------+
; Fitter Settings ;
+-------------------------------------------------------------------------------------------------------
; Option ; Setting ; Default Value ;
+------------------------------------------------------------+--------------------+--------------------+
; Device ; EP1K30TC144-3 ; ;
; Logic Cell Insertion - I/Os Fed By Carry or Cascade Chains ; On ; On ;
; Logic Cell Insertion - Individual Logic Cells ; On ; On ;
; Auto Global Memory Control Signals ; Off ; Off ;
; PCI I/O ; Off ; Off ;
; Slow Slew Rate ; Off ; Off ;
; Fitter Initial Placement Seed ; 1 ; 1 ;
; Final Placement Optimizations ; Automatically ; Automatically ;
; FIT_ONLY_ONE_ATTEMPT ; Off ; Off ;
; Optimize IOC Register Placement for Timing ; On ; On ;
; Optimize Timing ; Normal Compilation ; Normal Compilation ;
+------------------------------------------------------------+--------------------+--------------------+
+-------------------------------------------------------------------------+
; Fitter Device Options ;
+--------------------------------------------------------------------------
; Option ; Setting ;
+----------------------------------------------+--------------------------+
; Auto-restart configuration after error ; On ;
; Release clears before tri-states ; Off ;
; Enable user-supplied start-up clock (CLKUSR) ; Off ;
; Enable device-wide reset (DEV_CLRn) ; Off ;
; Enable device-wide output enable (DEV_OE) ; Off ;
; Enable INIT_DONE output ; Off ;
; Reserve all unused pins ; As output driving ground ;
; Base pin-out file on sameframe device ; Off ;
+----------------------------------------------+--------------------------+
+-------------------+
; Fitter Equations ;
+-------------------+
The equations can be found in D:/workspace/dsp-d/chenpin/da/da.fit.eqn.
+-----------------+
; Floorplan View ;
+-----------------+
Floorplan report data cannot be output to ASCII.
Please use Quartus II to view the floorplan report data.
+---------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+----------------------------------------------------------------------------------------------------------------------------------------------------------
; Name ; Pin # ; Row ; Col. ; Fan-Out ; Global ; I/O Register ; Use Local Routing Input ; Power Up High ; PCI I/O Enabled ; Single-Pin CE ; I/O Standard ;
+-------+-------+-----+------+---------+--------+--------------+-------------------------+---------------+-----------------+---------------+--------------+
; clk ; 125 ; -- ; -- ; 17 ; yes ; no ; no ; no ; no ; no ; LVTTL/LVCMOS ;
; rst ; 99 ; B ; -- ; 8 ; no ; no ; no ; no ; no ; no ; LVTTL/LVCMOS ;
; da[7] ; 70 ; -- ; 5 ; 1 ; no ; no ; no ; no ; no ; no ; LVTTL/LVCMOS ;
; da[6] ; 72 ; -- ; 3 ; 1 ; no ; no ; no ; no ; no ; no ; LVTTL/LVCMOS ;
; da[5] ; 73 ; -- ; 1 ; 1 ; no ; no ; no ; no ; no ; no ; LVTTL/LVCMOS ;
; da[4] ; 78 ; F ; -- ; 1 ; no ; no ; no ; no ; no ; no ; LVTTL/LVCMOS ;
; da[3] ; 79 ; F ; -- ; 1 ; no ; no ; no ; no ; no ; no ; LVTTL/LVCMOS ;
; da[2] ; 80 ; F ; -- ; 1 ; no ; no ; no ; no ; no ; no ; LVTTL/LVCMOS ;
; da[1] ; 81 ; F ; -- ; 1 ; no ; no ; no ; no ; no ; no ; LVTTL/LVCMOS ;
; da[0] ; 82 ; F ; -- ; 1 ; no ; no ; no ; no ; no ; no ; LVTTL/LVCMOS ;
+-------+-------+-----+------+---------+--------+--------------+-------------------------+---------------+-----------------+---------------+--------------+
+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------
; Name ; Pin # ; Row ; Col. ; I/O Register ; Use Local Routing Output ; Power Up High ; Slow Slew Rate ; PCI I/O Enabled ; Single-Pin OE ; Single-Pin CE ; Open Drain ; I/O Standard ;
+----------+-------+-----+------+--------------+--------------------------+---------------+----------------+-----------------+---------------+---------------+------------+--------------+
; adclk ; 69 ; -- ; 6 ; no ; no ; no ; no ; no ; no ; no ; no ; LVTTL/LVCMOS ;
; daout[7] ; 96 ; C ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; LVTTL/LVCMOS ;
; daout[6] ; 95 ; C ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; LVTTL/LVCMOS ;
; daout[5] ; 92 ; D ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; LVTTL/LVCMOS ;
; daout[4] ; 91 ; D ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; LVTTL/LVCMOS ;
; daout[3] ; 90 ; D ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; LVTTL/LVCMOS ;
; daout[2] ; 89 ; D ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; LVTTL/LVCMOS ;
; daout[1] ; 88 ; D ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; LVTTL/LVCMOS ;
; daout[0] ; 87 ; E ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; LVTTL/LVCMOS ;
; adcs ; 83 ; E ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; LVTTL/LVCMOS ;
; dacs ; 86 ; E ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; LVTTL/LVCMOS ;
+----------+-------+-----+------+--------------+--------------------------+---------------+----------------+-----------------+---------------+---------------+------------+--------------+
+-----------------------------------+
; All Package Pins ;
+------------------------------------
; Pin # ; Usage ; I/O Standard ;
+-------+------------+--------------+
; 1 ; #TCK ; ;
; 2 ; ^CONF_DONE ; ;
; 3 ; ^nCEO ; ;
; 4 ; #TDO ; ;
; 5 ; VCC_IO ; ;
; 6 ; GND_INT ; ;
; 7 ; GND* ; ;
; 8 ; GND* ; ;
; 9 ; GND* ; ;
; 10 ; GND* ; ;
; 11 ; GND* ; ;
; 12 ; GND* ; ;
; 13 ; GND* ; ;
; 14 ; GND* ; ;
; 15 ; GND_INT ; ;
; 16 ; VCC_INT ; ;
; 17 ; GND* ; ;
; 18 ; GND* ; ;
; 19 ; GND* ; ;
; 20 ; GND* ; ;
; 21 ; GND* ; ;
; 22 ; GND* ; ;
; 23 ; GND* ; ;
; 24 ; VCC_IO ; ;
; 25 ; GND_INT ; ;
; 26 ; GND* ; ;
; 27 ; GND* ; ;
; 28 ; GND* ; ;
; 29 ; GND* ; ;
; 30 ; GND* ; ;
; 31 ; GND* ; ;
; 32 ; GND* ; ;
; 33 ; GND* ; ;
; 34 ; #TMS ; ;
; 35 ; ^nSTATUS ; ;
; 36 ; GND* ; ;
; 37 ; GND* ; ;
; 38 ; GND* ; ;
; 39 ; GND* ; ;
; 40 ; GND_INT ; ;
; 41 ; GND* ; ;
; 42 ; GND* ; ;
; 43 ; GND* ; ;
; 44 ; GND* ; ;
; 45 ; VCC_IO ; ;
; 46 ; GND* ; ;
; 47 ; GND* ; ;
; 48 ; GND* ; ;
; 49 ; GND* ; ;
; 50 ; VCC_INT ; ;
; 51 ; GND* ; ;
; 52 ; GND_INT ; ;
; 53 ; VCC_CKLK ; ;
; 54 ; GND+ ; ;
; 55 ; GND+ ; ;
; 56 ; GND+ ; ;
; 57 ; GND_CKLK ; ;
; 58 ; GND_INT ; ;
; 59 ; GND* ; ;
; 60 ; GND* ; ;
; 61 ; VCC_IO ; ;
; 62 ; GND* ; ;
; 63 ; GND* ; ;
; 64 ; GND* ; ;
; 65 ; GND* ; ;
; 66 ; GND_INT ; ;
; 67 ; GND* ; ;
; 68 ; GND* ; ;
; 69 ; adclk ; LVTTL/LVCMOS ;
; 70 ; da[7] ; LVTTL/LVCMOS ;
; 71 ; VCC_IO ; ;
; 72 ; da[6] ; LVTTL/LVCMOS ;
; 73 ; da[5] ; LVTTL/LVCMOS ;
; 74 ; ^nCONFIG ; ;
; 75 ; VCC_INT ; ;
; 76 ; ^MSEL1 ; ;
; 77 ; ^MSEL0 ; ;
; 78 ; da[4] ; LVTTL/LVCMOS ;
; 79 ; da[3] ; LVTTL/LVCMOS ;
; 80 ; da[2] ; LVTTL/LVCMOS ;
; 81 ; da[1] ; LVTTL/LVCMOS ;
; 82 ; da[0] ; LVTTL/LVCMOS ;
; 83 ; adcs ; LVTTL/LVCMOS ;
; 84 ; GND_INT ; ;
; 85 ; VCC_INT ; ;
; 86 ; dacs ; LVTTL/LVCMOS ;
; 87 ; daout[0] ; LVTTL/LVCMOS ;
; 88 ; daout[1] ; LVTTL/LVCMOS ;
; 89 ; daout[2] ; LVTTL/LVCMOS ;
; 90 ; daout[3] ; LVTTL/LVCMOS ;
; 91 ; daout[4] ; LVTTL/LVCMOS ;
; 92 ; daout[5] ; LVTTL/LVCMOS ;
; 93 ; GND_INT ; ;
; 94 ; VCC_IO ; ;
; 95 ; daout[6] ; LVTTL/LVCMOS ;
; 96 ; daout[7] ; LVTTL/LVCMOS ;
; 97 ; GND* ; ;
; 98 ; GND* ; ;
; 99 ; rst ; LVTTL/LVCMOS ;
; 100 ; GND* ; ;
; 101 ; GND* ; ;
; 102 ; GND* ; ;
; 103 ; VCC_INT ; ;
; 104 ; GND_INT ; ;
; 105 ; #TDI ; ;
; 106 ; ^nCE ; ;
; 107 ; ^DCLK ; ;
; 108 ; ^DATA0 ; ;
; 109 ; GND* ; ;
; 110 ; GND* ; ;
; 111 ; GND* ; ;
; 112 ; GND* ; ;
; 113 ; GND* ; ;
; 114 ; GND* ; ;
; 115 ; VCC_IO ; ;
; 116 ; GND* ; ;
; 117 ; GND* ; ;
; 118 ; GND* ; ;
; 119 ; GND* ; ;
; 120 ; GND* ; ;
; 121 ; GND* ; ;
; 122 ; GND* ; ;
⌨️ 快捷键说明
复制代码
Ctrl + C
搜索代码
Ctrl + F
全屏模式
F11
切换主题
Ctrl + Shift + D
显示快捷键
?
增大字号
Ctrl + =
减小字号
Ctrl + -