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<title>学位论文－人民币智能分捡器硬件系统设计</title>
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<p></p></td>
<td width="81%"><p>馆藏号：Y861109<br>
<br>
论 文 题 目：<strong style="font-weight: 400">人民币智能分捡器硬件系统设计</strong><br>
学位授予单位：武汉理工大学<br>
作 者：吴慧峰<br>
申请学位级别：硕士<br>
学 科 名 称：检测技术与自动化装置<br>
指 导 教 师：李中年<br>
出 版 时 间：20060401<br>
摘 要：<br>
本课题根据市场的需求，从人民币的分捡功能入手，采用双CPU控制的结构，即DSP和单片机共同控制人民币的分捡、验钞、点钞等功能。人民币智能分捡器采用光电转化和光电识别技术，利用DSP芯片高速的数字处理能力，采用图像识别的方法分捡人民币；同时将神经网络技术用于其中，加强了检测信号的准确性，并且使系统始终处于最佳运行状态；由单片机控制外围电路部分，如光电、磁性、图像传感器，并对相关的数据进行采集和处理，以及设备本身的故障监测任务，对点钞过程中可能出现的半张，粘张，重张等情况进行相应判断与处理，有效防止错点、漏点的可能。同时采用CPLD逻辑芯片对系统的整体逻辑关系进行全局处理，简化了电路。<br> 主要论述了人民币智能分捡器的硬件部分设计。首先阐述人民币智能分捡器相关技术的发展状况、发展趋势以及课题背景与研究意义；然后设计了利用图像传感器采集人民币图像输出模拟视频信号的硬件电路，以及利用视频解码芯片(SAA7113)对模拟视频图像进行预处理，SAA7113输出的标准数字视频信号存入FIFO存储器，同时还解码输出场、行同步信号、像素时钟信号送入CPLD等部分电路；重点设计了单片机控制验钞、点钞等外围电路，以及DSP控制的外围电路，如存储器的扩展等部分；最后完成CPLD对部分器件的逻辑和时序控制设计，并对逻辑电路的功能进行仿真，仿真结果令人满意。<br> <br>
分 类 号：TH693.5;TP391.41<br>
关 键 词：人民币;智能分捡器;硬件系统;图像采集;逻辑芯片;图像识别
<p align="center">
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