mvbif.pad

来自「MVBC VHDL代码..实现多功能车辆总线的通信」· PAD 代码 · 共 238 行

PAD
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Release 6.1i - Par G.23Copyright (c) 1995-2003 Xilinx, Inc.  All rights reserved.Wed Jan 10 15:30:37 2007NOTE: This file is designed to be imported into a spreadsheet programsuch as Microsoft Excel for viewing, printing and sorting. The |character is used as the data field separator. This file is also designedto support parsing.INPUT FILE:       mvbif_map.ncdOUTPUT FILE:      mvbif.padPART TYPE:        xc2s300eSPEED GRADE:      -6PACKAGE:          pq208Pinout by Pin Number:-----|-----|-----|-----|-----|-----|-----|-----|-----|-----|-----|-----|-----|Pin Number|Signal Name|Pin Usage|Pin Name|Direction|IO Standard|IO Bank Number|Drive (mA)|Slew Rate|Termination|IOB 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|||P25|||GND||||||||||P26|||VCCO|||0|||||3.30||P27||PCIIOB|IO_TRDY|UNUSED||(0,6)***|||||||P28|||VCCINT||||||||1.8||P29|CS<6>|IOB|IO|INPUT|LVTTL|(0,6)***||||NONE|||P3||IOB|IO|UNUSED||(0,7)***|||||||P30|CS<4>|IOB|IO_L43P_Y|INPUT|LVTTL|(0,6)***||||NONE|||P31|CS<5>|IOB|IO_VREF_6_L43N_Y|INPUT|LVTTL|(0,6)***||||NONE|||P32|||GND||||||||||P33|cs_cpu_n|IOB|IO_L42P_YY|INPUT|LVTTL|(0,6)***||||IFD|||P34|SPARE0|IOB|IO_L42N_YY|OUTPUT|LVTTL|(0,6)***|12|SLOW|NONE**||||P35|cs_mvbc_n|IOB|IO_L41P_YY|OUTPUT|LVTTL|(0,6)***|12|SLOW|NONE**||||P36|addr_cpu<20>|IOB|IO_L41N_YY|INPUT|LVTTL|(0,6)***||||NONE|||P37|||VCCINT||||||||1.8||P38|||VCCO|||0|||||3.30||P39|||GND||||||||||P4||IOB|IO_VREF_7|UNUSED||(0,7)***|||||||P40|addr_mvbc<11>|IOB|IO_L40P_Y|OUTPUT|LVTTL|(0,6)***|12|SLOW|NONE**||||P41|addr_cpu<3>|IOB|IO_VREF_6_L40N_Y|INPUT|LVTTL|(0,6)***||||NONE|||P42|addr_cpu<1>|IOB|IO|INPUT|LVTTL|(0,6)***||||NONE|||P43|addr_cpu<17>|IOB|IO|INPUT|LVTTL|(0,6)***||||NONE|||P44|addr_cpu<22>|IOB|IO|INPUT|LVTTL|(0,6)***||||NONE|||P45|wr_mvbc_n|IOB|IO_VREF_6_L39P|OUTPUT|LVTTL|(0,6)***|12|SLOW|NONE**||||P46|addr_cpu<18>|IOB|IO_L39N|INPUT|LVTTL|(0,6)***||||NONE|||P47|addr_cpu<16>|IOB|IO_VREF_6|INPUT|LVTTL|(0,6)***||||NONE|||P48|addr_cpu<15>|IOB|IO_L38P_YY|INPUT|LVTTL|(0,6)***||||NONE|||P49|addr_cpu<14>|IOB|IO_L38N_YY|INPUT|LVTTL|(0,6)***||||NONE|||P5||IOB|IO|UNUSED||(0,7)***|||||||P50|||M1||||||||||P51|||GND||||||||||P52|||M0||||||||||P53|||VCCO|||0|||||3.30||P54|||M2||||||||||P55|addr_cpu<13>|IOB|IO_L37N_YY|INPUT|LVTTL|(0,5)***||||NONE|||P56|addr_mvbc<9>|IOB|IO_L37P_YY|OUTPUT|LVTTL|(0,5)***|12|SLOW|NONE**||||P57|addr_mvbc<3>|IOB|IO_VREF_5|OUTPUT|LVTTL|(0,5)***|12|SLOW|NONE**||||P58|addr_mvbc<18>|IOB|IO|OUTPUT|LVTTL|(0,5)***|12|SLOW|NONE**||||P59|rd_mvbc_n|IOB|IO_VREF_5_L36N_YY|OUTPUT|LVTTL|(0,5)***|12|SLOW|NONE**||||P6||IOB|IO_VREF_7_L49P_Y|UNUSED||(0,7)***|||||||P60|addr_mvbc<17>|IOB|IO_L36P_YY|OUTPUT|LVTTL|(0,5)***|12|SLOW|NONE**||||P61|addr_mvbc<6>|IOB|IO_L35N_Y|OUTPUT|LVTTL|(0,5)***|12|SLOW|NONE**||||P62|addr_cpu<11>|IOB|IO_L35P_Y|INPUT|LVTTL|(0,5)***||||IFD|||P63|addr_mvbc<22>|IOB|IO_VREF_5_L34N_Y|OUTPUT|LVTTL|(0,5)***|12|SLOW|NONE**||||P64|addr_mvbc<16>|IOB|IO_L34P_Y|OUTPUT|LVTTL|(0,5)***|12|SLOW|NONE**||||P65|||GND||||||||||P66|||VCCO|||0|||||3.30||P67|||VCCINT||||||||1.8||P68|addr_mvbc<5>|IOB|IO_L33N_Y|OUTPUT|LVTTL|(0,5)***|12|SLOW|NONE**||||P69|addr_mvbc<13>|IOB|IO_L33P_Y|OUTPUT|LVTTL|(0,5)***|12|SLOW|NONE**||||P7||IOB|IO_L49N_Y|UNUSED||(0,7)***|||||||P70|addr_mvbc<4>|IOB|IO|OUTPUT|LVTTL|(0,5)***|12|SLOW|NONE**||||P71|addr_mvbc<23>|IOB|IO_L32N|OUTPUT|LVTTL|(0,5)***|12|SLOW|NONE**||||P72|||GND||||||||||P73|addr_cpu<8>|IOB|IO_VREF_5_L32P|INPUT|LVTTL|(0,5)***||||NONE|||P74|addr_mvbc<8>|IOB|IO|OUTPUT|LVTTL|(0,5)***|12|SLOW|NONE**||||P75|addr_mvbc<1>|IOB|IO_LVDS_DLL_L31N|OUTPUT|LVTTL|(0,5)***|12|SLOW|NONE**||||P76|||VCCINT||||||||1.8||P77|clk|GCLKIOB|GCK1|INPUT|LVTTL|(0,5)***|||||||P78|||VCCO|||0|||||3.30||P79|||GND||||||||||P8||IOB|IO|UNUSED||(0,7)***|||||||P80||GCLKIOB|GCK0|UNUSED||(0,4)***|||||||P81|addr_mvbc<20>|IOB|IO_LVDS_DLL_L31P|OUTPUT|LVTTL|(0,4)***|12|SLOW|NONE**||||P82|addr_cpu<9>|IOB|IO|INPUT|LVTTL|(0,4)***||||IFD|||P83|addr_mvbc<21>|IOB|IO_L30N_Y|OUTPUT|LVTTL|(0,4)***|12|SLOW|NONE**||||P84|addr_mvbc<14>|IOB|IO_VREF_4_L30P_Y|OUTPUT|LVTTL|(0,4)***|12|SLOW|NONE**||||P85|||GND||||||||||P86|rdy2cpu_n|IOB|IO_L29N_Y|OUTPUT|LVTTL|(0,4)***|12|SLOW|NONE**||||P87|addr_mvbc<15>|IOB|IO_L29P_Y|OUTPUT|LVTTL|(0,4)***|12|SLOW|NONE**||||P88|addr_cpu<10>|IOB|IO_L28N_Y|INPUT|LVTTL|(0,4)***||||IFD|||P89|wr_cpu_n|IOB|IO_L28P_Y|INPUT|LVTTL|(0,4)***||||IFD|||P9||IOB|IO|UNUSED||(0,7)***|||||||P90|||VCCINT||||||||1.8||P91|||VCCO|||0|||||3.30||P92|||GND||||||||||P93|addr_mvbc<19>|IOB|IO_L27N_Y|OUTPUT|LVTTL|(0,4)***|12|SLOW|NONE**||||P94|addr_mvbc<0>|IOB|IO_VREF_4_L27P_Y|OUTPUT|LVTTL|(0,4)***|12|SLOW|NONE**||||P95|oe_cpu_n|IOB|IO|INPUT|LVTTL|(0,4)***||||IFD|||P96|addr_mvbc<2>|IOB|IO|OUTPUT|LVTTL|(0,4)***|12|SLOW|NONE**||||P97|addr_mvbc<12>|IOB|IO_L26N_YY|OUTPUT|LVTTL|(0,4)***|12|SLOW|NONE**||||P98|addr_cpu<12>|IOB|IO_VREF_4_L26P_YY|INPUT|LVTTL|(0,4)***||||NONE|||P99|addr_cpu<19>|IOB|IO|INPUT|LVTTL|(0,4)***||||NONE|||-----|-----|-----|-----|-----|-----|-----|-----|-----|-----|-----|-----|-----|* Default value.** This default Pullup/Pulldown value can be overridden in Bitgen.*** In some smaller packages, the VCCO bank number of a pin may trail     the VREF bank number (VCCO,VREF).

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