mcs_51.pin

VHDL实现：单片机与FPGA接口通信源文件

 -- Copyright (C) 1991-2004 Altera Corporation
 -- Any  megafunction  design,  and related netlist (encrypted  or  decrypted),
 -- support information,  device programming or simulation file,  and any other
 -- associated  documentation or information  provided by  Altera  or a partner
 -- under  Altera's   Megafunction   Partnership   Program  may  be  used  only
 -- to program  PLD  devices (but not masked  PLD  devices) from  Altera.   Any
 -- other  use  of such  megafunction  design,  netlist,  support  information,
 -- device programming or simulation file,  or any other  related documentation
 -- or information  is prohibited  for  any  other purpose,  including, but not
 -- limited to  modification,  reverse engineering,  de-compiling, or use  with
 -- any other  silicon devices,  unless such use is  explicitly  licensed under
 -- a separate agreement with  Altera  or a megafunction partner.  Title to the
 -- intellectual property,  including patents,  copyrights,  trademarks,  trade
 -- secrets,  or maskworks,  embodied in any such megafunction design, netlist,
 -- support  information,  device programming or simulation file,  or any other
 -- related documentation or information provided by  Altera  or a megafunction
 -- partner, remains with Altera, the megafunction partner, or their respective
 -- licensors. No other licenses, including any licenses needed under any third
 -- party's intellectual property, are provided herein.
 -- 
 -- This is a Quartus II output file. It is for reporting purposes only, and is
 -- not intended for use as a Quartus II input file. This file cannot be used
 -- to make Quartus II pin assignments - for instructions on how to make pin
 -- assignments, please see Quartus II help.
 ------------------------------------------------------------------------------



 ------------------------------------------------------------------------------
 -- NC         : No Connect. This pin has no internal connection to the device.
 -- VCC_INT    : Dedicated power pin, which MUST be connected to VCC  (2.5V).
 -- VCC_IO     : Dedicated power pin, which MUST be connected to VCC  (Refer to
 --              the table below for voltage).
 -- GND        : Dedicated ground pin, which MUST be connected to GND.
 -- GND+       : Unused input. This pin should be connected to GND. It may also
 --              be connected  to a  valid signal  on the board  (low, high, or
 --              toggling)  if that signal is required for a different revision
 --              of the design.
 -- GND*       : Unused  I/O  pin.   This pin can either be left unconnected or
 --              connected to GND.  Connecting this pin to GND will improve the
 --              device's immunity to noise.
 ------------------------------------------------------------------------------


Quartus II Version 4.2 Build 157 12/07/2004 SJ Full Version
CHIP  "mcs_51"  ASSIGNED TO AN: EP1K30TC144-3

Pin Name/Usage               : Location  : Dir.   : I/O Standard      : Voltage : I/O Bank  : User Assignment
-------------------------------------------------------------------------------------------------------------
TCK                          : 1         : input  :                   :         :           :                
CONF_DONE                    : 2         : bidir  :                   :         :           :                
nCEO                         : 3         : output :                   :         :           :                
TDO                          : 4         : output :                   :         :           :                
VCC_IO                       : 5         : power  :                   : 3.3V    :           :                
GND_INT                      : 6         : gnd    :                   :         :           :                
DATAOUT1[4]                  : 7         : output : LVTTL/LVCMOS      :         :           : N              
P0[7]                        : 8         : bidir  : LVTTL/LVCMOS      :         :           : N              
GND*                         : 9         :        :                   :         :           :                
GND*                         : 10        :        :                   :         :           :                
DATAOUT2[5]                  : 11        : output : LVTTL/LVCMOS      :         :           : N              
DATAOUT2[4]                  : 12        : output : LVTTL/LVCMOS      :         :           : N              
DATAOUT1[0]                  : 13        : output : LVTTL/LVCMOS      :         :           : N              
DATAOUT1[7]                  : 14        : output : LVTTL/LVCMOS      :         :           : N              
GND_INT                      : 15        : gnd    :                   :         :           :                
VCC_INT                      : 16        : power  :                   : 2.5V    :           :                
DATAOUT2[6]                  : 17        : output : LVTTL/LVCMOS      :         :           : N              
DATAOUT2[7]                  : 18        : output : LVTTL/LVCMOS      :         :           : N              
P0[3]                        : 19        : bidir  : LVTTL/LVCMOS      :         :           : N              
GND*                         : 20        :        :                   :         :           :                
P0[1]                        : 21        : bidir  : LVTTL/LVCMOS      :         :           : N              
GND*                         : 22        :        :                   :         :           :                
P0[2]                        : 23        : bidir  : LVTTL/LVCMOS      :         :           : N              
VCC_IO                       : 24        : power  :                   : 3.3V    :           :                
GND_INT                      : 25        : gnd    :                   :         :           :                
GND*                         : 26        :        :                   :         :           :                
P0[4]                        : 27        : bidir  : LVTTL/LVCMOS      :         :           : N              
GND*                         : 28        :        :                   :         :           :                
P0[0]                        : 29        : bidir  : LVTTL/LVCMOS      :         :           : N              
GND*                         : 30        :        :                   :         :           :                
P0[6]                        : 31        : bidir  : LVTTL/LVCMOS      :         :           : N              
DATAOUT1[1]                  : 32        : output : LVTTL/LVCMOS      :         :           : N              
GND*                         : 33        :        :                   :         :           :                
TMS                          : 34        : input  :                   :         :           :                
nSTATUS                      : 35        : bidir  :                   :         :           :                
GND*                         : 36        :        :                   :         :           :                
GND*                         : 37        :        :                   :         :           :                
GND*                         : 38        :        :                   :         :           :                
GND*                         : 39        :        :                   :         :           :                
GND_INT                      : 40        : gnd    :                   :         :           :                
WR                           : 41        : input  : LVTTL/LVCMOS      :         :           : N              
DATAOUT2[0]                  : 42        : output : LVTTL/LVCMOS      :         :           : N              
GND*                         : 43        :        :                   :         :           :                
P2[5]                        : 44        : input  : LVTTL/LVCMOS      :         :           : N              
VCC_IO                       : 45        : power  :                   : 3.3V    :           :                
DATAOUT2[1]                  : 46        : output : LVTTL/LVCMOS      :         :           : N              
DATAOUT1[2]                  : 47        : output : LVTTL/LVCMOS      :         :           : N              
GND*                         : 48        :        :                   :         :           :