__iq_pn_gen_2prj_exewrap.rsp
来自「FPGA-CPLD_DesignTool,事例程序3-4」· RSP 代码 · 共 2 行
RSP
2 行
-mode pipe -tapkeep -check warn -tcl -command D:/Xilinx/data/projnav/chipsim.tcl iq_pn_gen._prj iq_pn_gen.prj
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