pn_gen_srl_test.jhd

来自「FPGA-CPLD_DesignTool,事例程序3-4」· JHD 代码 · 共 3 行

JHD
3 行
字号 
MODULE testbench
   SUBMODULE iq_pn_gen

pn_gen_srl_test.jhd - 源码说明

本页面展示了「FPGA-CPLD_DesignTool,事例程序3-4」中的 pn_gen_srl_test.jhd 源码文件，采用 JHD 编程语言编写，共 3 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

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