📄 ddsfpga.fit.rpt
字号:
; keyout[5] ; 32 ; 1 ; 0 ; 3 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; keyout[6] ; 139 ; 2 ; 6 ; 14 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; keyout[7] ; 130 ; 2 ; 10 ; 14 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; q[0] ; 60 ; 4 ; 20 ; 0 ; 2 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; q[1] ; 56 ; 4 ; 16 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; q[2] ; 58 ; 4 ; 18 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; q[3] ; 61 ; 4 ; 20 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; q[4] ; 57 ; 4 ; 16 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; q[5] ; 59 ; 4 ; 18 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; q[6] ; 62 ; 4 ; 20 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; q[7] ; 55 ; 4 ; 16 ; 0 ; 2 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; qsquare[0] ; 77 ; 3 ; 27 ; 3 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; qsquare[1] ; 85 ; 3 ; 27 ; 7 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; qsquare[2] ; 83 ; 3 ; 27 ; 5 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; qsquare[3] ; 78 ; 3 ; 27 ; 3 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; qsquare[4] ; 84 ; 3 ; 27 ; 5 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; qsquare[5] ; 75 ; 3 ; 27 ; 2 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; qsquare[6] ; 79 ; 3 ; 27 ; 4 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; qsquare[7] ; 82 ; 3 ; 27 ; 4 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; qtriangle[0] ; 51 ; 4 ; 10 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; qtriangle[1] ; 53 ; 4 ; 12 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; qtriangle[2] ; 127 ; 2 ; 12 ; 14 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; qtriangle[3] ; 50 ; 4 ; 10 ; 0 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; qtriangle[4] ; 52 ; 4 ; 12 ; 0 ; 2 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; qtriangle[5] ; 129 ; 2 ; 12 ; 14 ; 2 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; qtriangle[6] ; 42 ; 4 ; 6 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
; qtriangle[7] ; 54 ; 4 ; 12 ; 0 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; Fitter ; Unspecified ;
+--------------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+-------------+
+------------------------------------------------------------+
; I/O Bank Usage ;
+----------+------------------+---------------+--------------+
; I/O Bank ; Usage ; VCCIO Voltage ; VREF Voltage ;
+----------+------------------+---------------+--------------+
; 1 ; 13 / 22 ( 59 % ) ; 3.3V ; -- ;
; 2 ; 12 / 28 ( 42 % ) ; 3.3V ; -- ;
; 3 ; 9 / 26 ( 34 % ) ; 3.3V ; -- ;
; 4 ; 25 / 28 ( 89 % ) ; 3.3V ; -- ;
+----------+------------------+---------------+--------------+
+--------------------------------------------------------------------------------------------------------------------+
; All Package Pins ;
+----------+------------+----------+----------------+--------+--------------+---------+------------+-----------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; Dir. ; I/O Standard ; Voltage ; I/O Type ; User Assignment ;
+----------+------------+----------+----------------+--------+--------------+---------+------------+-----------------+
; 1 ; 0 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 2 ; 1 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 3 ; 2 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 4 ; 3 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 5 ; 4 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 6 ; 5 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 7 ; 6 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 8 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ;
; 9 ; ; ; GND ; gnd ; ; ; -- ; ;
; 10 ; 7 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 11 ; 8 ; 1 ; DLedout[3] ; output ; LVTTL ; ; Row I/O ; N ;
; 12 ; 9 ; 1 ; *~nCSO~ / GND* ; output ; LVTTL ; ; Row I/O ; N ;
; 13 ; 10 ; 1 ; ^DATA0 ; input ; ; ; -- ; ;
; 14 ; 11 ; 1 ; ^nCONFIG ; ; ; ; -- ; ;
; 15 ; ; ; VCCA_PLL1 ; power ; ; 1.5V ; -- ; ;
; 16 ; 12 ; 1 ; KeyIn[4] ; input ; LVTTL ; ; Row I/O ; N ;
; 17 ; 13 ; 1 ; clk ; input ; LVTTL ; ; Row I/O ; N ;
; 18 ; ; ; GNDA_PLL1 ; gnd ; ; ; -- ; ;
; 19 ; ; ; GNDG_PLL1 ; gnd ; ; ; -- ; ;
; 20 ; 14 ; 1 ; ^nCEO ; ; ; ; -- ; ;
; 21 ; 15 ; 1 ; ^nCE ; ; ; ; -- ; ;
; 22 ; 16 ; 1 ; ^MSEL0 ; ; ; ; -- ; ;
; 23 ; 17 ; 1 ; ^MSEL1 ; ; ; ; -- ; ;
; 24 ; 18 ; 1 ; ^DCLK ; bidir ; ; ; -- ; ;
; 25 ; 19 ; 1 ; *~ASDO~ / GND* ; output ; LVTTL ; ; Row I/O ; N ;
; 26 ; 20 ; 1 ; KeyIn[0] ; input ; LVTTL ; ; Row I/O ; N ;
; 27 ; 21 ; 1 ; KeyIn[5] ; input ; LVTTL ; ; Row I/O ; N ;
; 28 ; 22 ; 1 ; KeyIn[1] ; input ; LVTTL ; ; Row I/O ; N ;
; 29 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ;
; 30 ; ; ; GND ; gnd ; ; ; -- ; ;
; 31 ; 23 ; 1 ; keyout[4] ; output ; LVTTL ; ; Row I/O ; N ;
; 32 ; 24 ; 1 ; keyout[5] ; output ; LVTTL ; ; Row I/O ; N ;
; 33 ; 25 ; 1 ; DLedout[2] ; output ; LVTTL ; ; Row I/O ; N ;
; 34 ; 26 ; 1 ; DLedout[6] ; output ; LVTTL ; ; Row I/O ; N ;
; 35 ; 27 ; 1 ; GND* ; ; ; ; Row I/O ; ;
; 36 ; 28 ; 1 ; dataout[4] ; output ; LVTTL ; ; Row I/O ; N ;
; 37 ; 29 ; 4 ; DLedout[0] ; output ; LVTTL ; ; Column I/O ; N ;
; 38 ; 30 ; 4 ; dataout[7] ; output ; LVTTL ; ; Column I/O ; N ;
; 39 ; 31 ; 4 ; dataout[0] ; output ; LVTTL ; ; Column I/O ; N ;
; 40 ; 32 ; 4 ; DLedout[1] ; output ; LVTTL ; ; Column I/O ; N ;
; 41 ; 33 ; 4 ; dataout[1] ; output ; LVTTL ; ; Column I/O ; N ;
; 42 ; 34 ; 4 ; qtriangle[6] ; output ; LVTTL ; ; Column I/O ; N ;
; 43 ; ; ; GND ; gnd ; ; ; -- ; ;
; 44 ; ; 4 ; VCCIO4 ; power ; ; 3.3V ; -- ; ;
; 45 ; ; ; GND ; gnd ; ; ; -- ; ;
; 46 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ;
; 47 ; 35 ; 4 ; KeyIn[7] ; input ; LVTTL ; ; Column I/O ; N ;
; 48 ; 36 ; 4 ; KeyIn[2] ; input ; LVTTL ; ; Column I/O ; N ;
; 49 ; 37 ; 4 ; KeyIn[6] ; input ; LVTTL ; ; Column I/O ; N ;
; 50 ; 38 ; 4 ; qtriangle[3] ; output ; LVTTL ; ; Column I/O ; N ;
; 51 ; 39 ; 4 ; qtriangle[0] ; output ; LVTTL ; ; Column I/O ; N ;
; 52 ; 40 ; 4 ; qtriangle[4] ; output ; LVTTL ; ; Column I/O ; N ;
; 53 ; 41 ; 4 ; qtriangle[1] ; output ; LVTTL ; ; Column I/O ; N ;
; 54 ; 42 ; 4 ; qtriangle[7] ; output ; LVTTL ; ; Column I/O ; N ;
; 55 ; 43 ; 4 ; q[7] ; output ; LVTTL ; ; Column I/O ; N ;
; 56 ; 44 ; 4 ; q[1] ; output ; LVTTL ; ; Column I/O ; N ;
; 57 ; 45 ; 4 ; q[4] ; output ; LVTTL ; ; Column I/O ; N ;
; 58 ; 46 ; 4 ; q[2] ; output ; LVTTL ; ; Column I/O ; N ;
; 59 ; 47 ; 4 ; q[5] ; output ; LVTTL ; ; Column I/O ; N ;
; 60 ; 48 ; 4 ; q[0] ; output ; LVTTL ; ; Column I/O ; N ;
; 61 ; 49 ; 4 ; q[3] ; output ; LVTTL ; ; Column I/O ; N ;
; 62 ; 50 ; 4 ; q[6] ; output ; LVTTL ; ; Column I/O ; N ;
; 63 ; ; ; GND ; gnd ; ; ; -- ; ;
; 64 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ;
; 65 ; ; ; GND ; gnd ; ; ; -- ; ;
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