📄 fpga313czkz.fit.rpt
字号:
; 3 ; 7 ;
; 4 ; 11 ;
; 5 ; 8 ;
; 6 ; 3 ;
; 7 ; 18 ;
; 8 ; 75 ;
+--------------------------+----------------+
+----------------------------------------------+
; Local Routing Interconnect ;
+-----------------------------+----------------+
; Local Routing Interconnects ; Number of LABs ;
+-----------------------------+----------------+
; 0 ; 38 ;
; 1 ; 8 ;
; 2 ; 10 ;
; 3 ; 8 ;
; 4 ; 18 ;
; 5 ; 27 ;
; 6 ; 17 ;
; 7 ; 6 ;
; 8 ; 12 ;
+-----------------------------+----------------+
+---------------------------------------------+
; LAB External Interconnect ;
+----------------------------+----------------+
; LAB External Interconnects ; Number of LABs ;
+----------------------------+----------------+
; 0 - 1 ; 15 ;
; 2 - 3 ; 9 ;
; 4 - 5 ; 13 ;
; 6 - 7 ; 36 ;
; 8 - 9 ; 41 ;
; 10 - 11 ; 12 ;
; 12 - 13 ; 5 ;
; 14 - 15 ; 4 ;
; 16 - 17 ; 6 ;
; 18 - 19 ; 2 ;
; 20 - 21 ; 1 ;
+----------------------------+----------------+
+------------------------------------------------------------------------------------------+
; Row Interconnect ;
+-------+---------------------+-----------------------------+------------------------------+
; Row ; Interconnect Used ; Left Half Interconnect Used ; Right Half Interconnect Used ;
+-------+---------------------+-----------------------------+------------------------------+
; A ; 34 / 96 ( 35 % ) ; 24 / 48 ( 50 % ) ; 44 / 48 ( 91 % ) ;
; B ; 18 / 96 ( 18 % ) ; 22 / 48 ( 45 % ) ; 38 / 48 ( 79 % ) ;
; C ; 58 / 96 ( 60 % ) ; 36 / 48 ( 75 % ) ; 32 / 48 ( 66 % ) ;
; D ; 44 / 96 ( 45 % ) ; 32 / 48 ( 66 % ) ; 22 / 48 ( 45 % ) ;
; E ; 35 / 96 ( 36 % ) ; 24 / 48 ( 50 % ) ; 20 / 48 ( 41 % ) ;
; F ; 36 / 96 ( 37 % ) ; 19 / 48 ( 39 % ) ; 21 / 48 ( 43 % ) ;
; Total ; 225 / 576 ( 39 % ) ; 157 / 288 ( 54 % ) ; 177 / 288 ( 61 % ) ;
+-------+---------------------+-----------------------------+------------------------------+
+-----------------------------+
; LAB Column Interconnect ;
+-------+---------------------+
; Col. ; Interconnect Used ;
+-------+---------------------+
; 1 ; 7 / 24 ( 29 % ) ;
; 2 ; 2 / 24 ( 8 % ) ;
; 3 ; 4 / 24 ( 16 % ) ;
; 4 ; 12 / 24 ( 50 % ) ;
; 5 ; 8 / 24 ( 33 % ) ;
; 6 ; 6 / 24 ( 25 % ) ;
; 7 ; 9 / 24 ( 37 % ) ;
; 8 ; 11 / 24 ( 45 % ) ;
; 9 ; 11 / 24 ( 45 % ) ;
; 10 ; 7 / 24 ( 29 % ) ;
; 11 ; 6 / 24 ( 25 % ) ;
; 12 ; 6 / 24 ( 25 % ) ;
; 13 ; 5 / 24 ( 20 % ) ;
; 14 ; 6 / 24 ( 25 % ) ;
; 15 ; 6 / 24 ( 25 % ) ;
; 16 ; 8 / 24 ( 33 % ) ;
; 17 ; 3 / 24 ( 12 % ) ;
; 18 ; 10 / 24 ( 41 % ) ;
; 19 ; 6 / 24 ( 25 % ) ;
; 20 ; 10 / 24 ( 41 % ) ;
; 21 ; 10 / 24 ( 41 % ) ;
; 22 ; 3 / 24 ( 12 % ) ;
; 23 ; 13 / 24 ( 54 % ) ;
; 24 ; 6 / 24 ( 25 % ) ;
; Total ; 175 / 576 ( 30 % ) ;
+-------+---------------------+
+---------------------------+
; LAB Column Interconnect ;
+-------+-------------------+
; Col. ; Interconnect Used ;
+-------+-------------------+
; 1 ; 0 / 24 ( 0 % ) ;
; Total ; 0 / 24 ( 0 % ) ;
+-------+-------------------+
+----------------------------------------------------------+
; Fitter Resource Usage Summary ;
+--------------------------------+-------------------------+
; Resource ; Usage ;
+--------------------------------+-------------------------+
; Registers ; 367 / 1,152 ( 31 % ) ;
; Total LABs ; 0 / 144 ( 0 % ) ;
; Logic elements in carry chains ; 100 ;
; User inserted logic elements ; 0 ;
; I/O pins ; 95 / 102 ( 93 % ) ;
; -- Clock pins ; 2 ;
; -- Dedicated input pins ; 5 / 4 ( 125 % ) ;
; Global signals ; 2 ;
; EABs ; 1 / 6 ( 16 % ) ;
; Total memory bits ; 128 / 12,288 ( 1 % ) ;
; Total RAM block bits ; 2,048 / 12,288 ( 16 % ) ;
; Maximum fan-out node ; clk_1us ;
; Maximum fan-out ; 349 ;
; Total fan-out ; 3101 ;
; Average fan-out ; 3.23 ;
+--------------------------------+-------------------------+
+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Resource Utilization by Entity ;
+--------------------------------------------+-------------+--------------+-------------+------+--------------+-------------------+------------------+-----------------+-----------------------------------------------------------------------------------------------+
; Compilation Hierarchy Node ; Logic Cells ; LC Registers ; Memory Bits ; Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Carry Chain LCs ; Full Hierarchy Name ;
+--------------------------------------------+-------------+--------------+-------------+------+--------------+-------------------+------------------+-----------------+-----------------------------------------------------------------------------------------------+
; |fpga313czkz ; 864 (6) ; 367 ; 128 ; 95 ; 497 (5) ; 214 (0) ; 153 (1) ; 100 (0) ; |fpga313czkz ;
; |lamp:m3| ; 212 (65) ; 65 ; 0 ; 0 ; 147 (65) ; 65 (0) ; 0 (0) ; 0 (0) ; |fpga313czkz|lamp:m3 ;
; |lamp_light:u2| ; 65 (0) ; 65 ; 0 ; 0 ; 0 (0) ; 65 (0) ; 0 (0) ; 0 (0) ; |fpga313czkz|lamp:m3|lamp_light:u2 ;
; |lreg:g10| ; 1 (1) ; 1 ; 0 ; 0 ; 0 (0) ; 1 (1) ; 0 (0) ; 0 (0) ; |fpga313czkz|lamp:m3|lamp_light:u2|lreg:g10 ;
; |lreg:g11| ; 1 (1) ; 1 ; 0 ; 0 ; 0 (0) ; 1 (1) ; 0 (0) ; 0 (0) ; |fpga313czkz|lamp:m3|lamp_light:u2|lreg:g11 ;
; |lreg:g12| ; 1 (1) ; 1 ; 0 ; 0 ; 0 (0) ; 1 (1) ; 0 (0) ; 0 (0) ; |fpga313czkz|lamp:m3|lamp_light:u2|lreg:g12 ;
; |lreg:g13| ; 1 (1) ; 1 ; 0 ; 0 ; 0 (0) ; 1 (1) ; 0 (0) ; 0 (0) ; |fpga313czkz|lamp:m3|lamp_light:u2|lreg:g13 ;
; |lreg:g14| ; 1 (1) ; 1 ; 0 ; 0 ; 0 (0) ; 1 (1) ; 0 (0) ; 0 (0) ; |fpga313czkz|lamp:m3|lamp_light:u2|lreg:g14 ;
; |lreg:g15| ; 1 (1) ; 1 ; 0 ; 0 ; 0 (0) ; 1 (1) ; 0 (0) ; 0 (0) ; |fpga313czkz|lamp:m3|lamp_light:u2|lreg:g15 ;
; |lreg:g16| ; 1 (1) ; 1 ; 0 ; 0 ; 0 (0) ; 1 (1) ; 0 (0) ; 0 (0) ; |fpga313czkz|lamp:m3|lamp_light:u2|lreg:g16 ;
; |lreg:g17| ; 1 (1) ; 1 ; 0 ; 0 ; 0 (0) ; 1 (1) ; 0 (0) ; 0 (0) ; |fpga313czkz|lamp:m3|lamp_light:u2|lreg:g17 ;
; |lreg:g18| ; 1 (1) ; 1 ; 0 ; 0 ; 0 (0) ; 1 (1) ; 0 (0) ; 0 (0) ; |fpga313czkz|lamp:m3|lamp_light:u2|lreg:g18 ;
; |lreg:g19| ; 1 (1) ; 1 ; 0 ; 0 ; 0 (0) ; 1 (1) ; 0 (0) ; 0 (0) ; |fpga313czkz|lamp:m3|lamp_light:u2|lreg:g19 ;
; |lreg:g1| ; 1 (1) ; 1 ; 0 ; 0 ; 0 (0) ; 1 (1) ; 0 (0) ; 0 (0) ; |fpga313czkz|lamp:m3|lamp_light:u2|lreg:g1 ;
; |lreg:g20| ; 1 (1) ; 1 ; 0 ; 0 ; 0 (0) ; 1 (1) ; 0 (0) ; 0 (0) ; |fpga313czkz|lamp:m3|lamp_light:u2|lreg:g20 ;
; |lreg:g21| ; 1 (1) ; 1 ; 0 ; 0 ; 0 (0) ; 1 (1) ; 0 (0) ; 0 (0) ; |fpga313czkz|lamp:m3|lamp_light:u2|lreg:g21 ;
; |lreg:g22| ; 1 (1) ; 1 ; 0 ; 0 ; 0 (0) ; 1 (1) ; 0 (0) ; 0 (0) ; |fpga313czkz|lamp:m3|lamp_light:u2|lreg:g22 ;
; |lreg:g23| ; 1 (1) ; 1 ; 0 ; 0 ; 0 (0) ; 1 (1) ; 0 (0) ; 0 (0) ; |fpga313czkz|lamp:m3|lamp_light:u2|lreg:g23 ;
; |lreg:g24| ; 1 (1) ; 1 ; 0 ; 0 ; 0 (0) ; 1 (1) ; 0 (0) ; 0 (0) ; |fpga313czkz|lamp:m3|lamp_light:u2|lreg:g24 ;
; |lreg:g25| ; 1 (1) ; 1 ; 0 ; 0 ; 0 (0) ; 1 (1) ⌨️ 快捷键说明
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