📄 fpga313czkz.fit.rpt
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; lamp:m3|lighten_en:u1|lamp_en[57] ; LC5_E9 ; 1 ; Clock enable ; Non-global ;
; lamp:m3|lighten_en:u1|lamp_en[34] ; LC5_F19 ; 1 ; Clock enable ; Non-global ;
; lamp:m3|lighten_en:u1|lamp_en[35] ; LC7_F19 ; 1 ; Clock enable ; Non-global ;
; lamp:m3|lighten_en:u1|lamp_en[50] ; LC8_F19 ; 1 ; Clock enable ; Non-global ;
; lamp:m3|lighten_en:u1|lamp_en[2] ; LC3_F13 ; 1 ; Clock enable ; Non-global ;
; lamp:m3|lighten_en:u1|lamp_en[3] ; LC2_F13 ; 1 ; Clock enable ; Non-global ;
; lamp:m3|lighten_en:u1|lamp_en[18] ; LC6_F13 ; 1 ; Clock enable ; Non-global ;
; lamp:m3|lighten_en:u1|lamp_en[19] ; LC7_F13 ; 1 ; Clock enable ; Non-global ;
; lamp:m3|lighten_en:u1|lamp_en[58] ; LC6_F3 ; 1 ; Clock enable ; Non-global ;
; lamp:m3|lighten_en:u1|lamp_en[6] ; LC4_F12 ; 1 ; Clock enable ; Non-global ;
; lamp:m3|lighten_en:u1|lamp_en[14] ; LC5_F12 ; 1 ; Clock enable ; Non-global ;
; lamp:m3|lighten_en:u1|lamp_en[22] ; LC7_F12 ; 1 ; Clock enable ; Non-global ;
; lamp:m3|lighten_en:u1|lamp_en[59] ; LC2_F4 ; 1 ; Clock enable ; Non-global ;
; lamp:m3|lighten_en:u1|lamp_en[51] ; LC3_F6 ; 1 ; Clock enable ; Non-global ;
; lamp:m3|lighten_en:u1|lamp_en[11] ; LC3_F7 ; 1 ; Clock enable ; Non-global ;
; lamp:m3|lighten_en:u1|lamp_en[27] ; LC4_F7 ; 1 ; Clock enable ; Non-global ;
; lamp:m3|lighten_en:u1|lamp_en[43] ; LC6_F7 ; 1 ; Clock enable ; Non-global ;
; lamp:m3|lighten_en:u1|lamp_en[20] ; LC7_E11 ; 1 ; Clock enable ; Non-global ;
; lamp:m3|lighten_en:u1|lamp_en[21] ; LC8_E11 ; 1 ; Clock enable ; Non-global ;
; lamp:m3|lighten_en:u1|lamp_en[4] ; LC5_F1 ; 1 ; Clock enable ; Non-global ;
; lamp:m3|lighten_en:u1|lamp_en[12] ; LC6_F1 ; 1 ; Clock enable ; Non-global ;
; lamp:m3|lighten_en:u1|lamp_en[28] ; LC7_F1 ; 1 ; Clock enable ; Non-global ;
; lamp:m3|lighten_en:u1|lamp_en[64] ; LC4_F10 ; 1 ; Clock enable ; Non-global ;
; lamp:m3|lighten_en:u1|lamp_en[65] ; LC5_F10 ; 1 ; Clock enable ; Non-global ;
; main:m2|mach_next~169 ; LC5_E5 ; 9 ; Clock enable ; Non-global ;
; main:m2|reset_reg~37 ; LC8_E4 ; 9 ; Clock enable ; Non-global ;
+-------------------------------------+---------+---------+----------------------+--------------+
+---------------------------------------+
; Global & Other Fast Signals ;
+----------+---------+---------+--------+
; Name ; Pin # ; Fan-Out ; Global ;
+----------+---------+---------+--------+
; lamptest ; 54 ; 65 ; no ;
; selctin ; 56 ; 9 ; no ;
; clk_in ; 125 ; 17 ; yes ;
; clk_1us ; LC1_E13 ; 349 ; yes ;
+----------+---------+---------+--------+
+---------------------------------------------+
; Carry Chains ;
+--------------------+------------------------+
; Carry Chain Length ; Number of Carry Chains ;
+--------------------+------------------------+
; 0 - 2 ; 0 ;
; 3 - 5 ; 2 ;
; 6 - 8 ; 2 ;
; 9 - 11 ; 0 ;
; 12 - 14 ; 0 ;
; 15 - 17 ; 3 ;
; 18 - 20 ; 0 ;
; 21 - 23 ; 0 ;
; 24 - 26 ; 0 ;
; 27 - 29 ; 0 ;
; 30 - 32 ; 1 ;
+--------------------+------------------------+
+----------------+
; Cascade Chains ;
+--------+-------+
; Length ; Count ;
+--------+-------+
; 2 ; 8 ;
+--------+-------+
+---------------------------------------------------------------------------------------------------------------+
; Embedded Cells ;
+--------+---------------------------------------------------------------------------------------+------+-------+
; Cell # ; Name ; Mode ; Turbo ;
+--------+---------------------------------------------------------------------------------------+------+-------+
; EC1_D ; search_panel:m1|ttl128bit_dq:ttl_ram|lpm_ram_dq:lpm_ram_dq_component|altram:sram|q[0] ; RAM ; Off ;
+--------+---------------------------------------------------------------------------------------+------+-------+
+---------------------------------------------------------------------------------------------------------------+
; Non-Global High Fan-Out Signals ;
+-----------------------------------------------------------------------------------------------------+---------+
; Name ; Fan-Out ;
+-----------------------------------------------------------------------------------------------------+---------+
; main:m2|reset_reg~38 ; 107 ;
; parallel_port:m4|clr_busy_cmd~5 ; 68 ;
; main:m2|backbyte[7]~52 ; 67 ;
; main:m2|backbyte[4]~59 ; 66 ;
; lamptest ; 65 ;
; main:m2|backbyte[5]~58 ; 59 ;
; main:m2|backbyte[3]~53 ; 43 ;
; main:m2|mach_next.LoadResetByte~14 ; 39 ;
; search_panel:m1|mach_next.IDLE~36 ; 38 ;
; search_panel:m1|mach_next.JUDGE_TTL_REG~30 ; 37 ;
; search_panel:m1|Select~5370 ; 32 ;
; main:m2|backbyte[0]~56 ; 23 ;
; search_panel:m1|ram_initionalize_cnt[2]~104 ; 21 ;
; search_panel:m1|ram_initionalize_cnt[3]~105 ; 21 ;
; search_panel:m1|ttl_cnt[2]~233 ; 20 ;
; search_panel:m1|ram_initionalize_cnt[0]~109 ; 20 ;
; parallel_port:m4|mach_tr_next.TR_START~7 ; 20 ;
; search_panel:m1|ttl_cnt[3]~234 ; 19 ;
; search_panel:m1|ram_initionalize_cnt[1]~103 ; 19 ;
; search_panel:m1|lpm_counter:scan_cnt_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[0]~COUT ; 19 ;
; search_panel:m1|lpm_counter:scan_cnt_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[2]~COUT ; 19 ;
; search_panel:m1|lpm_counter:scan_cnt_rtl_0|alt_counter_f10ke:wysi_counter|q[3]~4 ; 19 ;
; search_panel:m1|ttl_cnt[4]~235 ; 19 ;
; search_panel:m1|ttl_cnt[5]~236 ; 19 ;
; search_panel:m1|lpm_counter:scan_cnt_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[1]~COUT ; 19 ;
; main:m2|mach_next.AckParallel~14 ; 19 ;
; parallel_port:m4|mach_tr_next.TR_END~21 ; 18 ;
; LessThan~170 ; 17 ;
; parallel_port:m4|lpm_counter:delay_count0_rtl_1|alt_counter_f10ke:wysi_counter|counter_cell[15]~121 ; 16 ;
; parallel_port:m4|parallel_rd[0]~173 ; 16 ;
; parallel_port:m4|lpm_counter:delay_count0_rtl_1|alt_counter_f10ke:wysi_counter|counter_cell[15]~120 ; 16 ;
; main:m2|backbyte[2]~54 ; 16 ;
; search_panel:m1|initionalize_flag~15 ; 13 ;
; search_panel:m1|ttl_cnt[6]~231 ; 13 ;
; main:m2|SearchStart~40 ; 12 ;
; parallel_port:m4|para_dir~13 ; 11 ;
; search_panel:m1|ttl_cnt[0]~230 ; 11 ;
; main:m2|backbyte[1]~57 ; 11 ;
; parallel_port:m4|reduce_or~48 ; 10 ;
; main:m2|parallel_send~4 ; 10 ;
; lamp:m3|lighten_en:u1|lamp_en[61]~660 ; 10 ;
; search_panel:m1|Select~5413 ; 9 ;
; selctin ; 9 ;
; switchin[0] ; 9 ;
; switchin[3] ; 9 ;
; search_panel:m1|ttl_cnt[1]~232 ; 9 ;
; switchin[1] ; 9 ;
; switchin[7] ; 9 ;
; switchin[2] ; 9 ;
; main:m2|reset_reg~39 ; 9 ;
+-----------------------------------------------------------------------------------------------------+---------+
+--------------------------------------------------------------------------------------------------------------+
; Peripheral Signals ;
+---------------------------+---------+---------------+-----------------+---------------------------+----------+
; Peripheral Signal ; Source ; Usage ; Dedicated Clock ; Peripheral Control Signal ; Polarity ;
+---------------------------+---------+---------------+-----------------+---------------------------+----------+
; parallel_port:m4|para_dir ; LC1_A9 ; Output enable ; no ; yes ; -ve ;
; clk_1us ; LC1_E13 ; Clock ; no ; yes ; +ve ;
+---------------------------+---------+---------------+-----------------+---------------------------+----------+
+-------------------------------------------+
; LAB ;
+--------------------------+----------------+
; Number of Logic Elements ; Number of LABs ;
+--------------------------+----------------+
; 0 ; 11 ;
; 1 ; 7 ;
; 2 ; 4 ;
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