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Fitter report for fpga313czkz
Mon Jul 17 09:10:09 2006
Version 5.0 Build 148 04/26/2005 SJ Full Version
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; Table of Contents ;
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1. Legal Notice
2. Fitter Summary
3. Fitter Settings
4. Fitter Device Options
5. Fitter Equations
6. Input Pins
7. Output Pins
8. Bidir Pins
9. All Package Pins
10. Control Signals
11. Global & Other Fast Signals
12. Carry Chains
13. Cascade Chains
14. Embedded Cells
15. Non-Global High Fan-Out Signals
16. Peripheral Signals
17. LAB
18. Local Routing Interconnect
19. LAB External Interconnect
20. Row Interconnect
21. LAB Column Interconnect
22. LAB Column Interconnect
23. Fitter Resource Usage Summary
24. Fitter Resource Utilization by Entity
25. Delay Chain Summary
26. Fitter RAM Summary
27. Pin-Out File
28. Fitter Messages
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; Legal Notice ;
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Copyright (C) 1991-2005 Altera Corporation
Your use of Altera Corporation's design tools, logic functions
and other software and tools, and its AMPP partner logic
functions, and any output files any of the foregoing
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without limitation, that your use is for the sole purpose of
programming logic devices manufactured by Altera and sold by
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applicable agreement for further details.
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; Fitter Summary ;
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; Fitter Status ; Successful - Mon Jul 17 09:10:09 2006 ;
; Quartus II Version ; 5.0 Build 148 04/26/2005 SJ Full Version ;
; Revision Name ; fpga313czkz ;
; Top-level Entity Name ; fpga313czkz ;
; Family ; FLEX10K ;
; Device ; EPF10K20TI144-4 ;
; Timing Models ; Final ;
; Total logic elements ; 864 / 1,152 ( 75 % ) ;
; Total pins ; 95 / 102 ( 93 % ) ;
; Total memory bits ; 128 / 12,288 ( 1 % ) ;
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+------------------------------------------------------------------------------------------------------+
; Fitter Settings ;
+------------------------------------------------------------+--------------------+--------------------+
; Option ; Setting ; Default Value ;
+------------------------------------------------------------+--------------------+--------------------+
; Device ; EPF10K20TI144-4 ; ;
; Use smart compilation ; Off ; Off ;
; Placement Effort Multiplier ; 1.0 ; 1.0 ;
; Router Effort Multiplier ; 1.0 ; 1.0 ;
; Optimize Timing ; Normal compilation ; Normal compilation ;
; Optimize IOC Register Placement for Timing ; On ; On ;
; Limit to One Fitting Attempt ; Off ; Off ;
; Final Placement Optimizations ; Automatically ; Automatically ;
; Fitter Initial Placement Seed ; 1 ; 1 ;
; Slow Slew Rate ; Off ; Off ;
; Auto Global Memory Control Signals ; Off ; Off ;
; Logic Cell Insertion - Individual Logic Cells ; On ; On ;
; Logic Cell Insertion - I/Os Fed By Carry or Cascade Chains ; On ; On ;
; Fitter Effort ; Auto Fit ; Auto Fit ;
; Auto Global Clock ; On ; On ;
; Auto Global Output Enable ; On ; On ;
; Auto Global Register Control Signals ; On ; On ;
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; Fitter Device Options ;
+----------------------------------------------+--------------------------+
; Option ; Setting ;
+----------------------------------------------+--------------------------+
; Enable user-supplied start-up clock (CLKUSR) ; Off ;
; Enable device-wide reset (DEV_CLRn) ; Off ;
; Enable device-wide output enable (DEV_OE) ; Off ;
; Enable INIT_DONE output ; Off ;
; Configuration scheme ; Passive Serial ;
; Reserve all unused pins ; As output driving ground ;
; Base pin-out file on sameframe device ; Off ;
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; Fitter Equations ;
+------------------+
The equations can be found in E:/my_work/313/操作控制板_归档/HARDWARE/EPLD/CPV3 FIREWARE/ver6.0/fpga313czkz.fit.eqn.
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; Input Pins ;
+-------------+-------+-----+------+---------+--------+--------------+-------------------------+---------------+---------------+--------------+
; Name ; Pin # ; Row ; Col. ; Fan-Out ; Global ; I/O Register ; Use Local Routing Input ; Power Up High ; Single-Pin CE ; I/O Standard ;
+-------------+-------+-----+------+---------+--------+--------------+-------------------------+---------------+---------------+--------------+
; lamptest ; 54 ; -- ; -- ; 65 ; no ; no ; no ; no ; no ; TTL ;
; selctin ; 56 ; -- ; -- ; 9 ; no ; no ; no ; no ; no ; TTL ;
; clk_in ; 125 ; -- ; -- ; 17 ; yes ; no ; no ; no ; no ; TTL ;
; switchin[5] ; 23 ; D ; -- ; 9 ; no ; no ; no ; no ; no ; TTL ;
; switchin[6] ; 26 ; E ; -- ; 9 ; no ; no ; no ; no ; no ; TTL ;
; switchin[4] ; 22 ; D ; -- ; 9 ; no ; no ; no ; no ; no ; TTL ;
; switchin[7] ; 27 ; E ; -- ; 9 ; no ; no ; no ; no ; no ; TTL ;
; switchin[2] ; 20 ; D ; -- ; 9 ; no ; no ; no ; no ; no ; TTL ;
; switchin[1] ; 19 ; D ; -- ; 9 ; no ; no ; no ; no ; no ; TTL ;
; switchin[0] ; 18 ; D ; -- ; 9 ; no ; no ; no ; no ; no ; TTL ;
; switchin[3] ; 21 ; D ; -- ; 9 ; no ; no ; no ; no ; no ; TTL ;
+-------------+-------+-----+------+---------+--------+--------------+-------------------------+---------------+---------------+--------------+
+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+-------------+-------+-----+------+--------------+--------------------------+---------------+----------------+---------------+---------------+------------+---------------+--------------+
; Name ; Pin # ; Row ; Col. ; I/O Register ; Use Local Routing Output ; Power Up High ; Slow Slew Rate ; Single-Pin OE ; Single-Pin CE ; Open Drain ; TRI Primitive ; I/O Standard ;
+-------------+-------+-----+------+--------------+--------------------------+---------------+----------------+---------------+---------------+------------+---------------+--------------+
; switchen[1] ; 9 ; B ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
; switchen[2] ; 8 ; A ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
; switchen[3] ; 7 ; A ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
; switchen[4] ; 12 ; C ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
; switchen[5] ; 11 ; C ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
; switchen[6] ; 10 ; B ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
; switchen[7] ; 17 ; D ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
; switchen[8] ; 14 ; C ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
; switchen[9] ; 13 ; C ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
; lampout[1] ; 28 ; E ; -- ; no ; no ; no ; no ; no ; no ; no ; no ; TTL ;
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