📄 pc2fpga.fit.rpt
字号:
; fifo_rd ; 57 ; 1 ; 0 ; 2 ; 1 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
; fifo_wr ; 56 ; 1 ; 0 ; 2 ; 0 ; no ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; Unspecified ;
+---------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+----------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+-------------+
+------------------------------------------------------------+
; I/O Bank Usage ;
+----------+------------------+---------------+--------------+
; I/O Bank ; Usage ; VCCIO Voltage ; VREF Voltage ;
+----------+------------------+---------------+--------------+
; 1 ; 11 / 44 ( 25 % ) ; 3.3V ; -- ;
; 2 ; 0 / 42 ( 0 % ) ; 3.3V ; -- ;
; 3 ; 1 / 45 ( 2 % ) ; 3.3V ; -- ;
; 4 ; 5 / 42 ( 11 % ) ; 3.3V ; -- ;
+----------+------------------+---------------+--------------+
+--------------------------------------------------------------------------------------------------------------------------+
; All Package Pins ;
+----------+------------+----------+----------------------+--------+--------------+---------+------------+-----------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; Dir. ; I/O Standard ; Voltage ; I/O Type ; User Assignment ;
+----------+------------+----------+----------------------+--------+--------------+---------+------------+-----------------+
; 1 ; 0 ; 1 ; RESERVED_INPUT ; ; ; ; Row I/O ; ;
; 2 ; 1 ; 1 ; RESERVED_INPUT ; ; ; ; Row I/O ; ;
; 3 ; 2 ; 1 ; RESERVED_INPUT ; ; ; ; Row I/O ; ;
; 4 ; 3 ; 1 ; RESERVED_INPUT ; ; ; ; Row I/O ; ;
; 5 ; 4 ; 1 ; RESERVED_INPUT ; ; ; ; Row I/O ; ;
; 6 ; 5 ; 1 ; RESERVED_INPUT ; ; ; ; Row I/O ; ;
; 7 ; 6 ; 1 ; RESERVED_INPUT ; ; ; ; Row I/O ; ;
; 8 ; 7 ; 1 ; RESERVED_INPUT ; ; ; ; Row I/O ; ;
; 9 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ;
; 10 ; ; ; GND ; gnd ; ; ; -- ; ;
; 11 ; 8 ; 1 ; RESERVED_INPUT ; ; ; ; Row I/O ; ;
; 12 ; 9 ; 1 ; RESERVED_INPUT ; ; ; ; Row I/O ; ;
; 13 ; 10 ; 1 ; RESERVED_INPUT ; ; ; ; Row I/O ; ;
; 14 ; 11 ; 1 ; RESERVED_INPUT ; ; ; ; Row I/O ; ;
; 15 ; 12 ; 1 ; rst ; input ; LVTTL ; ; Row I/O ; Y ;
; 16 ; 13 ; 1 ; RESERVED_INPUT ; ; ; ; Row I/O ; ;
; 17 ; 14 ; 1 ; RESERVED_INPUT ; ; ; ; Row I/O ; ;
; 18 ; 15 ; 1 ; RESERVED_INPUT ; ; ; ; Row I/O ; ;
; 19 ; 16 ; 1 ; RESERVED_INPUT ; ; ; ; Row I/O ; ;
; 20 ; 17 ; 1 ; RESERVED_INPUT ; ; ; ; Row I/O ; ;
; 21 ; 18 ; 1 ; RESERVED_INPUT ; ; ; ; Row I/O ; ;
; 22 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ;
; 23 ; 28 ; 1 ; RESERVED_INPUT ; ; ; ; Row I/O ; ;
; 24 ; 29 ; 1 ; *~nCSO~ / GND* ; output ; LVTTL ; ; Row I/O ; N ;
; 25 ; 30 ; 1 ; ^DATA0 ; input ; ; ; -- ; ;
; 26 ; 31 ; 1 ; ^nCONFIG ; ; ; ; -- ; ;
; 27 ; ; ; VCCA_PLL1 ; power ; ; 1.5V ; -- ; ;
; 28 ; 32 ; 1 ; GND+ ; ; ; ; Row I/O ; ;
; 29 ; 33 ; 1 ; GND+ ; ; ; ; Row I/O ; ;
; 30 ; ; ; GNDA_PLL1 ; gnd ; ; ; -- ; ;
; 31 ; ; ; GNDG_PLL1 ; gnd ; ; ; -- ; ;
; 32 ; 34 ; 1 ; ^nCEO ; ; ; ; -- ; ;
; 33 ; 35 ; 1 ; ^nCE ; ; ; ; -- ; ;
; 34 ; 36 ; 1 ; ^MSEL0 ; ; ; ; -- ; ;
; 35 ; 37 ; 1 ; ^MSEL1 ; ; ; ; -- ; ;
; 36 ; 38 ; 1 ; ^DCLK ; bidir ; ; ; -- ; ;
; 37 ; 39 ; 1 ; *~ASDO~ / GND* ; output ; LVTTL ; ; Row I/O ; N ;
; 38 ; 40 ; 1 ; RESERVED_INPUT ; ; ; ; Row I/O ; ;
; 39 ; 41 ; 1 ; RESERVED_INPUT ; ; ; ; Row I/O ; ;
; 40 ; ; ; GND ; gnd ; ; ; -- ; ;
; 41 ; 52 ; 1 ; RESERVED_INPUT ; ; ; ; Row I/O ; ;
; 42 ; 53 ; 1 ; RESERVED_INPUT ; ; ; ; Row I/O ; ;
; 43 ; 54 ; 1 ; RESERVED_INPUT ; ; ; ; Row I/O ; ;
; 44 ; 55 ; 1 ; RESERVED_INPUT ; ; ; ; Row I/O ; ;
; 45 ; 56 ; 1 ; RESERVED_INPUT ; ; ; ; Row I/O ; ;
; 46 ; 57 ; 1 ; RESERVED_INPUT ; ; ; ; Row I/O ; ;
; 47 ; 58 ; 1 ; RESERVED_INPUT ; ; ; ; Row I/O ; ;
; 48 ; 59 ; 1 ; RESERVED_INPUT ; ; ; ; Row I/O ; ;
; 49 ; 60 ; 1 ; RESERVED_INPUT ; ; ; ; Row I/O ; ;
; 50 ; 61 ; 1 ; RESERVED_INPUT ; ; ; ; Row I/O ; ;
; 51 ; ; 1 ; VCCIO1 ; power ; ; 3.3V ; -- ; ;
; 52 ; ; ; GND ; gnd ; ; ; -- ; ;
; 53 ; 62 ; 1 ; fifo_empty ; input ; LVTTL ; ; Row I/O ; Y ;
; 54 ; 63 ; 1 ; fifo_full ; input ; LVTTL ; ; Row I/O ; Y ;
; 55 ; 64 ; 1 ; fifo_pf ; input ; LVTTL ; ; Row I/O ; Y ;
; 56 ; 65 ; 1 ; fifo_wr ; output ; LVTTL ; ; Row I/O ; Y ;
; 57 ; 66 ; 1 ; fifo_rd ; output ; LVTTL ; ; Row I/O ; Y ;
; 58 ; 67 ; 1 ; fifo_data[0] ; input ; LVTTL ; ; Row I/O ; Y ;
; 59 ; 68 ; 1 ; fifo_data[1] ; input ; LVTTL ; ; Row I/O ; Y ;
; 60 ; 69 ; 1 ; fifo_data[2] ; input ; LVTTL ; ; Row I/O ; Y ;
; 61 ; 70 ; 4 ; fifo_data[3] ; input ; LVTTL ; ; Column I/O ; Y ;
; 62 ; 71 ; 4 ; fifo_data[4] ; input ; LVTTL ; ; Column I/O ; Y ;
; 63 ; 72 ; 4 ; fifo_data[5] ; input ; LVTTL ; ; Column I/O ; Y ;
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; 65 ; 74 ; 4 ; fifo_data[7] ; input ; LVTTL ; ; Column I/O ; Y ;
; 66 ; 75 ; 4 ; RESERVED_INPUT ; ; ; ; Column I/O ; ;
; 67 ; 76 ; 4 ; RESERVED_INPUT ; ; ; ; Column I/O ; ;
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; 69 ; ; ; GND ; gnd ; ; ; -- ; ;
; 70 ; ; 4 ; VCCIO4 ; power ; ; 3.3V ; -- ; ;
; 71 ; ; ; GND ; gnd ; ; ; -- ; ;
; 72 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ;
; 73 ; 78 ; 4 ; RESERVED_INPUT ; ; ; ; Column I/O ; ;
; 74 ; 79 ; 4 ; RESERVED_INPUT ; ; ; ; Column I/O ; ;
; 75 ; 80 ; 4 ; RESERVED_INPUT ; ; ; ; Column I/O ; ;
; 76 ; 81 ; 4 ; RESERVED_INPUT ; ; ; ; Column I/O ; ;
; 77 ; 82 ; 4 ; RESERVED_INPUT ; ; ; ; Column I/O ; ;
; 78 ; 83 ; 4 ; RESERVED_INPUT ; ; ; ; Column I/O ; ;
; 79 ; 84 ; 4 ; RESERVED_INPUT ; ; ; ; Column I/O ; ;
; 80 ; ; ; GND ; gnd ; ; ; -- ; ;
; 81 ; ; ; VCCINT ; power ; ; 1.5V ; -- ; ;
; 82 ; 86 ; 4 ; RESERVED_INPUT ; ; ; ; Column I/O ; ;
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