clock6.tan.rpt
来自「通过VERILOG HDL语言使用CPLD连接PS2键盘」· RPT 代码 · 共 368 行 · 第 1/5 页
RPT
368 行
; N/A ; 71.43 MHz ( period = 14.000 ns ) ; count[18] ; count[14] ; clk ; clk ; None ; None ; 9.500 ns ;
; N/A ; 71.43 MHz ( period = 14.000 ns ) ; count[17] ; count[14] ; clk ; clk ; None ; None ; 9.500 ns ;
; N/A ; 71.43 MHz ( period = 14.000 ns ) ; count[16] ; count[14] ; clk ; clk ; None ; None ; 9.500 ns ;
; N/A ; 94.34 MHz ( period = 10.600 ns ) ; count[12] ; sec ; clk ; clk ; None ; None ; 6.100 ns ;
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; N/A ; 97.09 MHz ( period = 10.300 ns ) ; count[4] ; count[15] ; clk ; clk ; None ; None ; 5.800 ns ;
; N/A ; 97.09 MHz ( period = 10.300 ns ) ; count[3] ; count[15] ; clk ; clk ; None ; None ; 5.800 ns ;
; N/A ; 97.09 MHz ( period = 10.300 ns ) ; count[2] ; count[15] ; clk ; clk ; None ; None ; 5.800 ns ;
; N/A ; 97.09 MHz ( period = 10.300 ns ) ; count[0] ; count[15] ; clk ; clk ; None ; None ; 5.800 ns ;
; Timing analysis restricted to 200 rows. ; To change the limit use Settings (Assignments menu) ; ; ; ; ; ; ; ;
+-----------------------------------------+-----------------------------------------------------+-----------+-----------+------------+----------+-----------------------------+---------------------------+-------------------------+
+------------------------------------------------------------------------------------------------------------------------------------------------+
; tco ;
+-----------------------------------------+-----------------------------------------------------+------------+-----------+----------+------------+
; Slack ; Required tco ; Actual tco ; From ; To ; From Clock ;
+-----------------------------------------+-----------------------------------------------------+------------+-----------+----------+------------+
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