📄 test.fit.rpt
字号:
; -- 4 input functions ; 788 ;
; -- 3 input functions ; 457 ;
; -- <=2 input functions ; 552 ;
; -- Register only ; 384 ;
; -- Combinational cells for routing ; 264 ;
; ; ;
; Logic elements by mode ; ;
; -- normal mode ; 1405 ;
; -- arithmetic mode ; 392 ;
; ; ;
; Total registers ; 1,620 / 33,216 ( 4 % ) ;
; Total LABs ; 183 / 2,076 ( 8 % ) ;
; User inserted logic elements ; 0 ;
; Virtual pins ; 0 ;
; I/O pins ; 180 / 322 ( 55 % ) ;
; -- Clock pins ; 2 / 8 ( 25 % ) ;
; Global signals ; 14 ;
; M4Ks ; 38 / 105 ( 36 % ) ;
; Total memory bits ; 148,480 / 483,840 ( 30 % ) ;
; Total RAM block bits ; 175,104 / 483,840 ( 36 % ) ;
; Embedded Multiplier 9-bit elements ; 0 / 70 ( 0 % ) ;
; Global clocks ; 14 / 16 ( 87 % ) ;
; Maximum fan-out node ; initial_block:inst9|odd_division:clk_50m_25m|clk_odd~clkctrl ;
; Maximum fan-out ; 801 ;
; Total fan-out ; 12199 ;
; Average fan-out ; 3.11 ;
+---------------------------------------------+--------------------------------------------------------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; al_da_ram ; E14 ; 4 ; 44 ; 36 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; clk75m ; L22 ; 5 ; 65 ; 19 ; 0 ; 3 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; fifo1_ef ; D3 ; 2 ; 0 ; 34 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; fifo2_ef ; G18 ; 5 ; 65 ; 30 ; 0 ; 3 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; fifo3_ef ; P17 ; 6 ; 65 ; 11 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; fifo4_ef ; AA18 ; 7 ; 55 ; 0 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; sd1_dat[0] ; B3 ; 3 ; 1 ; 36 ; 3 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; sd1_dat[1] ; A3 ; 3 ; 1 ; 36 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; sd1_dat[2] ; E1 ; 2 ; 0 ; 28 ; 4 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; sd1_dat[3] ; D1 ; 2 ; 0 ; 29 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; sd2_dat[0] ; G1 ; 2 ; 0 ; 25 ; 3 ; 5 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; sd2_dat[1] ; F1 ; 2 ; 0 ; 27 ; 1 ; 4 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; sd2_dat[2] ; J1 ; 2 ; 0 ; 23 ; 3 ; 4 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; sd2_dat[3] ; J2 ; 2 ; 0 ; 23 ; 4 ; 4 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; sd3_dat[0] ; N2 ; 1 ; 0 ; 17 ; 3 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; sd3_dat[1] ; N1 ; 1 ; 0 ; 17 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; sd3_dat[2] ; T1 ; 1 ; 0 ; 10 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; sd3_dat[3] ; R1 ; 1 ; 0 ; 12 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; sd4_dat[0] ; V1 ; 1 ; 0 ; 7 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; sd4_dat[1] ; U1 ; 1 ; 0 ; 9 ; 1 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; sd4_dat[2] ; Y2 ; 1 ; 0 ; 5 ; 1 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; sd4_dat[3] ; Y1 ; 1 ; 0 ; 5 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; sd_clk_in ; A12 ; 4 ; 31 ; 36 ; 1 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; vp ; E15 ; 4 ; 55 ; 36 ; 2 ; 469 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
+------------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins ;
+-------------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Output Register ; Output Enable Register ; Power Up High ; PCI I/O Enabled ; Open Drain ; TRI Primitive ; Bus Hold ; Weak Pull Up ; I/O Standard ; Current Strength ; Termination ; Location assigned by ; Load ;
+-------------+-------+----------+--------------+--------------+-------------+-----------------+------------------------+---------------+-----------------+------------+---------------+----------+--------------+--------------+------------------+-------------+----------------------+------+
; fifo12_fwft ; A17 ; 4 ; 46 ; 36 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; fifo12_mrs ; B17 ; 4 ; 46 ; 36 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; fifo12_pfm ; B16 ; 4 ; 42 ; 36 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; fifo12_prs ; C17 ; 4 ; 63 ; 36 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; fifo12_ren ; A16 ; 4 ; 42 ; 36 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; fifo12_wen ; C18 ; 4 ; 63 ; 36 ; 0 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
; fifo1_d[0] ; A4 ; 3 ; 1 ; 36 ; 1 ; no ; no ; no ; no ; no ; no ; no ; Off ; LVTTL ; 24mA ; Off ; User ; 0 pF ;
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