testinstruction.v

来自「若干VHDL语言的源代码」· Verilog 代码 · 共 4 行

V
4 行
字号 
//add r0 with 11111111 to r1
`define TestInstruction_Add1	32'b1110_0010_1000_0000_0001_0000_1111_1111
//add r1 with 00000000 to r3
`define TestInstruction_Add2	32'b1110_0010_1000_0001_0011_0000_0000_0000

testinstruction.v - 源码说明

本页面展示了「若干VHDL语言的源代码」中的 testinstruction.v 源码文件，采用 Verilog 编程语言编写，共 4 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

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