📄 framesynch.fit.rpt
字号:
+---------------------------------------------------------------------------------------------------+
; Non-Global High Fan-Out Signals ;
+-----------------------------------------------------------------------------------------+---------+
; Name ; Fan-Out ;
+-----------------------------------------------------------------------------------------+---------+
; cnt32:inst|co ; 3 ;
; barker:inst7|temp[6] ; 3 ;
; framecontrol:inst4|temq~379 ; 3 ;
; framecontrol:inst4|div3[0] ; 3 ;
; barker:inst7|temp[5] ; 3 ;
; barker:inst7|temp[3] ; 3 ;
; barker:inst7|temp[2] ; 3 ;
; barker:inst7|temp[4] ; 3 ;
; framecontrol:inst4|clk3 ; 3 ;
; cnt32:inst|lpm_counter:countx_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[2]~COUT ; 2 ;
; cnt32:inst|lpm_counter:countx_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[3]~COUT ; 2 ;
; framecontrol:inst4|div3[1] ; 2 ;
; barker:inst7|temp[1] ; 2 ;
; barker:inst7|temp[0] ; 2 ;
; framecontrol:inst4|div3[1]~17 ; 2 ;
; cnt32:inst|lpm_counter:countx_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[0]~COUT ; 2 ;
; cnt32:inst|lpm_counter:countx_rtl_0|alt_counter_f10ke:wysi_counter|counter_cell[1]~COUT ; 2 ;
; framecontrol:inst4|div3co ; 2 ;
; framecontrol:inst4|temnq~330 ; 2 ;
; decoder:inst2|reduce_nor~118 ; 1 ;
; cnt32:inst|lpm_counter:countx_rtl_0|alt_counter_f10ke:wysi_counter|q[4] ; 1 ;
; decoder:inst2|reduce_nor~119 ; 1 ;
; decoder:inst2|reduce_nor~24 ; 1 ;
; codein ; 1 ;
; decoder:inst2|reduce_nor~117 ; 1 ;
; cnt32:inst|reduce_nor~23 ; 1 ;
; inst6 ; 1 ;
+-----------------------------------------------------------------------------------------+---------+
+-----------------------------------------------------------------------------------------------------------+
; Peripheral Signals ;
+--------------------------+--------+--------------+-----------------+---------------------------+----------+
; Peripheral Signal ; Source ; Usage ; Dedicated Clock ; Peripheral Control Signal ; Polarity ;
+--------------------------+--------+--------------+-----------------+---------------------------+----------+
; framecontrol:inst4|s~121 ; LC1_A3 ; Async. clear ; no ; yes ; -ve ;
+--------------------------+--------+--------------+-----------------+---------------------------+----------+
+-------------------------------------------+
; LAB ;
+--------------------------+----------------+
; Number of Logic Elements ; Number of LABs ;
+--------------------------+----------------+
; 0 ; 67 ;
; 1 ; 1 ;
; 2 ; 1 ;
; 3 ; 0 ;
; 4 ; 0 ;
; 5 ; 0 ;
; 6 ; 0 ;
; 7 ; 0 ;
; 8 ; 3 ;
+--------------------------+----------------+
+----------------------------------------------+
; Local Routing Interconnect ;
+-----------------------------+----------------+
; Local Routing Interconnects ; Number of LABs ;
+-----------------------------+----------------+
; 0 ; 68 ;
; 1 ; 1 ;
; 2 ; 0 ;
; 3 ; 0 ;
; 4 ; 0 ;
; 5 ; 0 ;
; 6 ; 0 ;
; 7 ; 2 ;
; 8 ; 1 ;
+-----------------------------+----------------+
+---------------------------------------------+
; LAB External Interconnect ;
+----------------------------+----------------+
; LAB External Interconnects ; Number of LABs ;
+----------------------------+----------------+
; 0 ; 67 ;
; 1 ; 3 ;
; 2 ; 1 ;
; 3 ; 1 ;
+----------------------------+----------------+
+-----------------------------------------------------------------------------------------+
; Row Interconnect ;
+-------+--------------------+-----------------------------+------------------------------+
; Row ; Interconnect Used ; Left Half Interconnect Used ; Right Half Interconnect Used ;
+-------+--------------------+-----------------------------+------------------------------+
; A ; 1 / 96 ( 1 % ) ; 7 / 48 ( 14 % ) ; 0 / 48 ( 0 % ) ;
; B ; 0 / 96 ( 0 % ) ; 0 / 48 ( 0 % ) ; 0 / 48 ( 0 % ) ;
; C ; 0 / 96 ( 0 % ) ; 0 / 48 ( 0 % ) ; 0 / 48 ( 0 % ) ;
; Total ; 1 / 288 ( < 1 % ) ; 7 / 144 ( 4 % ) ; 0 / 144 ( 0 % ) ;
+-------+--------------------+-----------------------------+------------------------------+
+---------------------------+
; LAB Column Interconnect ;
+-------+-------------------+
; Col. ; Interconnect Used ;
+-------+-------------------+
; 1 ; 0 / 24 ( 0 % ) ;
; 2 ; 0 / 24 ( 0 % ) ;
; 3 ; 0 / 24 ( 0 % ) ;
; 4 ; 0 / 24 ( 0 % ) ;
; 5 ; 0 / 24 ( 0 % ) ;
; 6 ; 0 / 24 ( 0 % ) ;
; 7 ; 0 / 24 ( 0 % ) ;
; 8 ; 0 / 24 ( 0 % ) ;
; 9 ; 0 / 24 ( 0 % ) ;
; 10 ; 0 / 24 ( 0 % ) ;
; 11 ; 0 / 24 ( 0 % ) ;
; 12 ; 0 / 24 ( 0 % ) ;
; 13 ; 0 / 24 ( 0 % ) ;
; 14 ; 0 / 24 ( 0 % ) ;
; 15 ; 0 / 24 ( 0 % ) ;
; 16 ; 0 / 24 ( 0 % ) ;
; 17 ; 0 / 24 ( 0 % ) ;
; 18 ; 0 / 24 ( 0 % ) ;
; 19 ; 0 / 24 ( 0 % ) ;
; 20 ; 0 / 24 ( 0 % ) ;
; 21 ; 0 / 24 ( 0 % ) ;
; 22 ; 0 / 24 ( 0 % ) ;
; 23 ; 0 / 24 ( 0 % ) ;
; 24 ; 0 / 24 ( 0 % ) ;
; Total ; 0 / 576 ( 0 % ) ;
+-------+-------------------+
+---------------------------+
; LAB Column Interconnect ;
+-------+-------------------+
; Col. ; Interconnect Used ;
+-------+-------------------+
; 1 ; 0 / 24 ( 0 % ) ;
; Total ; 0 / 24 ( 0 % ) ;
+-------+-------------------+
+----------------------------------------------------+
; Fitter Resource Usage Summary ;
+--------------------------------+-------------------+
; Resource ; Usage ;
+--------------------------------+-------------------+
; Logic cells ; 27 / 576 ( 4 % ) ;
; Registers ; 16 / 576 ( 2 % ) ;
; Logic elements in carry chains ; 5 ;
; User inserted logic cells ; 0 ;
; I/O pins ; 3 / 150 ( 2 % ) ;
; -- Clock pins ; 0 ;
; -- Dedicated input pins ; 0 / 4 ( 0 % ) ;
; Global signals ; 2 ;
; EABs ; 0 / 3 ( 0 % ) ;
; Total memory bits ; 0 / 6,144 ( 0 % ) ;
; Total RAM block bits ; 0 / 6,144 ( 0 % ) ;
; Maximum fan-out node ; clk ;
; Maximum fan-out ; 15 ;
; Total fan-out ; 81 ;
; Average fan-out ; 2.70 ;
+--------------------------------+-------------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fitter Resource Utilization by Entity ;
+-------------------------------------------+-------------+--------------+-------------+------+--------------+-------------------+------------------+-----------------+--------------------------------------------------------------------------------+
; Compilation Hierarchy Node ; Logic Cells ; LC Registers ; Memory Bits ; Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Carry Chain LCs ; Full Hierarchy Name ;
+-------------------------------------------+-------------+--------------+-------------+------+--------------+-------------------+------------------+-----------------+--------------------------------------------------------------------------------+
; |framesynch ; 27 (1) ; 16 ; 0 ; 3 ; 11 (1) ; 8 (0) ; 8 (0) ; 5 (0) ; |framesynch ;
; |barker:inst7| ; 7 (7) ; 7 ; 0 ; 0 ; 0 (0) ; 7 (7) ; 0 (0) ; 0 (0) ; |framesynch|barker:inst7 ;
; |cnt32:inst| ; 7 (2) ; 6 ; 0 ; 0 ; 1 (1) ; 0 (0) ; 6 (1) ; 5 (0) ; |framesynch|cnt32:inst ;
; |lpm_counter:countx_rtl_0| ; 5 (0) ; 5 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 5 (0) ; 5 (0) ; |framesynch|cnt32:inst|lpm_counter:countx_rtl_0 ;
; |alt_counter_f10ke:wysi_counter| ; 5 (5) ; 5 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 5 (5) ; 5 (5) ; |framesynch|cnt32:inst|lpm_counter:countx_rtl_0|alt_counter_f10ke:wysi_counter ;
; |decoder:inst2| ; 4 (4) ; 0 ; 0 ; 0 ; 4 (4) ; 0 (0) ; 0 (0) ; 0 (0) ; |framesynch|decoder:inst2 ;
; |framecontrol:inst4| ; 8 (8) ; 3 ; 0 ; 0 ; 5 (5) ; 1 (1) ; 2 (2) ; 0 (0) ; |framesynch|framecontrol:inst4 ;
+-------------------------------------------+-------------+--------------+-------------+------+--------------+-------------------+------------------+-----------------+--------------------------------------------------------------------------------+
+----------------------------------+
; Delay Chain Summary ;
+---------+----------+-------------+
; Name ; Pin Type ; Pad to Core ;
+---------+----------+-------------+
; clk ; Input ; OFF ;
; codein ; Input ; OFF ;
; fsynout ; Output ; OFF ;
+---------+----------+-------------+
+--------------+
; Pin-Out File ;
+--------------+
The pin-out file can be found in D:/lzxdesign10/framesynch/framesynch.pin.
+-----------------+
; Fitter Messages ;
+-----------------+
Info: *******************************************************************
Info: Running Quartus II Fitter
Info: Version 4.1 Build 181 06/29/2004 SJ Full Version
Info: Processing started: Wed Apr 05 21:52:53 2006
Info: Command: quartus_fit --import_settings_files=off --export_settings_files=off framesynch -c framesynch
Info: Selected device EPF10K10AFC256-1 for design framesynch
Info: Timing requirements not specified -- optimizing circuit to achieve the following default global requirements
Info: Assuming a global fmax requirement of 1000 MHz
Info: Not setting a global tsu requirement
Info: Not setting a global tco requirement
Info: Not setting a global tpd requirement
Info: Inserted 0 logic cells in first fitting attempt
Info: Started fitting attempt 1 on Wed Apr 05 2006 at 21:52:57
Info: Fitter placement preparation operations beginning
Info: Fitter placement preparation operations ending: elapsed time = 0 seconds
Info: Fitter placement operations beginning
Info: Fitter placement operations ending: elapsed time = 0 seconds
Info: Fitter routing operations beginning
Info: Fitter routing operations ending: elapsed time = 0 seconds
Info: Quartus II Fitter was successful. 0 errors, 0 warnings
Info: Processing ended: Wed Apr 05 21:52:58 2006
Info: Elapsed time: 00:00:05
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