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📄 state.tan.rpt

📁 FPGA实验:用于检测输入的二进制系列
💻 RPT
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字号:
; N/A   ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; cnt[4] ; next_state[7] ; clk0       ; clk0     ; None                        ; None                      ; 1.567 ns                ;
; N/A   ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; cnt[0] ; cnt[4]        ; clk0       ; clk0     ; None                        ; None                      ; 1.540 ns                ;
; N/A   ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; cnt[0] ; cnt[3]        ; clk0       ; clk0     ; None                        ; None                      ; 1.469 ns                ;
; N/A   ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; cnt[0] ; cnt[2]        ; clk0       ; clk0     ; None                        ; None                      ; 1.398 ns                ;
; N/A   ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; cnt[3] ; cnt[4]        ; clk0       ; clk0     ; None                        ; None                      ; 1.385 ns                ;
; N/A   ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; cnt[2] ; cnt[4]        ; clk0       ; clk0     ; None                        ; None                      ; 1.296 ns                ;
; N/A   ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; cnt[1] ; cnt[1]        ; clk0       ; clk0     ; None                        ; None                      ; 1.244 ns                ;
; N/A   ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; cnt[2] ; cnt[3]        ; clk0       ; clk0     ; None                        ; None                      ; 1.225 ns                ;
; N/A   ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; cnt[0] ; cnt[1]        ; clk0       ; clk0     ; None                        ; None                      ; 1.015 ns                ;
; N/A   ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; cnt[3] ; cnt[3]        ; clk0       ; clk0     ; None                        ; None                      ; 1.002 ns                ;
; N/A   ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; cnt[2] ; cnt[2]        ; clk0       ; clk0     ; None                        ; None                      ; 0.842 ns                ;
; N/A   ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; cnt[4] ; cnt[4]        ; clk0       ; clk0     ; None                        ; None                      ; 0.557 ns                ;
; N/A   ; Restricted to 420.17 MHz ( period = 2.380 ns ) ; cnt[0] ; cnt[0]        ; clk0       ; clk0     ; None                        ; None                      ; 0.407 ns                ;
+-------+------------------------------------------------+--------+---------------+------------+----------+-----------------------------+---------------------------+-------------------------+


+----------------------------------------------------------------------+
; tsu                                                                  ;
+-------+--------------+------------+-------+---------------+----------+
; Slack ; Required tsu ; Actual tsu ; From  ; To            ; To Clock ;
+-------+--------------+------------+-------+---------------+----------+
; N/A   ; None         ; 6.795 ns   ; w[8]  ; next_state[2] ; clk0     ;
; N/A   ; None         ; 6.705 ns   ; w[13] ; next_state[2] ; clk0     ;
; N/A   ; None         ; 6.700 ns   ; w[0]  ; next_state[2] ; clk0     ;
; N/A   ; None         ; 6.666 ns   ; w[8]  ; next_state[1] ; clk0     ;
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; N/A   ; None         ; 6.629 ns   ; w[8]  ; next_state[6] ; clk0     ;
; N/A   ; None         ; 6.629 ns   ; w[8]  ; next_state[3] ; clk0     ;
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; N/A   ; None         ; 6.539 ns   ; w[13] ; next_state[3] ; clk0     ;
; N/A   ; None         ; 6.537 ns   ; w[0]  ; next_state[5] ; clk0     ;
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; N/A   ; None         ; 6.534 ns   ; w[0]  ; next_state[3] ; clk0     ;
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