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来自「fpga开发pci的verilog」· RPT 代码 · 共 443 行 · 第 1/5 页

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; dq[31] ; Unassigned ; --       ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no             ; no              ; no         ; no       ; Off          ; LVTTL        ; Default          ; Off         ; User                 ; Unspecified ;
; dq[3]  ; Unassigned ; --       ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no             ; no              ; no         ; no       ; Off          ; LVTTL        ; Default          ; Off         ; User                 ; Unspecified ;
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; ld[27] ; Unassigned ; --       ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no             ; no              ; no         ; no       ; Off          ; LVTTL        ; Default          ; Off         ; User                 ; Unspecified ;
; ld[28] ; Unassigned ; --       ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no             ; no              ; no         ; no       ; Off          ; LVTTL        ; Default          ; Off         ; User                 ; Unspecified ;
; ld[29] ; Unassigned ; --       ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no             ; no              ; no         ; no       ; Off          ; LVTTL        ; Default          ; Off         ; User                 ; Unspecified ;
; ld[2]  ; Unassigned ; --       ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no             ; no              ; no         ; no       ; Off          ; LVTTL        ; Default          ; Off         ; User                 ; Unspecified ;
; ld[30] ; Unassigned ; --       ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no             ; no              ; no         ; no       ; Off          ; LVTTL        ; Default          ; Off         ; User                 ; Unspecified ;
; ld[31] ; Unassigned ; --       ; 1                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no             ; no              ; no         ; no       ; Off          ; LVTTL        ; Default          ; Off         ; User                 ; Unspecified ;
; ld[3]  ; Unassigned ; --       ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no             ; no              ; no         ; no       ; Off          ; LVTTL        ; Default          ; Off         ; User                 ; Unspecified ;
; ld[4]  ; Unassigned ; --       ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no             ; no              ; no         ; no       ; Off          ; LVTTL        ; Default          ; Off         ; User                 ; Unspecified ;
; ld[5]  ; Unassigned ; --       ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no             ; no              ; no         ; no       ; Off          ; LVTTL        ; Default          ; Off         ; User                 ; Unspecified ;
; ld[6]  ; Unassigned ; --       ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no             ; no              ; no         ; no       ; Off          ; LVTTL        ; Default          ; Off         ; User                 ; Unspecified ;
; ld[7]  ; Unassigned ; --       ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no             ; no              ; no         ; no       ; Off          ; LVTTL        ; Default          ; Off         ; User                 ; Unspecified ;
; ld[8]  ; Unassigned ; --       ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no             ; no              ; no         ; no       ; Off          ; LVTTL        ; Default          ; Off         ; User                 ; Unspecified ;
; ld[9]  ; Unassigned ; --       ; 0                     ; 0                  ; no     ; no             ; no              ; no                     ; no            ; no             ; no              ; no         ; no       ; Off          ; LVTTL        ; Default          ; Off         ; User                 ; Unspecified ;
+--------+------------+----------+-----------------------+--------------------+--------+----------------+-----------------+------------------------+---------------+----------------+-----------------+------------+----------+--------------+--------------+------------------+-------------+----------------------+-------------+


+----------------------------------------------------------+
; I/O Bank Usage                                           ;
+----------+----------------+---------------+--------------+
; I/O Bank ; Usage          ; VCCIO Voltage ; VREF Voltage ;
+----------+----------------+---------------+--------------+
; 1        ; 0 / 44 ( 0 % ) ; 3.3V          ; --           ;
; 2        ; 0 / 48 ( 0 % ) ; 3.3V          ; --           ;
; 3        ; 0 / 45 ( 0 % ) ; 3.3V          ; --           ;
; 4        ; 0 / 48 ( 0 % ) ; 3.3V          ; --           ;
; Unknown  ; 125            ; --            ;              ;
+----------+----------------+---------------+--------------+


+--------------------------------------------------------------------------------------------------------------------+
; All Package Pins                                                                                                   ;
+----------+------------+----------+----------------+--------+--------------+---------+------------+-----------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; Dir.   ; I/O Standard ; Voltage ; I/O Type   ; User Assignment ;
+----------+------------+----------+----------------+--------+--------------+---------+------------+-----------------+
; 1        ; 0          ; 1        ; GND*           ;        ;              ;         ; Row I/O    ;                 ;
; 2        ; 1          ; 1        ; GND*           ;        ;              ;         ; Row I/O    ;                 ;
; 3        ; 2          ; 1        ; GND*           ;        ;              ;         ; Row I/O    ;                 ;
; 4        ; 3          ; 1        ; GND*           ;        ;              ;         ; Row I/O    ;                 ;
; 5        ; 4          ; 1        ; GND*           ;        ;              ;         ; Row I/O    ;                 ;
; 6        ; 5          ; 1        ; GND*           ;        ;              ;         ; Row I/O    ;                 ;
; 7        ; 6          ; 1        ; GND*           ;        ;              ;         ; Row I/O    ;                 ;
; 8        ; 7          ; 1        ; GND*           ;        ;              ;         ; Row I/O    ;                 ;
; 9        ;            ; 1        ; VCCIO1         ; power  ;              ; 3.3V    ; --         ;                 ;
; 10       ;            ;          ; GND            ; gnd    ;              ;         ; --         ;                 ;
; 11       ; 8          ; 1        ; GND*           ;        ;              ;         ; Row I/O    ;                 ;
; 12       ; 9          ; 1        ; GND*           ;        ;              ;         ; Row I/O    ;                 ;
; 13       ; 10         ; 1        ; GND*           ;        ;              ;         ; Row I/O    ;                 ;
; 14       ; 11         ; 1        ; GND*           ;        ;              ;         ; Row I/O    ;                 ;
; 15       ; 12         ; 1        ; GND*           ;        ;              ;         ; Row I/O    ;                 ;
; 16       ; 13         ; 1        ; GND*           ;        ;              ;         ; Row I/O    ;                 ;
; 17       ; 14         ; 1        ; GND*           ;        ;              ;         ; Row I/O    ;                 ;
; 18       ; 15         ; 1        ; GND*           ;        ;              ;         ; Row I/O    ;                 ;
; 19       ; 16         ; 1        ; GND*           ;        ;              ;         ; Row I/O    ;                 ;
; 20       ; 17         ; 1        ; GND*           ;        ;              ;         ; Row I/O    ;                 ;
; 21       ; 18         ; 1        ; GND*           ;        ;              ;         ; Row I/O    ;                 ;
; 22       ;            ; 1        ; VCCIO1         ; power  ;              ; 3.3V    ; --         ;                 ;
; 23       ; 19         ; 1        ; GND*           ;        ;              ;         ; Row I/O    ;                 ;
; 24       ; 20         ; 1        ; GND*           ;        ;              ;         ; Row I/O    ;                 ;