div_256.spl

来自「来自FPGA开发板的PS2开发源代码」· SPL 代码 · 共 10 行

SPL

10 行

[Inputs]
mclk
reset
[Outputs]
clk
[BiDir]
[ATTRIBUTES]
VeriModel div_256

div_256.spl - 源码说明

本页面展示了「来自FPGA开发板的PS2开发源代码」中的 div_256.spl 源码文件，采用 SPL 编程语言编写，共 10 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

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