top.versim_synth

来自「来自FPGA开发板的PS2开发源代码」· VERSIM_SYNTH 代码 · 共 3 行

VERSIM_SYNTH
3 行
字号 
top.versim_synth -- generated only for ProjNav status tracking
Simulation Model Target: ModelSim SE (Verilog)

top.versim_synth - 源码说明

本页面展示了「来自FPGA开发板的PS2开发源代码」中的 top.versim_synth 源码文件，采用 VERSIM_SYNTH 编程语言编写，共 3 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

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