i2c.fit.rpt

CPLD VHDL CODE非常好的参考资料

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; Fitter Equations ;
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The equations can be found in G:/work_room/PLD/Mars-7128-S Altera CPLD开发板/示例程序/VHDL/接口实验/i2c总线/i2c.fit.eqn.


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; Pin-Out File ;
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The pin-out file can be found in G:/work_room/PLD/Mars-7128-S Altera CPLD开发板/示例程序/VHDL/接口实验/i2c总线/i2c.pin.


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; Fitter Resource Usage Summary                      ;
+-------------------------------+--------------------+
; Resource                      ; Usage              ;
+-------------------------------+--------------------+
; Logic cells                   ; 126 / 128 ( 98 % ) ;
; Registers                     ; 70 / 128 ( 54 % )  ;
; Number of pterms used         ; 431                ;
; User inserted logic elements  ; 0                  ;
; I/O pins                      ; 25 / 68 ( 36 % )   ;
;     -- Clock pins             ; 1 / 2 ( 50 % )     ;
;     -- Dedicated input pins   ; 1 / 2 ( 50 % )     ;
; Global signals                ; 2                  ;
; Shareable expanders           ; 24 / 128 ( 18 % )  ;
; Parallel expanders            ; 36 / 120 ( 30 % )  ;
; Cells using turbo bit         ; 126 / 128 ( 98 % ) ;
; Maximum fan-out node          ; clk                ;
; Maximum fan-out               ; 70                 ;
; Total fan-out                 ; 1549               ;
; Average fan-out               ; 8.85               ;
+-------------------------------+--------------------+


+--------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins                                                                                                                                       ;
+------------+-------+----------+-----+-----------------------+--------------------+--------+----------------+--------------+----------------------+
; Name       ; Pin # ; I/O Bank ; LAB ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; I/O Standard ; Location assigned by ;
+------------+-------+----------+-----+-----------------------+--------------------+--------+----------------+--------------+----------------------+
; clk        ; 83    ; --       ; --  ; 70                    ; 0                  ; yes    ; no             ; TTL          ; User                 ;
; data_in[0] ; 24    ; --       ; 3   ; 1                     ; 0                  ; no     ; no             ; TTL          ; User                 ;
; data_in[1] ; 22    ; --       ; 2   ; 1                     ; 0                  ; no     ; no             ; TTL          ; User                 ;
; data_in[2] ; 21    ; --       ; 2   ; 1                     ; 0                  ; no     ; no             ; TTL          ; User                 ;
; data_in[3] ; 20    ; --       ; 2   ; 1                     ; 0                  ; no     ; no             ; TTL          ; User                 ;
; rd_input   ; 36    ; --       ; 4   ; 2                     ; 0                  ; no     ; no             ; TTL          ; User                 ;
; rst        ; 1     ; --       ; --  ; 70                    ; 0                  ; yes    ; no             ; TTL          ; User                 ;
; wr_input   ; 35    ; --       ; 4   ; 3                     ; 0                  ; no     ; no             ; TTL          ; User                 ;
+------------+-------+----------+-----+-----------------------+--------------------+--------+----------------+--------------+----------------------+


+----------------------------------------------------------------------------------------------------------------------------------------------------------+
; Output Pins                                                                                                                                              ;
+-------------+-------+----------+-----+-----------------+----------------+------------+---------------+--------------+----------------------+-------------+
; Name        ; Pin # ; I/O Bank ; LAB ; Output Register ; Slow Slew Rate ; Open Drain ; TRI Primitive ; I/O Standard ; Location assigned by ; Load        ;
+-------------+-------+----------+-----+-----------------+----------------+------------+---------------+--------------+----------------------+-------------+
; en[0]       ; 75    ; --       ; 8   ; no              ; no             ; no         ; no            ; TTL          ; User                 ; Unspecified ;
; en[1]       ; 74    ; --       ; 8   ; no              ; no             ; no         ; no            ; TTL          ; User                 ; Unspecified ;
; lowbit      ; 30    ; --       ; 3   ; no              ; no             ; no         ; no            ; TTL          ; User                 ; Unspecified ;
; scl         ; 28    ; --       ; 3   ; no              ; no             ; no         ; no            ; TTL          ; User                 ; Unspecified ;
; seg_data[0] ; 61    ; --       ; 6   ; no              ; no             ; no         ; no            ; TTL          ; User                 ; Unspecified ;
; seg_data[1] ; 64    ; --       ; 7   ; no              ; no             ; no         ; no            ; TTL          ; User                 ; Unspecified ;
; seg_data[2] ; 56    ; --       ; 6   ; no              ; no             ; no         ; no            ; TTL          ; User                 ; Unspecified ;
; seg_data[3] ; 58    ; --       ; 6   ; no              ; no             ; no         ; no            ; TTL          ; User                 ; Unspecified ;
; seg_data[4] ; 60    ; --       ; 6   ; no              ; no             ; no         ; no            ; TTL          ; User                 ; Unspecified ;
; seg_data[5] ; 63    ; --       ; 7   ; no              ; no             ; no         ; no            ; TTL          ; User                 ; Unspecified ;
; seg_data[6] ; 55    ; --       ; 6   ; no              ; no             ; no         ; no            ; TTL          ; User                 ; Unspecified ;
; seg_data[7] ; 57    ; --       ; 6   ; no              ; no             ; no         ; no            ; TTL          ; User                 ; Unspecified ;
+-------------+-------+----------+-----+-----------------+----------------+------------+---------------+--------------+----------------------+-------------+


+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Bidir Pins                                                                                                                                                                                               ;
+------+-------+----------+-----+-----------------------+--------------------+--------+----------------+-----------------+----------------+------------+--------------+----------------------+-------------+
; Name ; Pin # ; I/O Bank ; LAB ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Output Register ; Slow Slew Rate ; Open Drain ; I/O Standard ; Location assigned by ; Load        ;
+------+-------+----------+-----+-----------------------+--------------------+--------+----------------+-----------------+----------------+------------+--------------+----------------------+-------------+
; sda  ; 29    ; --       ; 3   ; 10                    ; 0                  ; no     ; no             ; no              ; no             ; no         ; TTL          ; User                 ; Unspecified ;
+------+-------+----------+-----+-----------------------+--------------------+--------+----------------+-----------------+----------------+------------+--------------+----------------------+-------------+


+-------------------------------------------------------------------------------------------------------+
; All Package Pins                                                                                      ;
+----------+------------+----------+----------------+--------+--------------+---------+-----------------+
; Location ; Pad Number ; I/O Bank ; Pin Name/Usage ; Dir.   ; I/O Standard ; Voltage ; User Assignment ;
+----------+------------+----------+----------------+--------+--------------+---------+-----------------+
; 1        ; 0          ; --       ; rst            ; input  ; TTL          ;         ; Y               ;
; 2        ; 1          ; --       ; GND+           ;        ;              ;         ;                 ;
; 3        ; 2          ; --       ; VCCINT         ; power  ;              ; 5.0V    ;                 ;
; 4        ; 3          ; --       ; RESERVED_INPUT ;        ;              ;         ;                 ;
; 5        ; 4          ; --       ; RESERVED_INPUT ;        ;              ;         ;                 ;
; 6        ; 5          ; --       ; RESERVED_INPUT ;        ;              ;         ;                 ;
; 7        ; 6          ; --       ; GND            ; gnd    ;              ;         ;                 ;
; 8        ; 7          ; --       ; RESERVED_INPUT ;        ;              ;         ;                 ;
; 9        ; 8          ; --       ; RESERVED_INPUT ;        ;              ;         ;                 ;
; 10       ; 9          ; --       ; RESERVED_INPUT ;        ;              ;         ;                 ;
; 11       ; 10         ; --       ; RESERVED_INPUT ;        ;              ;         ;                 ;
; 12       ; 11         ; --       ; RESERVED_INPUT ;        ;              ;         ;                 ;
; 13       ; 12         ; --       ; VCCIO          ; power  ;              ; 5.0V    ;                 ;
; 14       ; 13         ; --       ; +TDI           ; input  ; TTL          ;         ; N               ;
; 15       ; 14         ; --       ; RESERVED_INPUT ;        ;              ;         ;                 ;
; 16       ; 15         ; --       ; RESERVED_INPUT ;        ;              ;         ;                 ;
; 17       ; 16         ; --       ; RESERVED_INPUT ;        ;              ;         ;                 ;