lcd.tan.rpt
来自「CPLD VHDL CODE非常好的参考资料」· RPT 代码 · 共 445 行 · 第 1/5 页
RPT
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; N/A ; 76.92 MHz ( period = 13.000 ns ) ; clkcnt[16] ; clkcnt[16] ; clk ; clk ; None ; None ; 8.000 ns ;
; N/A ; 76.92 MHz ( period = 13.000 ns ) ; clkcnt[17] ; clkcnt[17] ; clk ; clk ; None ; None ; 8.000 ns ;
; N/A ; 76.92 MHz ( period = 13.000 ns ) ; clkcnt[0] ; clkcnt[0] ; clk ; clk ; None ; None ; 8.000 ns ;
; N/A ; 76.92 MHz ( period = 13.000 ns ) ; clkcnt[17] ; clkcnt[0] ; clk ; clk ; None ; None ; 8.000 ns ;
; N/A ; 76.92 MHz ( period = 13.000 ns ) ; clkcnt[16] ; clkcnt[0] ; clk ; clk ; None ; None ; 8.000 ns ;
; N/A ; 76.92 MHz ( period = 13.000 ns ) ; clkcnt[15] ; clkcnt[0] ; clk ; clk ; None ; None ; 8.000 ns ;
; N/A ; 76.92 MHz ( period = 13.000 ns ) ; clkcnt[14] ; clkcnt[0] ; clk ; clk ; None ; None ; 8.000 ns ;
; N/A ; 76.92 MHz ( period = 13.000 ns ) ; clkcnt[13] ; clkcnt[0] ; clk ; clk ; None ; None ; 8.000 ns ;
; N/A ; 76.92 MHz ( period = 13.000 ns ) ; clkcnt[12] ; clkcnt[0] ; clk ; clk ; None ; None ; 8.000 ns ;
; N/A ; 76.92 MHz ( period = 13.000 ns ) ; clkcnt[11] ; clkcnt[0] ; clk ; clk ; None ; None ; 8.000 ns ;
; N/A ; 76.92 MHz ( period = 13.000 ns ) ; clkcnt[10] ; clkcnt[0] ; clk ; clk ; None ; None ; 8.000 ns ;
; N/A ; 76.92 MHz ( period = 13.000 ns ) ; clkcnt[9] ; clkcnt[0] ; clk ; clk ; None ; None ; 8.000 ns ;
; N/A ; 76.92 MHz ( period = 13.000 ns ) ; clkcnt[8] ; clkcnt[0] ; clk ; clk ; None ; None ; 8.000 ns ;
; N/A ; 76.92 MHz ( period = 13.000 ns ) ; clkcnt[7] ; clkcnt[0] ; clk ; clk ; None ; None ; 8.000 ns ;
; N/A ; 76.92 MHz ( period = 13.000 ns ) ; clkcnt[6] ; clkcnt[0] ; clk ; clk ; None ; None ; 8.000 ns ;
; N/A ; 76.92 MHz ( period = 13.000 ns ) ; clkcnt[18] ; clkcnt[0] ; clk ; clk ; None ; None ; 8.000 ns ;
; N/A ; 76.92 MHz ( period = 13.000 ns ) ; clkcnt[5] ; clkcnt[0] ; clk ; clk ; None ; None ; 8.000 ns ;
; N/A ; 76.92 MHz ( period = 13.000 ns ) ; clkcnt[4] ; clkcnt[0] ; clk ; clk ; None ; None ; 8.000 ns ;
; N/A ; 76.92 MHz ( period = 13.000 ns ) ; clkcnt[3] ; clkcnt[0] ; clk ; clk ; None ; None ; 8.000 ns ;
; N/A ; 76.92 MHz ( period = 13.000 ns ) ; clkcnt[2] ; clkcnt[0] ; clk ; clk ; None ; None ; 8.000 ns ;
; Timing analysis restricted to 200 rows. ; To change the limit use Settings (Assignments menu) ; ; ; ; ; ; ; ;
+-----------------------------------------+-----------------------------------------------------+------------+------------+------------+----------+-----------------------------+---------------------------+-------------------------+
+-----------------------------------------------------------------------+
; tco ;
+-------+--------------+------------+------------+---------+------------+
; Slack ; Required tco ; Actual tco ; From ; To ; From Clock ;
+-------+--------------+------------+------------+---------+------------+
; N/A ; None ; 55.000 ns ; state[9] ; data[0] ; clk ;
; N/A ; None ; 55.000 ns ; state[3] ; data[0] ; clk ;
; N/A ; None ; 55.000 ns ; state[5] ; data[0] ; clk ;
; N/A ; None ; 55.000 ns ; state[2] ; data[0] ; clk ;
; N/A ; None ; 55.000 ns ; state[0] ; data[0] ; clk ;
; N/A ; None ; 55.000 ns ; state[7] ; data[0] ; clk ;
; N/A ; None ; 55.000 ns ; state[4] ; data[0] ; clk ;
; N/A ; None ; 55.000 ns ; counter[2] ; data[0] ; clk ;
; N/A ; None ; 55.000 ns ; counter[5] ; data[0] ; clk ;
; N/A ; None ; 55.000 ns ; counter[4] ; data[0] ; clk ;
; N/A ; None ; 55.000 ns ; counter[3] ; data[0] ; clk ;
; N/A ; None ; 55.000 ns ; counter[0] ; data[0] ; clk ;
; N/A ; None ; 55.000 ns ; counter[6] ; data[0] ; clk ;
; N/A ; None ; 55.000 ns ; state[9] ; data[1] ; clk ;
; N/A ; None ; 55.000 ns ; state[3] ; data[1] ; clk ;
; N/A ; None ; 55.000 ns ; state[5] ; data[1] ; clk ;
; N/A ; None ; 55.000 ns ; state[0] ; data[1] ; clk ;
; N/A ; None ; 55.000 ns ; state[7] ; data[1] ; clk ;
; N/A ; None ; 55.000 ns ; state[4] ; data[1] ; clk ;
; N/A ; None ; 55.000 ns ; counter[2] ; data[1] ; clk ;
; N/A ; None ; 55.000 ns ; counter[5] ; data[1] ; clk ;
; N/A ; None ; 55.000 ns ; counter[4] ; data[1] ; clk ;
; N/A ; None ; 55.000 ns ; counter[3] ; data[1] ; clk ;
; N/A ; None ; 55.000 ns ; counter[1] ; data[1] ; clk ;
; N/A ; None ; 55.000 ns ; counter[0] ; data[1] ; clk ;
; N/A ; None ; 55.000 ns ; counter[6] ; data[1] ; clk ;
; N/A ; None ; 54.000 ns ; state[9] ; data[2] ; clk ;
; N/A ; None ; 54.000 ns ; state[3] ; data[2] ; clk ;
; N/A ; None ; 54.000 ns ; state[5] ; data[2] ; clk ;
; N/A ; None ; 54.000 ns ; state[2] ; data[2] ; clk ;
; N/A ; None ; 54.000 ns ; state[0] ; data[2] ; clk ;
; N/A ; None ; 54.000 ns ; state[7] ; data[2] ; clk ;
; N/A ; None ; 54.000 ns ; state[4] ; data[2] ; clk ;
; N/A ; None ; 54.000 ns ; counter[2] ; data[2] ; clk ;
; N/A ; None ; 54.000 ns ; counter[5] ; data[2] ; clk ;
; N/A ; None ; 54.000 ns ; counter[4] ; data[2] ; clk ;
; N/A ; None ; 54.000 ns ; counter[3] ; data[2] ; clk ;
; N/A ; None ; 54.000 ns ; counter[1] ; data[2] ; clk ;
; N/A ; None ; 54.000 ns ; counter[0] ; data[2] ; clk ;
; N/A ; None ; 54.000 ns ; counter[6] ; data[2] ; clk ;
; N/A ; None ; 54.000 ns ; state[9] ; data[5] ; clk ;
; N/A ; None ; 54.000 ns ; state[5] ; data[5] ; clk ;
; N/A ; None ; 54.000 ns ; counter[1] ; data[0] ; clk ;
; N/A ; None ; 54.000 ns ; state[9] ; data[6] ; clk ;
; N/A ; None ; 54.000 ns ; state[3] ; data[6] ; clk ;
; N/A ; None ; 54.000 ns ; state[5] ; data[6] ; clk ;
; N/A ; None ; 54.000 ns ; state[2] ; data[6] ; clk ;
; N/A ; None ; 54.000 ns ; state[0] ; data[6] ; clk ;
; N/A ; None ; 54.000 ns ; state[7] ; data[6] ; clk ;
; N/A ; None ; 54.000 ns ; state[4] ; data[6] ; clk ;
; N/A ; None ; 54.000 ns ; counter[2] ; data[6] ; clk ;
; N/A ; None ; 54.000 ns ; counter[5] ; data[6] ; clk ;
; N/A ; None ; 54.000 ns ; counter[4] ; data[6] ; clk ;
; N/A ; None ; 54.000 ns ; counter[3] ; data[6] ; clk ;
; N/A ; None ; 54.000 ns ; counter[1] ; data[6] ; clk ;
; N/A ; None ; 54.000 ns ; counter[0] ; data[6] ; clk ;
; N/A ; None ; 54.000 ns ; counter[6] ; data[6] ; clk ;
; N/A ; None ; 53.000 ns ; state[9] ; data[4] ; clk ;
; N/A ; None ; 53.000 ns ; state[3] ; data[4] ; clk ;
; N/A ; None ; 53.000 ns ; state[5] ; data[4] ; clk ;
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