fpga_am_rom.mif

基于cyclone系列FPGA的模拟幅度调制的VHDL代码

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-- Quartus II generated Memory Initialization File (.mif)

WIDTH=10;
DEPTH=99;

ADDRESS_RADIX=HEX;
DATA_RADIX=HEX;

CONTENT BEGIN
	00  :   1FF;
	01  :   21F;
	02  :   240;
	03  :   260;
	04  :   27F;
	05  :   29F;
	06  :   2BD;
	07  :   2DB;
	08  :   2F8;
	09  :   314;
	0A  :   32E;
	0B  :   348;
	0C  :   360;
	0D  :   377;
	0E  :   38C;
	0F  :   3A0;
	10  :   3B2;
	11  :   3C2;
	12  :   3D0;
	13  :   3DD;
	14  :   3E7;
	15  :   3F0;
	16  :   3F7;
	17  :   3FB;
	[18..19]  :   3FE;
	1A  :   3FD;
	1B  :   3F9;
	1C  :   3F4;
	1D  :   3EC;
	1E  :   3E2;
	1F  :   3D7;
	20  :   3C9;
	21  :   3BA;
	22  :   3A9;
	23  :   396;
	24  :   382;
	25  :   36C;
	26  :   354;
	27  :   33B;
	28  :   321;
	29  :   306;
	2A  :   2E9;
	2B  :   2CC;
	2C  :   2AE;
	2D  :   28F;
	2E  :   270;
	2F  :   250;
	30  :   230;
	31  :   20F;
	32  :   1EF;
	33  :   1CE;
	34  :   1AE;
	35  :   18E;
	36  :   16F;
	37  :   150;
	38  :   132;
	39  :   115;
	3A  :   0F8;
	3B  :   0DD;
	3C  :   0C3;
	3D  :   0AA;
	3E  :   092;
	3F  :   07C;
	40  :   068;
	41  :   055;
	42  :   044;
	43  :   035;
	44  :   027;
	45  :   01C;
	46  :   012;
	47  :   00A;
	48  :   005;
	49  :   001;
	[4A..4B]  :   000;
	4C  :   003;
	4D  :   007;
	4E  :   00E;
	4F  :   017;
	50  :   021;
	51  :   02E;
	52  :   03C;
	53  :   04C;
	54  :   05E;
	55  :   072;
	56  :   087;
	57  :   09E;
	58  :   0B6;
	59  :   0D0;
	5A  :   0EA;
	5B  :   106;
	5C  :   123;
	5D  :   141;
	5E  :   15F;
	5F  :   17F;
	60  :   19E;
	61  :   1BE;
	62  :   1DF;
END;