📄 myfx2.fit.rpt
字号:
; -- 3 input functions ; 0 ;
; -- 2 input functions ; 16 ;
; -- 1 input functions ; 2 ;
; -- 0 input functions ; 2 ;
; ; ;
; Logic elements by mode ; ;
; -- normal mode ; 5 ;
; -- arithmetic mode ; 15 ;
; -- qfbk mode ; 0 ;
; -- register cascade mode ; 0 ;
; -- synchronous clear/load mode ; 1 ;
; -- asynchronous clear/load mode ; 19 ;
; ; ;
; Total LABs ; 3 / 598 ( < 1 % ) ;
; Logic elements in carry chains ; 16 ;
; User inserted logic elements ; 0 ;
; Virtual pins ; 0 ;
; I/O pins ; 142 / 185 ( 76 % ) ;
; -- Clock pins ; 2 / 2 ( 100 % ) ;
; Global signals ; 1 ;
; M4Ks ; 0 / 20 ( 0 % ) ;
; Total memory bits ; 0 / 92,160 ( 0 % ) ;
; Total RAM block bits ; 0 / 92,160 ( 0 % ) ;
; Global clocks ; 1 / 8 ( 12 % ) ;
; Maximum fan-out node ; CLK_2 ;
; Maximum fan-out ; 20 ;
; Total fan-out ; 134 ;
; Average fan-out ; 0.82 ;
+---------------------------------------------+----------------------+
+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; LogicLock Region Resource Usage ;
+------------------+--------+-------+--------+-------------+--------------+-------------+-------+--------------+--------------+-------------------+------------------+-----------------+
; LogicLock Region ; Origin ; Width ; Height ; Logic Cells ; LC Registers ; Memory Bits ; Pins ; Virtual Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Carry Chain LCs ;
+------------------+--------+-------+--------+-------------+--------------+-------------+-------+--------------+--------------+-------------------+------------------+-----------------+
; MYFX2 ; X2_Y14 ; 2 ; 2 ; 20 (20) ; 20 (20) ; 0 (0) ; 0 (0) ; 0 (0) ; 0 (0) ; 2 (2) ; 18 (18) ; 16 (16) ;
+------------------+--------+-------+--------+-------------+--------------+-------------+-------+--------------+--------------+-------------------+------------------+-----------------+
+---------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Input Pins ;
+---------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; Name ; Pin # ; I/O Bank ; X coordinate ; Y coordinate ; Cell number ; Combinational Fan-Out ; Registered Fan-Out ; Global ; Input Register ; Power Up High ; PCI I/O Enabled ; Bus Hold ; Weak Pull Up ; I/O Standard ; Termination ; Location assigned by ;
+---------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
; CLKOUT ; 29 ; 1 ; 0 ; 11 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; CTL[0] ; 57 ; 1 ; 0 ; 2 ; 1 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; CTL[1] ; 56 ; 1 ; 0 ; 2 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; CTL[2] ; 55 ; 1 ; 0 ; 3 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; CTL[3] ; 59 ; 1 ; 0 ; 1 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; CTL[4] ; 58 ; 1 ; 0 ; 2 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; CTL[5] ; 20 ; 1 ; 0 ; 14 ; 1 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; GPA[0] ; 54 ; 1 ; 0 ; 3 ; 1 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; GPA[1] ; 53 ; 1 ; 0 ; 3 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; GPA[2] ; 50 ; 1 ; 0 ; 4 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; GPA[3] ; 49 ; 1 ; 0 ; 4 ; 1 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; GPA[4] ; 48 ; 1 ; 0 ; 4 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; GPA[5] ; 47 ; 1 ; 0 ; 5 ; 1 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; GPA[6] ; 46 ; 1 ; 0 ; 5 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; GPA[7] ; 45 ; 1 ; 0 ; 6 ; 1 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; GPA[8] ; 5 ; 1 ; 0 ; 19 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; IFCLK ; 14 ; 1 ; 0 ; 16 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; KEY[0] ; 123 ; 3 ; 35 ; 2 ; 2 ; 19 ; 0 ; yes ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; KEY[1] ; 122 ; 3 ; 35 ; 1 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; KEY[2] ; 121 ; 3 ; 35 ; 1 ; 1 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; MMCLK ; 153 ; 3 ; 35 ; 12 ; 1 ; 2 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; USER[0] ; 13 ; 1 ; 0 ; 17 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; USER[1] ; 12 ; 1 ; 0 ; 17 ; 1 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; USER[2] ; 11 ; 1 ; 0 ; 17 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; USER[3] ; 8 ; 1 ; 0 ; 18 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; USER[4] ; 7 ; 1 ; 0 ; 18 ; 1 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; USER[5] ; 6 ; 1 ; 0 ; 18 ; 0 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; nINT5 ; 15 ; 1 ; 0 ; 16 ; 1 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
; nRESET ; 131 ; 3 ; 35 ; 4 ; 2 ; 0 ; 0 ; no ; no ; no ; no ; no ; Off ; LVTTL ; Off ; User ;
+---------+-------+----------+--------------+--------------+-------------+-----------------------+--------------------+--------+----------------+---------------+-----------------+----------+--------------+--------------+-------------+----------------------+
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