rt_window_monitor.vhd

来自「FPGA之间的LVDS传输」· VHDL 代码 · 共 936 行 · 第 1/3 页

VHD
936 行
字号
123
                  STORE_STATUS(0) <= '0';    -- +2                  STORE_STATUS(1) <= '0';    -- +1                  STORE_STATUS(2) <= '0';    -- 0                  STORE_STATUS(3) <= '0';    -- -1                  STORE_STATUS(4) <= '0';    -- -2                  STATUS <= '0';             WHEN COMPARE_MINUS2 =>                  COUNT0 <= '0';                      UD0 <= '0';                      COUNT1 <= '1';                      UD1 <= '1';                      INC_MONITOR  <= '0';                      ICE_MONITOR  <= '0';                      INC_DATABUS  <= '0';                      ICE_DATABUS  <= '0';                      STORE_STATUS(0) <= '0';    -- +2                  STORE_STATUS(1) <= '0';    -- +1                  STORE_STATUS(2) <= '0';    -- 0                  STORE_STATUS(3) <= '0';    -- -1                  STORE_STATUS(4) <= '0';    -- -2                  STATUS <= '0';             WHEN RECORD_0_2 =>                  COUNT0 <= '0';                      UD0 <= '0';                      COUNT1 <= '0';                      UD1 <= '0';                      INC_MONITOR  <= '0';                      ICE_MONITOR  <= '0';                      INC_DATABUS  <= '0';                      ICE_DATABUS  <= '0';                      STORE_STATUS(0) <= '0';    -- +2                  STORE_STATUS(1) <= '0';    -- +1                  STORE_STATUS(2) <= '0';    -- 0                  STORE_STATUS(3) <= '0';    -- -1                  STORE_STATUS(4) <= '1';    -- -2                  STATUS <= '0';    -- ERRORS         WHEN RECORD_1_2 =>                  COUNT0 <= '0';                      UD0 <= '0';                      COUNT1 <= '0';                      UD1 <= '0';                      INC_MONITOR  <= '0';                      ICE_MONITOR  <= '0';                      INC_DATABUS  <= '0';                      ICE_DATABUS  <= '0';                      STORE_STATUS(0) <= '0';    -- +2                  STORE_STATUS(1) <= '0';    -- +1                  STORE_STATUS(2) <= '0'; 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                     INC_DATABUS  <= '0';                      ICE_DATABUS  <= '0';                      STORE_STATUS(0) <= '0';    -- +2                  STORE_STATUS(1) <= '0';    -- +1                  STORE_STATUS(2) <= '0';    -- 0                  STORE_STATUS(3) <= '0';    -- -1                  STORE_STATUS(4) <= '0';    -- -2                  STATUS <= '0';             WHEN COMPARE_PLUS1 =>                  COUNT0 <= '0';                      UD0 <= '0';                      COUNT1 <= '1';                      UD1 <= '1';                      INC_MONITOR  <= '0';                      ICE_MONITOR  <= '0';                      INC_DATABUS  <= '0';                      ICE_DATABUS  <= '0';                      STORE_STATUS(0) <= '0';    -- +2                  STORE_STATUS(1) <= '0';    -- +1                  STORE_STATUS(2) <= '0';    -- 0                  STORE_STATUS(3) <= '0';    -- -1                  STORE_STATUS(4) <= '0';    -- -2                  STATUS <= '0';             WHEN RECORD_0_3 =>                  COUNT0 <= '0'; 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   -- 0                  STORE_STATUS(3) <= '0';    -- -1                  STORE_STATUS(4) <= '0';    -- -2                  STATUS <= '1';    -- ERROR FREE         WHEN INC_1 =>                  COUNT0 <= '0';                      UD0 <= '0';                      COUNT1 <= '0';                      UD1 <= '0';                      INC_MONITOR  <= '1';                      ICE_MONITOR  <= '1';                      INC_DATABUS  <= '0';                      ICE_DATABUS  <= '0';                      STORE_STATUS(0) <= '0';    -- +2                  STORE_STATUS(1) <= '0';    -- +1                  STORE_STATUS(2) <= '0';    -- 0                  STORE_STATUS(3) <= '0';    -- -1                  STORE_STATUS(4) <= '0';    -- -2                  STATUS <= '0';             WHEN WAIT7_3 =>                  COUNT0 <= '1';                      UD0 <= '1';                      COUNT1 <= '0';                      UD1 <= '0';                      INC_MONITOR  <= '0';                      ICE_MONITOR  <= '0';                      INC_DATABUS  <= '0';                      ICE_DATABUS  <= '0';                      STORE_STATUS(0) <= '0';    -- +2                  STORE_STATUS(1) <= '0';    -- +1                  STORE_STATUS(2) <= '0';    -- 0                  STORE_STATUS(3) <= '0';    -- -1                  STORE_STATUS(4) <= '0';    -- -2                  STATUS <= '0';             WHEN COMPARE_PLUS2 =>                  COUNT0 <= '0';                      UD0 <= '0';                      COUNT1 <= '1';                      UD1 <= '1';                      INC_MONITOR  <= '0';                      ICE_MONITOR  <= '0';                      INC_DATABUS  <= '0';                      ICE_DATABUS  <= '0';                      STORE_STATUS(0) <= '0';    -- +2                  STORE_STATUS(1) <= '0';    -- +1                  STORE_STATUS(2) <= '0';    -- 0                  STORE_STATUS(3) <= '0';    -- -1                  STORE_STATUS(4) <= '0';    -- -2                  STATUS <= '0';             WHEN RECORD_0_4 =>                  COUNT0 <= '0'; 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                     ICE_DATABUS  <= '0';                      STORE_STATUS(0) <= '0';    -- +2                  STORE_STATUS(1) <= '0';    -- +1                  STORE_STATUS(2) <= '0';    -- 0                  STORE_STATUS(3) <= '0';    -- -1                  STORE_STATUS(4) <= '0';    -- -2                  STATUS <= '0';                   END CASE;   END PROCESS;END translated;
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rt_window_monitor.vhd - 源码说明

本页面展示了「FPGA之间的LVDS传输」中的 rt_window_monitor.vhd 源码文件，采用 VHDL 编程语言编写，共 936 行代码。您可以在线阅读完整代码内容，也可以返回资源详情页下载完整源码包进行本地学习和开发。

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