📄 frequency.map.rpt
字号:
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|-- altrom:srom
|-- altsyncram:rom_block
|-- altsyncram_rfm:auto_generated
|-- lpm_add_sub:inst100
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|-- lpm_ff:inst102
|-- lpm_ff:inst103
+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Analysis & Synthesis Resource Utilization by Entity ;
+---------------------------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+--------------------------------------------------------------------------------------------------------------------------------+
; Compilation Hierarchy Node ; Logic Cells ; LC Registers ; Memory Bits ; Pins ; Virtual Pins ; LUT-Only LCs ; Register-Only LCs ; LUT/Register LCs ; Carry Chain LCs ; Full Hierarchy Name ;
+---------------------------------------------+-------------+--------------+-------------+------+--------------+--------------+-------------------+------------------+-----------------+--------------------------------------------------------------------------------------------------------------------------------+
; |Frequency ; 1507 (1) ; 128 ; 40960 ; 170 ; 0 ; 1379 (1) ; 88 (0) ; 40 (0) ; 776 (0) ; |Frequency ;
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; |INTIGRATOR_FE:inst| ; 107 (99) ; 72 ; 0 ; 0 ; 0 ; 35 (35) ; 32 (32) ; 40 (32) ; 40 (32) ; |Frequency|INTIGRATOR_FE:inst ;
; |lpm_counter:CYCLE_rtl_0| ; 8 (0) ; 8 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 8 (0) ; 8 (0) ; |Frequency|INTIGRATOR_FE:inst|lpm_counter:CYCLE_rtl_0 ;
; |cntr_ia7:auto_generated| ; 8 (8) ; 8 ; 0 ; 0 ; 0 ; 0 (0) ; 0 (0) ; 8 (8) ; 8 (8) ; |Frequency|INTIGRATOR_FE:inst|lpm_counter:CYCLE_rtl_0|cntr_ia7:auto_generated ;
; |lpm_abs:inst15| ; 16 (16) ; 0 ; 0 ; 0 ; 0 ; 16 (16) ; 0 (0) ; 0 (0) ; 16 (16) ; |Frequency|lpm_abs:inst15 ;
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; |addcore:adder| ; 16 (0) ; 0 ; 0 ; 0 ; 0 ; 16 (0) ; 0 (0) ; 0 (0) ; 16 (0) ; |Frequency|lpm_add_sub:inst100|addcore:adder ;
; |a_csnbuffer:result_node| ; 16 (16) ; 0 ; 0 ; 0 ; 0 ; 16 (16) ; 0 (0) ; 0 (0) ; 16 (16) ; |Frequency|lpm_add_sub:inst100|addcore:adder|a_csnbuffer:result_node ;
; |lpm_add_sub:inst101| ; 16 (0) ; 0 ; 0 ; 0 ; 0 ; 16 (0) ; 0 (0) ; 0 (0) ; 16 (0) ; |Frequency|lpm_add_sub:inst101 ;
; |addcore:adder| ; 16 (0) ; 0 ; 0 ; 0 ; 0 ; 16 (0) ; 0 (0) ; 0 (0) ; 16 (0) ; |Frequency|lpm_add_sub:inst101|addcore:adder ;
; |a_csnbuffer:result_node| ; 16 (16) ; 0 ; 0 ; 0 ; 0 ; 16 (16) ; 0 (0) ; 0 (0) ; 16 (16) ; |Frequency|lpm_add_sub:inst101|addcore:adder|a_csnbuffer:result_node ;
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; |addcore:adder| ; 16 (0) ; 0 ; 0 ; 0 ; 0 ; 16 (0) ; 0 (0) ; 0 (0) ; 9 (0) ; |Frequency|lpm_add_sub:inst25|addcore:adder ;
; |a_csnbuffer:result_node| ; 16 (16) ; 0 ; 0 ; 0 ; 0 ; 16 (16) ; 0 (0) ; 0 (0) ; 9 (9) ; |Frequency|lpm_add_sub:inst25|addcore:adder|a_csnbuffer:result_node ;
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; |addcore:adder| ; 11 (0) ; 0 ; 0 ; 0 ; 0 ; 11 (0) ; 0 (0) ; 0 (0) ; 11 (0) ; |Frequency|lpm_add_sub:inst57|addcore:adder ;
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; |addcore:adder| ; 9 (0) ; 0 ; 0 ; 0 ; 0 ; 9 (0) ; 0 (0) ; 0 (0) ; 9 (0) ; |Frequency|lpm_add_sub:inst94|addcore:adder ;
; |a_csnbuffer:result_node| ; 9 (9) ; 0 ; 0 ; 0 ; 0 ; 9 (9) ; 0 (0) ; 0 (0) ; 9 (9) ; |Frequency|lpm_add_sub:inst94|addcore:adder|a_csnbuffer:result_node ;
; |lpm_divide:inst1| ; 576 (0) ; 0 ; 0 ; 0 ; 0 ; 576 (0) ; 0 (0) ; 0 (0) ; 305 (0) ; |Frequency|lpm_divide:inst1 ;
; |sign_div_unsign:divider| ; 576 (0) ; 0 ; 0 ; 0 ; 0 ; 576 (0) ; 0 (0) ; 0 (0) ; 305 (0) ; |Frequency|lpm_divide:inst1|sign_div_unsign:divider ;
; |alt_u_div:divider| ; 576 (268) ; 0 ; 0 ; 0 ; 0 ; 576 (268) ; 0 (0) ; 0 (0) ; 305 (0) ; |Frequency|lpm_divide:inst1|sign_div_unsign:divider|alt_u_div:divider ;
; |lpm_add_sub:$00007| ; 4 (0) ; 0 ; 0 ; 0 ; 0 ; 4 (0) ; 0 (0) ; 0 (0) ; 4 (0) ; |Frequency|lpm_divide:inst1|sign_div_unsign:divider|alt_u_div:divider|lpm_add_sub:$00007 ;
; |addcore:adder| ; 4 (0) ; 0 ; 0 ; 0 ; 0 ; 4 (0) ; 0 (0) ; 0 (0) ; 4 (0) ; |Frequency|lpm_divide:inst1|sign_div_unsign:divider|alt_u_div:divider|lpm_add_sub:$00007|addcore:adder ;
; |a_csnbuffer:result_node| ; 4 (4) ; 0 ; 0 ; 0 ; 0 ; 4 (4) ; 0 (0) ; 0 (0) ; 4 (4) ; |Frequency|lpm_divide:inst1|sign_div_unsign:divider|alt_u_div:divider|lpm_add_sub:$00007|addcore:adder|a_csnbuffer:result_node ;
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; |addcore:adder| ; 5 (0) ; 0 ; 0 ; 0 ; 0 ; 5 (0) ; 0 (0) ; 0 (0) ; 5 (0) ; |Frequency|lpm_divide:inst1|sign_div_unsign:divider|alt_u_div:divider|lpm_add_sub:$00009|addcore:adder ;
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