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Timing Analyzer report for ACS_0
Mon Oct 02 14:35:53 2006
Version 6.0 Build 178 04/27/2006 SJ Full Version
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; Table of Contents ;
---------------------
1. Legal Notice
2. Timing Analyzer Summary
3. Timing Analyzer Settings
4. Clock Settings Summary
5. tsu
6. tco
7. th
8. Timing Analyzer Messages
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; Legal Notice ;
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and other software and tools, and its AMPP partner logic
functions, and any output files any of the foregoing
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+-----------------------------------------------------------------------------------------------------------------------------------------+
; Timing Analyzer Summary ;
+------------------------------+-------+---------------+-------------+--------------+--------------+------------+----------+--------------+
; Type ; Slack ; Required Time ; Actual Time ; From ; To ; From Clock ; To Clock ; Failed Paths ;
+------------------------------+-------+---------------+-------------+--------------+--------------+------------+----------+--------------+
; Worst-case tsu ; N/A ; None ; 7.362 ns ; rc[1] ; om_0[5]~reg0 ; -- ; clk ; 0 ;
; Worst-case tco ; N/A ; None ; 6.915 ns ; om_0[2]~reg0 ; om_0[2] ; clk ; -- ; 0 ;
; Worst-case th ; N/A ; None ; -2.194 ns ; reset ; acs_0~reg0 ; -- ; clk ; 0 ;
; Total number of failed paths ; ; ; ; ; ; ; ; 0 ;
+------------------------------+-------+---------------+-------------+--------------+--------------+------------+----------+--------------+
+------------------------------------------------------------------------------------------------------+
; Timing Analyzer Settings ;
+-------------------------------------------------------+--------------------+------+----+-------------+
; Option ; Setting ; From ; To ; Entity Name ;
+-------------------------------------------------------+--------------------+------+----+-------------+
; Device Name ; EP1S10F484C5 ; ; ; ;
; Timing Models ; Final ; ; ; ;
; Number of source nodes to report per destination node ; 10 ; ; ; ;
; Number of destination nodes to report ; 10 ; ; ; ;
; Number of paths to report ; 200 ; ; ; ;
; Report Minimum Timing Checks ; Off ; ; ; ;
; Use Fast Timing Models ; Off ; ; ; ;
; Report IO Paths Separately ; Off ; ; ; ;
; Default hold multicycle ; Same As Multicycle ; ; ; ;
; Cut paths between unrelated clock domains ; On ; ; ; ;
; Cut off read during write signal paths ; On ; ; ; ;
; Cut off feedback from I/O pins ; On ; ; ; ;
; Report Combined Fast/Slow Timing ; Off ; ; ; ;
; Ignore Clock Settings ; Off ; ; ; ;
; Analyze latches as synchronous elements ; On ; ; ; ;
; Enable Recovery/Removal analysis ; Off ; ; ; ;
; Enable Clock Latency ; Off ; ; ; ;
; Use TimeQuest Timing Analyzer ; Off ; ; ; ;
+-------------------------------------------------------+--------------------+------+----+-------------+
+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clock Settings Summary ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
; Clock Node Name ; Clock Setting Name ; Type ; Fmax Requirement ; Early Latency ; Late Latency ; Based on ; Multiply Base Fmax by ; Divide Base Fmax by ; Offset ; Phase offset ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
; clk ; ; User Pin ; None ; 0.000 ns ; 0.000 ns ; -- ; N/A ; N/A ; N/A ; ;
+-----------------+--------------------+----------+------------------+---------------+--------------+----------+-----------------------+---------------------+--------+--------------+
+-----------------------------------------------------------------------+
; tsu ;
+-------+--------------+------------+---------+--------------+----------+
; Slack ; Required tsu ; Actual tsu ; From ; To ; To Clock ;
+-------+--------------+------------+---------+--------------+----------+
; N/A ; None ; 7.362 ns ; rc[1] ; om_0[0]~reg0 ; clk ;
; N/A ; None ; 7.362 ns ; rc[1] ; om_0[1]~reg0 ; clk ;
; N/A ; None ; 7.362 ns ; rc[1] ; om_0[2]~reg0 ; clk ;
; N/A ; None ; 7.362 ns ; rc[1] ; om_0[3]~reg0 ; clk ;
; N/A ; None ; 7.362 ns ; rc[1] ; om_0[4]~reg0 ; clk ;
; N/A ; None ; 7.362 ns ; rc[1] ; om_0[5]~reg0 ; clk ;
; N/A ; None ; 7.178 ns ; rc[0] ; om_0[0]~reg0 ; clk ;
; N/A ; None ; 7.178 ns ; rc[0] ; om_0[1]~reg0 ; clk ;
; N/A ; None ; 7.178 ns ; rc[0] ; om_0[2]~reg0 ; clk ;
; N/A ; None ; 7.178 ns ; rc[0] ; om_0[3]~reg0 ; clk ;
; N/A ; None ; 7.178 ns ; rc[0] ; om_0[4]~reg0 ; clk ;
; N/A ; None ; 7.178 ns ; rc[0] ; om_0[5]~reg0 ; clk ;
; N/A ; None ; 6.523 ns ; rc[1] ; acs_0~reg0 ; clk ;
; N/A ; None ; 6.376 ns ; im_0[0] ; om_0[0]~reg0 ; clk ;
; N/A ; None ; 6.376 ns ; im_0[0] ; om_0[1]~reg0 ; clk ;
; N/A ; None ; 6.376 ns ; im_0[0] ; om_0[2]~reg0 ; clk ;
; N/A ; None ; 6.376 ns ; im_0[0] ; om_0[3]~reg0 ; clk ;
; N/A ; None ; 6.376 ns ; im_0[0] ; om_0[4]~reg0 ; clk ;
; N/A ; None ; 6.376 ns ; im_0[0] ; om_0[5]~reg0 ; clk ;
; N/A ; None ; 6.339 ns ; rc[0] ; acs_0~reg0 ; clk ;
; N/A ; None ; 6.272 ns ; im_0[2] ; om_0[0]~reg0 ; clk ;
; N/A ; None ; 6.272 ns ; im_0[2] ; om_0[1]~reg0 ; clk ;
; N/A ; None ; 6.272 ns ; im_0[2] ; om_0[2]~reg0 ; clk ;
; N/A ; None ; 6.272 ns ; im_0[2] ; om_0[3]~reg0 ; clk ;
; N/A ; None ; 6.272 ns ; im_0[2] ; om_0[4]~reg0 ; clk ;
; N/A ; None ; 6.272 ns ; im_0[2] ; om_0[5]~reg0 ; clk ;
; N/A ; None ; 6.171 ns ; im_0[1] ; om_0[0]~reg0 ; clk ;
; N/A ; None ; 6.171 ns ; im_0[1] ; om_0[1]~reg0 ; clk ;
; N/A ; None ; 6.171 ns ; im_0[1] ; om_0[2]~reg0 ; clk ;
; N/A ; None ; 6.171 ns ; im_0[1] ; om_0[3]~reg0 ; clk ;
; N/A ; None ; 6.171 ns ; im_0[1] ; om_0[4]~reg0 ; clk ;
; N/A ; None ; 6.171 ns ; im_0[1] ; om_0[5]~reg0 ; clk ;
; N/A ; None ; 6.131 ns ; im_2[1] ; om_0[0]~reg0 ; clk ;
; N/A ; None ; 6.131 ns ; im_2[1] ; om_0[1]~reg0 ; clk ;
; N/A ; None ; 6.131 ns ; im_2[1] ; om_0[2]~reg0 ; clk ;
; N/A ; None ; 6.131 ns ; im_2[1] ; om_0[3]~reg0 ; clk ;
; N/A ; None ; 6.131 ns ; im_2[1] ; om_0[4]~reg0 ; clk ;
; N/A ; None ; 6.131 ns ; im_2[1] ; om_0[5]~reg0 ; clk ;
; N/A ; None ; 6.044 ns ; im_2[0] ; om_0[0]~reg0 ; clk ;
; N/A ; None ; 6.044 ns ; im_2[0] ; om_0[1]~reg0 ; clk ;
; N/A ; None ; 6.044 ns ; im_2[0] ; om_0[2]~reg0 ; clk ;
; N/A ; None ; 6.044 ns ; im_2[0] ; om_0[3]~reg0 ; clk ;
; N/A ; None ; 6.044 ns ; im_2[0] ; om_0[4]~reg0 ; clk ;
; N/A ; None ; 6.044 ns ; im_2[0] ; om_0[5]~reg0 ; clk ;
; N/A ; None ; 5.930 ns ; im_2[3] ; om_0[0]~reg0 ; clk ;
; N/A ; None ; 5.930 ns ; im_2[3] ; om_0[1]~reg0 ; clk ;
; N/A ; None ; 5.930 ns ; im_2[3] ; om_0[2]~reg0 ; clk ;
; N/A ; None ; 5.930 ns ; im_2[3] ; om_0[3]~reg0 ; clk ;
; N/A ; None ; 5.930 ns ; im_2[3] ; om_0[4]~reg0 ; clk ;
; N/A ; None ; 5.930 ns ; im_2[3] ; om_0[5]~reg0 ; clk ;
; N/A ; None ; 5.738 ns ; im_0[3] ; om_0[0]~reg0 ; clk ;
; N/A ; None ; 5.738 ns ; im_0[3] ; om_0[1]~reg0 ; clk ;
; N/A ; None ; 5.738 ns ; im_0[3] ; om_0[2]~reg0 ; clk ;
; N/A ; None ; 5.738 ns ; im_0[3] ; om_0[3]~reg0 ; clk ;
; N/A ; None ; 5.738 ns ; im_0[3] ; om_0[4]~reg0 ; clk ;
; N/A ; None ; 5.738 ns ; im_0[3] ; om_0[5]~reg0 ; clk ;
; N/A ; None ; 5.738 ns ; im_2[2] ; om_0[0]~reg0 ; clk ;
; N/A ; None ; 5.738 ns ; im_2[2] ; om_0[1]~reg0 ; clk ;
; N/A ; None ; 5.738 ns ; im_2[2] ; om_0[2]~reg0 ; clk ;
; N/A ; None ; 5.738 ns ; im_2[2] ; om_0[3]~reg0 ; clk ;
; N/A ; None ; 5.738 ns ; im_2[2] ; om_0[4]~reg0 ; clk ;
; N/A ; None ; 5.738 ns ; im_2[2] ; om_0[5]~reg0 ; clk ;
; N/A ; None ; 5.656 ns ; im_2[4] ; om_0[0]~reg0 ; clk ;
; N/A ; None ; 5.656 ns ; im_2[4] ; om_0[1]~reg0 ; clk ;
; N/A ; None ; 5.656 ns ; im_2[4] ; om_0[2]~reg0 ; clk ;
; N/A ; None ; 5.656 ns ; im_2[4] ; om_0[3]~reg0 ; clk ;
; N/A ; None ; 5.656 ns ; im_2[4] ; om_0[4]~reg0 ; clk ;
; N/A ; None ; 5.656 ns ; im_2[4] ; om_0[5]~reg0 ; clk ;
; N/A ; None ; 5.537 ns ; im_0[0] ; acs_0~reg0 ; clk ;
; N/A ; None ; 5.433 ns ; im_0[2] ; acs_0~reg0 ; clk ;
; N/A ; None ; 5.381 ns ; im_0[4] ; om_0[0]~reg0 ; clk ;
; N/A ; None ; 5.381 ns ; im_0[4] ; om_0[1]~reg0 ; clk ;
; N/A ; None ; 5.381 ns ; im_0[4] ; om_0[2]~reg0 ; clk ;
; N/A ; None ; 5.381 ns ; im_0[4] ; om_0[3]~reg0 ; clk ;
; N/A ; None ; 5.381 ns ; im_0[4] ; om_0[4]~reg0 ; clk ;
; N/A ; None ; 5.381 ns ; im_0[4] ; om_0[5]~reg0 ; clk ;
; N/A ; None ; 5.332 ns ; im_0[1] ; acs_0~reg0 ; clk ;
; N/A ; None ; 5.292 ns ; im_2[1] ; acs_0~reg0 ; clk ;
; N/A ; None ; 5.205 ns ; im_2[0] ; acs_0~reg0 ; clk ;
; N/A ; None ; 5.091 ns ; im_2[3] ; acs_0~reg0 ; clk ;
; N/A ; None ; 4.925 ns ; im_2[5] ; om_0[0]~reg0 ; clk ;
; N/A ; None ; 4.925 ns ; im_2[5] ; om_0[1]~reg0 ; clk ;
; N/A ; None ; 4.925 ns ; im_2[5] ; om_0[2]~reg0 ; clk ;
; N/A ; None ; 4.925 ns ; im_2[5] ; om_0[3]~reg0 ; clk ;
; N/A ; None ; 4.925 ns ; im_2[5] ; om_0[4]~reg0 ; clk ;
; N/A ; None ; 4.925 ns ; im_2[5] ; om_0[5]~reg0 ; clk ;
; N/A ; None ; 4.899 ns ; im_0[3] ; acs_0~reg0 ; clk ;
; N/A ; None ; 4.899 ns ; im_2[2] ; acs_0~reg0 ; clk ;
; N/A ; None ; 4.817 ns ; im_2[4] ; acs_0~reg0 ; clk ;
; N/A ; None ; 4.767 ns ; im_0[5] ; om_0[0]~reg0 ; clk ;
; N/A ; None ; 4.767 ns ; im_0[5] ; om_0[1]~reg0 ; clk ;
; N/A ; None ; 4.767 ns ; im_0[5] ; om_0[2]~reg0 ; clk ;
; N/A ; None ; 4.767 ns ; im_0[5] ; om_0[3]~reg0 ; clk ;
; N/A ; None ; 4.767 ns ; im_0[5] ; om_0[4]~reg0 ; clk ;
; N/A ; None ; 4.767 ns ; im_0[5] ; om_0[5]~reg0 ; clk ;
; N/A ; None ; 4.542 ns ; im_0[4] ; acs_0~reg0 ; clk ;
; N/A ; None ; 4.086 ns ; im_2[5] ; acs_0~reg0 ; clk ;
; N/A ; None ; 3.928 ns ; im_0[5] ; acs_0~reg0 ; clk ;
; N/A ; None ; 2.747 ns ; reset ; om_0[0]~reg0 ; clk ;
; N/A ; None ; 2.747 ns ; reset ; om_0[1]~reg0 ; clk ;
; N/A ; None ; 2.747 ns ; reset ; om_0[2]~reg0 ; clk ;
; N/A ; None ; 2.747 ns ; reset ; om_0[3]~reg0 ; clk ;
; N/A ; None ; 2.747 ns ; reset ; om_0[4]~reg0 ; clk ;
; N/A ; None ; 2.747 ns ; reset ; om_0[5]~reg0 ; clk ;
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