📄 odd_fren.fit.rpt
字号:
; 55 ; 54 ; -- ; RESERVED ; ; ; ; ;
; 56 ; 55 ; -- ; RESERVED ; ; ; ; ;
; 57 ; 56 ; -- ; RESERVED ; ; ; ; ;
; 58 ; 57 ; -- ; RESERVED ; ; ; ; ;
; 59 ; 58 ; -- ; GND ; gnd ; ; ; ;
; 60 ; 59 ; -- ; RESERVED ; ; ; ; ;
; 61 ; 60 ; -- ; RESERVED ; ; ; ; ;
; 62 ; 61 ; -- ; +TCK ; input ; TTL ; ; N ;
; 63 ; 62 ; -- ; RESERVED ; ; ; ; ;
; 64 ; 63 ; -- ; RESERVED ; ; ; ; ;
; 65 ; 64 ; -- ; RESERVED ; ; ; ; ;
; 66 ; 65 ; -- ; VCCIO ; power ; ; 5.0V ; ;
; 67 ; 66 ; -- ; RESERVED ; ; ; ; ;
; 68 ; 67 ; -- ; RESERVED ; ; ; ; ;
; 69 ; 68 ; -- ; RESERVED ; ; ; ; ;
; 70 ; 69 ; -- ; RESERVED ; ; ; ; ;
; 71 ; 70 ; -- ; *TDO ; output ; TTL ; ; N ;
; 72 ; 71 ; -- ; GND ; gnd ; ; ; ;
; 73 ; 72 ; -- ; RESERVED ; ; ; ; ;
; 74 ; 73 ; -- ; RESERVED ; ; ; ; ;
; 75 ; 74 ; -- ; RESERVED ; ; ; ; ;
; 76 ; 75 ; -- ; RESERVED ; ; ; ; ;
; 77 ; 76 ; -- ; RESERVED ; ; ; ; ;
; 78 ; 77 ; -- ; VCCIO ; power ; ; 5.0V ; ;
; 79 ; 78 ; -- ; RESERVED ; ; ; ; ;
; 80 ; 79 ; -- ; RESERVED ; ; ; ; ;
; 81 ; 80 ; -- ; RESERVED ; ; ; ; ;
; 82 ; 81 ; -- ; GND ; gnd ; ; ; ;
; 83 ; 82 ; -- ; Clk ; input ; TTL ; ; N ;
; 84 ; 83 ; -- ; GND+ ; ; ; ; ;
+----------+------------+----------+----------------+--------+--------------+---------+-----------------+
+--------------------------------------------------------------------------------------------------+
; I/O Standard ;
+--------------+------------+----------------------+-------------------+-------------------+-------+
; I/O Standard ; Input Vref ; Dedicated Input Pins ; Pins in I/O Bank1 ; Pins in I/O Bank2 ; Total ;
+--------------+------------+----------------------+-------------------+-------------------+-------+
; TTL ; - ; 1 ; 0 ; 0 ; 1 ;
+--------------+------------+----------------------+-------------------+-------------------+-------+
+--------------------------------------------------------------------+
; Dedicated Inputs I/O ;
+------+-------+-------+-------+--------------+------------+---------+
; Name ; Pin # ; Type ; VCCIO ; I/O Standard ; Input Vref ; Current ;
+------+-------+-------+-------+--------------+------------+---------+
; Clk ; 83 ; Input ; -- ; TTL ; - ; 0 mA ;
+------+-------+-------+-------+--------------+------------+---------+
+-----------------------------------------------+
; Output Pin Default Load For Reported TCO ;
+--------------+-------+------------------------+
; I/O Standard ; Load ; Termination Resistance ;
+--------------+-------+------------------------+
; LVTTL ; 10 pF ; Not Available ;
; LVCMOS ; 10 pF ; Not Available ;
; TTL ; 10 pF ; Not Available ;
+--------------+-------+------------------------+
Note: User assignments will override these defaults. The user specified values are listed in the Output Pins and Bidir Pins tables.
+----------------------------------------------------------------------+
; Fitter Resource Utilization by Entity ;
+----------------------------+------------+------+---------------------+
; Compilation Hierarchy Node ; Macrocells ; Pins ; Full Hierarchy Name ;
+----------------------------+------------+------+---------------------+
; |Odd_Fren ; 6 ; 6 ; |Odd_Fren ;
+----------------------------+------------+------+---------------------+
+---------------------------------------------------------------------------------------+
; Control Signals ;
+-------+----------+---------+-------+--------+----------------------+------------------+
; Name ; Location ; Fan-Out ; Usage ; Global ; Global Resource Used ; Global Line Name ;
+-------+----------+---------+-------+--------+----------------------+------------------+
; Clk ; PIN_83 ; 5 ; Clock ; yes ; On ; -- ;
; O_x~0 ; SEXP1 ; 1 ; Clock ; no ; -- ; -- ;
; O_x~1 ; SEXP2 ; 1 ; Clock ; no ; -- ; -- ;
+-------+----------+---------+-------+--------+----------------------+------------------+
+---------------------------------------------------------------------+
; Global & Other Fast Signals ;
+------+----------+---------+----------------------+------------------+
; Name ; Location ; Fan-Out ; Global Resource Used ; Global Line Name ;
+------+----------+---------+----------------------+------------------+
; Clk ; PIN_83 ; 5 ; On ; -- ;
+------+----------+---------+----------------------+------------------+
+---------------------------------+
; Non-Global High Fan-Out Signals ;
+--------+------------------------+
; Name ; Fan-Out ;
+--------+------------------------+
; O_ro ; 4 ;
; O_d[1] ; 3 ;
; O_d[0] ; 3 ;
; O_do ; 2 ;
; O_r[0] ; 2 ;
; O_x~1 ; 1 ;
; O_x~0 ; 1 ;
; O~reg0 ; 1 ;
+--------+------------------------+
+----------------------------------------------+
; Interconnect Usage Summary ;
+----------------------------+-----------------+
; Interconnect Resource Type ; Usage ;
+----------------------------+-----------------+
; Output enables ; 0 / 6 ( 0 % ) ;
; PIA buffers ; 5 / 144 ( 3 % ) ;
+----------------------------+-----------------+
+----------------------------------------------------------------------+
; LAB Macrocells ;
+----------------------------------------+-----------------------------+
; Number of Macrocells (Average = 1.50) ; Number of LABs (Total = 1) ;
+----------------------------------------+-----------------------------+
; 0 ; 3 ;
; 1 ; 0 ;
; 2 ; 0 ;
; 3 ; 0 ;
; 4 ; 0 ;
; 5 ; 0 ;
; 6 ; 1 ;
+----------------------------------------+-----------------------------+
+-------------------------------------------------------------------------------+
; Shareable Expander ;
+-------------------------------------------------+-----------------------------+
; Number of shareable expanders (Average = 0.50) ; Number of LABs (Total = 1) ;
+-------------------------------------------------+-----------------------------+
; 0 ; 3 ;
; 1 ; 0 ;
; 2 ; 1 ;
+-------------------------------------------------+-----------------------------+
+---------------------------------------------------------------------+
; Logic Cell Interconnection ;
+-----+------------+---------------------+----------------------------+
; LAB ; Logic Cell ; Input ; Output ;
+-----+------------+---------------------+----------------------------+
; A ; LC2 ; Clk, O_d[1], O_d[0] ; O_d[0], O_d[1], O_do ;
; A ; LC3 ; Clk, O_ro, O_r[0] ; O_r[0], O_ro ;
; A ; LC4 ; Clk, O_d[1], O_d[0] ; O_d[0], O_d[1], O_do ;
; A ; LC5 ; Clk, O_ro, O_r[0] ; O_r[0], O_ro, O_x~0, O_x~1 ;
; A ; LC6 ; Clk, O_d[1], O_d[0] ; O_x~0, O_x~1 ;
; A ; LC1 ; O_x~0, O_x~1 ; O ;
+-----+------------+---------------------+----------------------------+
+----------------------------------------------------------------------------------------+
; Fitter Device Options ;
+----------------------------------------------+-----------------------------------------+
; Option ; Setting ;
+----------------------------------------------+-----------------------------------------+
; Enable user-supplied start-up clock (CLKUSR) ; Off ;
; Enable device-wide reset (DEV_CLRn) ; Off ;
; Enable device-wide output enable (DEV_OE) ; Off ;
; Enable INIT_DONE output ; Off ;
; Configuration scheme ; Passive Serial ;
; Reserve all unused pins ; As output driving an unspecified signal ;
; Security bit ; Off ;
; Base pin-out file on sameframe device ; Off ;
+----------------------------------------------+-----------------------------------------+
+-----------------+
; Fitter Messages ;
+-----------------+
Info: *******************************************************************
Info: Running Quartus II Fitter
Info: Version 6.0 Build 178 04/27/2006 SJ Full Version
Info: Processing started: Wed Oct 01 09:38:49 2008
Info: Command: quartus_fit --read_settings_files=off --write_settings_files=off Odd_Fren -c Odd_Fren
Info: Selected device EPM7064SLC84-10 for design "Odd_Fren"
Info: Quartus II Fitter was successful. 0 errors, 0 warnings
Info: Processing ended: Wed Oct 01 09:38:50 2008
Info: Elapsed time: 00:00:01
⌨️ 快捷键说明
复制代码
Ctrl + C
搜索代码
Ctrl + F
全屏模式
F11
切换主题
Ctrl + Shift + D
显示快捷键
?
增大字号
Ctrl + =
减小字号
Ctrl + -