jishuqi.hier_info

来自「一些很好的FPGA设计实例」· HIER_INFO 代码 · 共 10 行

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|jishuqi
rst => pr_state~1.IN1
clk => pr_state~0.IN1
count[0] <= reduce_or~2.DB_MAX_OUTPUT_PORT_TYPE
count[1] <= reduce_or~1.DB_MAX_OUTPUT_PORT_TYPE
count[2] <= reduce_or~0.DB_MAX_OUTPUT_PORT_TYPE
count[3] <= count~0.DB_MAX_OUTPUT_PORT_TYPE


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