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📄 ——一种多接口模式、超高速ad转换芯片Aad9430.htm

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          <TD align=middle height=15>文章作者:高丽红 王正垠 <BR>文章类型:设计应用 
            文章加入时间:2003年12月24日17:54</TD></TR>
        <TR>
          <TD align=right><FONT color=#cc0000>文章出处:国外电子元器件</FONT> </TD></TR>
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            <DIV id=Content><FONT face=宋体>&nbsp;&nbsp; 
            <B>摘要:</B></FONT>AD9430是AD公司推出的12位模数转换器,它采用3.3V单电源,可提供CMOS和LVDS两种接口模式。文章介绍了AD9430的主要性能,给出了其LVDS和 
            CMOS两种输出模式的应用电路。 
            <P class=MsoNormal><SPAN 
            style="FONT-FAMILY: 宋体; mso-ascii-font-family: 'Times New Roman'; mso-hansi-font-family: 'Times New Roman'">&nbsp;&nbsp;&nbsp; 
            <B>关键词:AD</B></SPAN>转换器;双数据口输出; LVDS AD9430</P>
            <P style="TEXT-INDENT: 0px"><B>1 概述</B></P>
            <P 
            style="TEXT-INDENT: 30px">AD9430是AD公司推出的一种12位高速、低功耗A/D转换器。它采用3.3V单电源供电,因而简化了系统电源设计。AD9430片内自带的参考电压源和采样保持器使其在系统设计中更易于使用。<BR><IMG 
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            width=482 vspace=10 border=0><BR><FONT size=3>&nbsp;&nbsp;&nbsp; 
            </FONT><SPAN class=main1>该器件提供有两种数据输出接口模式,即双端口3.3V 
            CMOS输出和LVDS输出。在CMOS模式下,每个通道的数据通过率为105 
            MSPS,且有交替数据输出和并行数据输出两种方式;在LVDS模式下,数据通过率为210 
            MSPS,可与带有LVDS接收器的FP-GA芯片进行直接接口。输出数据编码格式有二进制补码和偏移二进制码两种格式可供选择。其中的LVDS接口(即低压差分信号Low 
            Voltage Differential 
            Signaling)是一种低摆幅的电流型差分信号,它可使信号在差分PCB线对或平衡电缆上以几百Mbps的速率传输,而其低压幅和低电流驱动输出则可实现低噪声和低功耗。AD9430的主要特性如下:</P>
            <P style="TEXT-INDENT: 30px">●采用3.3V单电源供电;</P>
            <P 
            style="TEXT-INDENT: 30px">●模拟输入频率为65MHz、采样率为210MSPS时,信噪比高达65dB;</P>
            <P style="TEXT-INDENT: 30px">●采样率为210MSPS时,功耗仅1.3W;</P>
            <P style="TEXT-INDENT: 30px">●可提供数据同步输入和数据时钟输出;</P>
            <P style="TEXT-INDENT: 30px">●自带时钟占空比稳定器;</P>
            <P style="TEXT-INDENT: 30px">●具有极好的线性特性: DNL=±0.3LSB</P>
            <P style="TEXT-INDENT: 30px">INL=±0.5LSB<BR><IMG height=573 
            hspace=10 src="——一种多接口模式、超高速AD转换芯片AAD9430.files/20b.gif" width=549 
            vspace=10 border=0><BR><B>2 内部结构与管脚说明</B></P>
            <P 
            style="TEXT-INDENT: 30px">图1、图2分别为AD9430采用CMOS模式和LVDS模式的管脚分布图。其主要管脚说明如下:</P>
            <P 
            style="TEXT-INDENT: 30px">S5:满量程调节脚,接高电平时,输入差分信号峰峰值为0.768VP-P;接低电平时,输入差分信号峰峰值为1.536VP-P。</P>
            <P 
            style="TEXT-INDENT: 30px">S4:在CMOS模式下使用,接高时为交替数据输出方式,接低时为并行数据输出;该脚在LVDS模式时接地。</P>
            <P 

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