📄 ports_def.h
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#define CAN0IDMR6 PORTIO_8(IO_BASE + 0x15e) /* CAN0 id mask register 6 */
#define CAN0IDMR7 PORTIO_8(IO_BASE + 0x15f) /* CAN0 id mask register 7 */
#define CAN0RXFG PORTIO_8(IO_BASE + 0x160) /* CAN0 receive buffer */
#define CAN0TXFG PORTIO_8(IO_BASE + 0x170) /* CAN0 transmit buffer */
/* CAN1 Module
*/
#define CAN1_BASE (IO_BASE + 0x180)
#define CAN1CTL0 PORTIO_8(IO_BASE + 0x180) /* CAN1 control register 0 */
#define CAN1CTL1 PORTIO_8(IO_BASE + 0x181) /* CAN1 control register 1 */
#define CAN1BTR0 PORTIO_8(IO_BASE + 0x182) /* CAN1 bus timing register 0 */
#define CAN1BTR1 PORTIO_8(IO_BASE + 0x183) /* CAN1 bus timing register 1 */
#define CAN1RFLG PORTIO_8(IO_BASE + 0x184) /* CAN1 receiver flag register */
#define CAN1RIER PORTIO_8(IO_BASE + 0x185) /* CAN1 receiver interrupt reg */
#define CAN1TFLG PORTIO_8(IO_BASE + 0x186) /* CAN1 transmitter flag reg */
#define CAN1TIER PORTIO_8(IO_BASE + 0x187) /* CAN1 transmitter control reg */
#define CAN1TARQ PORTIO_8(IO_BASE + 0x188) /* CAN1 transmitter abort request */
#define CAN1TAAK PORTIO_8(IO_BASE + 0x189) /* CAN1 transmitter abort acknowledge */
#define CAN1TBSEL PORTIO_8(IO_BASE + 0x18a) /* CAN1 transmit buffer selection */
#define CAN1IDAC PORTIO_8(IO_BASE + 0x18b) /* CAN1 identifier acceptance */
#define CAN1RXERR PORTIO_8(IO_BASE + 0x18e) /* CAN1 transmitter control reg */
#define CAN1TXERR PORTIO_8(IO_BASE + 0x18f) /* CAN1 transmit error counter */
#define CAN1IDAR0 PORTIO_8(IO_BASE + 0x190) /* CAN1 id acceptance reg 0 */
#define CAN1IDAR1 PORTIO_8(IO_BASE + 0x191) /* CAN1 id acceptance reg 1 */
#define CAN1IDAR2 PORTIO_8(IO_BASE + 0x192) /* CAN1 id acceptance reg 2 */
#define CAN1IDAR3 PORTIO_8(IO_BASE + 0x193) /* CAN1 id acceptance reg 3 */
#define CAN1IDMR0 PORTIO_8(IO_BASE + 0x194) /* CAN1 id mask register 0 */
#define CAN1IDMR1 PORTIO_8(IO_BASE + 0x195) /* CAN1 id mask register 1 */
#define CAN1IDMR2 PORTIO_8(IO_BASE + 0x196) /* CAN1 id mask register 2 */
#define CAN1IDMR3 PORTIO_8(IO_BASE + 0x197) /* CAN1 id mask register 3 */
#define CAN1IDAR4 PORTIO_8(IO_BASE + 0x198) /* CAN1 id acceptance reg 4 */
#define CAN1IDAR5 PORTIO_8(IO_BASE + 0x199) /* CAN1 id acceptance reg 5 */
#define CAN1IDAR6 PORTIO_8(IO_BASE + 0x19a) /* CAN1 id acceptance reg 6 */
#define CAN1IDAR7 PORTIO_8(IO_BASE + 0x19b) /* CAN1 id acceptance reg 7 */
#define CAN1IDMR4 PORTIO_8(IO_BASE + 0x19c) /* CAN1 id mask register 4 */
#define CAN1IDMR5 PORTIO_8(IO_BASE + 0x19d) /* CAN1 id mask register 5 */
#define CAN1IDMR6 PORTIO_8(IO_BASE + 0x19e) /* CAN1 id mask register 6 */
#define CAN1IDMR7 PORTIO_8(IO_BASE + 0x19f) /* CAN1 id mask register 7 */
#define CAN1RXFG PORTIO_8(IO_BASE + 0x1a0) /* CAN1 receive buffer */
#define CAN1TXFG PORTIO_8(IO_BASE + 0x1b0) /* CAN1 transmit buffer */
/* CAN2 Module
*/
#define CAN2_BASE (IO_BASE + 0x1c0)
#define CAN2CTL0 PORTIO_8(IO_BASE + 0x1c0) /* CAN2 control register 0 */
#define CAN2CTL1 PORTIO_8(IO_BASE + 0x1c1) /* CAN2 control register 1 */
#define CAN2BTR0 PORTIO_8(IO_BASE + 0x1c2) /* CAN2 bus timing register 0 */
#define CAN2BTR1 PORTIO_8(IO_BASE + 0x1c3) /* CAN2 bus timing register 1 */
#define CAN2RFLG PORTIO_8(IO_BASE + 0x1c4) /* CAN2 receiver flag register */
#define CAN2RIER PORTIO_8(IO_BASE + 0x1c5) /* CAN2 receiver interrupt reg */
#define CAN2TFLG PORTIO_8(IO_BASE + 0x1c6) /* CAN2 transmitter flag reg */
#define CAN2TIER PORTIO_8(IO_BASE + 0x1c7) /* CAN2 transmitter control reg */
#define CAN2TARQ PORTIO_8(IO_BASE + 0x1c8) /* CAN2 transmitter abort request */
#define CAN2TAAK PORTIO_8(IO_BASE + 0x1c9) /* CAN2 transmitter abort acknowledge */
#define CAN2TBSEL PORTIO_8(IO_BASE + 0x1ca) /* CAN2 transmit buffer selection */
#define CAN2IDAC PORTIO_8(IO_BASE + 0x1cb) /* CAN2 identifier acceptance */
#define CAN2RXERR PORTIO_8(IO_BASE + 0x1ce) /* CAN2 transmitter control reg */
#define CAN2TXERR PORTIO_8(IO_BASE + 0x1cf) /* CAN2 transmit error counter */
#define CAN2IDAR0 PORTIO_8(IO_BASE + 0x1d0) /* CAN2 id acceptance reg 0 */
#define CAN2IDAR1 PORTIO_8(IO_BASE + 0x1d1) /* CAN2 id acceptance reg 1 */
#define CAN2IDAR2 PORTIO_8(IO_BASE + 0x1d2) /* CAN2 id acceptance reg 2 */
#define CAN2IDAR3 PORTIO_8(IO_BASE + 0x1d3) /* CAN2 id acceptance reg 3 */
#define CAN2IDMR0 PORTIO_8(IO_BASE + 0x1d4) /* CAN2 id mask register 0 */
#define CAN2IDMR1 PORTIO_8(IO_BASE + 0x1d5) /* CAN2 id mask register 1 */
#define CAN2IDMR2 PORTIO_8(IO_BASE + 0x1d6) /* CAN2 id mask register 2 */
#define CAN2IDMR3 PORTIO_8(IO_BASE + 0x1d7) /* CAN2 id mask register 3 */
#define CAN2IDAR4 PORTIO_8(IO_BASE + 0x1d8) /* CAN2 id acceptance reg 4 */
#define CAN2IDAR5 PORTIO_8(IO_BASE + 0x1d9) /* CAN2 id acceptance reg 5 */
#define CAN2IDAR6 PORTIO_8(IO_BASE + 0x1da) /* CAN2 id acceptance reg 6 */
#define CAN2IDAR7 PORTIO_8(IO_BASE + 0x1db) /* CAN2 id acceptance reg 7 */
#define CAN2IDMR4 PORTIO_8(IO_BASE + 0x1dc) /* CAN2 id mask register 4 */
#define CAN2IDMR5 PORTIO_8(IO_BASE + 0x1dd) /* CAN2 id mask register 5 */
#define CAN2IDMR6 PORTIO_8(IO_BASE + 0x1de) /* CAN2 id mask register 6 */
#define CAN2IDMR7 PORTIO_8(IO_BASE + 0x1df) /* CAN2 id mask register 7 */
#define CAN2RXFG PORTIO_8(IO_BASE + 0x1e0) /* CAN2 receive buffer */
#define CAN2TXFG PORTIO_8(IO_BASE + 0x1f0) /* CAN2 transmit buffer */
/* CAN3 Module
*/
#define CAN3_BASE (IO_BASE + 0x200)
#define CAN3CTL0 PORTIO_8(IO_BASE + 0x200) /* CAN3 control register 0 */
#define CAN3CTL1 PORTIO_8(IO_BASE + 0x201) /* CAN3 control register 1 */
#define CAN3BTR0 PORTIO_8(IO_BASE + 0x202) /* CAN3 bus timing register 0 */
#define CAN3BTR1 PORTIO_8(IO_BASE + 0x203) /* CAN3 bus timing register 1 */
#define CAN3RFLG PORTIO_8(IO_BASE + 0x204) /* CAN3 receiver flag register */
#define CAN3RIER PORTIO_8(IO_BASE + 0x205) /* CAN3 receiver interrupt reg */
#define CAN3TFLG PORTIO_8(IO_BASE + 0x206) /* CAN3 transmitter flag reg */
#define CAN3TIER PORTIO_8(IO_BASE + 0x207) /* CAN3 transmitter control reg */
#define CAN3TARQ PORTIO_8(IO_BASE + 0x208) /* CAN3 transmitter abort request */
#define CAN3TAAK PORTIO_8(IO_BASE + 0x209) /* CAN3 transmitter abort acknowledge */
#define CAN3TBSEL PORTIO_8(IO_BASE + 0x20a) /* CAN3 transmit buffer selection */
#define CAN3IDAC PORTIO_8(IO_BASE + 0x20b) /* CAN3 identifier acceptance */
#define CAN3RXERR PORTIO_8(IO_BASE + 0x20e) /* CAN3 transmitter control reg */
#define CAN3TXERR PORTIO_8(IO_BASE + 0x20f) /* CAN3 transmit error counter */
#define CAN3IDAR0 PORTIO_8(IO_BASE + 0x210) /* CAN3 id acceptance reg 0 */
#define CAN3IDAR1 PORTIO_8(IO_BASE + 0x211) /* CAN3 id acceptance reg 1 */
#define CAN3IDAR2 PORTIO_8(IO_BASE + 0x212) /* CAN3 id acceptance reg 2 */
#define CAN3IDAR3 PORTIO_8(IO_BASE + 0x213) /* CAN3 id acceptance reg 3 */
#define CAN3IDMR0 PORTIO_8(IO_BASE + 0x214) /* CAN3 id mask register 0 */
#define CAN3IDMR1 PORTIO_8(IO_BASE + 0x215) /* CAN3 id mask register 1 */
#define CAN3IDMR2 PORTIO_8(IO_BASE + 0x216) /* CAN3 id mask register 2 */
#define CAN3IDMR3 PORTIO_8(IO_BASE + 0x217) /* CAN3 id mask register 3 */
#define CAN3IDAR4 PORTIO_8(IO_BASE + 0x218) /* CAN3 id acceptance reg 4 */
#define CAN3IDAR5 PORTIO_8(IO_BASE + 0x219) /* CAN3 id acceptance reg 5 */
#define CAN3IDAR6 PORTIO_8(IO_BASE + 0x21a) /* CAN3 id acceptance reg 6 */
#define CAN3IDAR7 PORTIO_8(IO_BASE + 0x21b) /* CAN3 id acceptance reg 7 */
#define CAN3IDMR4 PORTIO_8(IO_BASE + 0x21c) /* CAN3 id mask register 4 */
#define CAN3IDMR5 PORTIO_8(IO_BASE + 0x21d) /* CAN3 id mask register 5 */
#define CAN3IDMR6 PORTIO_8(IO_BASE + 0x21e) /* CAN3 id mask register 6 */
#define CAN3IDMR7 PORTIO_8(IO_BASE + 0x21f) /* CAN3 id mask register 7 */
#define CAN3RXFG PORTIO_8(IO_BASE + 0x220) /* CAN3 receive buffer */
#define CAN3TXFG PORTIO_8(IO_BASE + 0x230) /* CAN3 transmit buffer */
/* PIM
*/
/*Port T register offsets
*/
#define PTT PORTIO_8(IO_BASE + 0x240) /* port T data register */
#define PTIT PORTIO_8(IO_BASE + 0x241) /* port T input register */
#define DDRT PORTIO_8(IO_BASE + 0x242) /* port T data direction */
#define RDRT PORTIO_8(IO_BASE + 0x243) /* port T reduce drive */
#define PERT PORTIO_8(IO_BASE + 0x244) /* port T pull enable */
#define PPST PORTIO_8(IO_BASE + 0x245) /* port T polarity select */
/*Port S
*/
#define PTS PORTIO_8(IO_BASE + 0x248) /* port S data register */
#define PTIS PORTIO_8(IO_BASE + 0x249) /* port S input register */
#define DDRS PORTIO_8(IO_BASE + 0x24a) /* port S data direction */
#define RDRS PORTIO_8(IO_BASE + 0x24b) /* port S reduce drive */
#define PERS PORTIO_8(IO_BASE + 0x24c) /* port S pull enable */
#define PPSS PORTIO_8(IO_BASE + 0x24d) /* port S polarity select */
#define WOMS PORTIO_8(IO_BASE + 0x24e) /* port S wired-or mode */
/* Port M
*/
#define PTM PORTIO_8(IO_BASE + 0x250) /* port M data register */
#define PTIM PORTIO_8(IO_BASE + 0x251) /* port M input register */
#define DDRM PORTIO_8(IO_BASE + 0x252) /* port M data direction */
#define RDRM PORTIO_8(IO_BASE + 0x253) /* port M reduce drive */
#define PERM PORTIO_8(IO_BASE + 0x254) /* port M pull enable */
#define PPSM PORTIO_8(IO_BASE + 0x255) /* port M polarity select */
#define WOMM PORTIO_8(IO_BASE + 0x256) /* port M wired-or mode */
/* Port P
*/
#define PTP PORTIO_8(IO_BASE + 0x258) /* port P data register */
#define PTIP PORTIO_8(IO_BASE + 0x259) /* port P input register */
#define DDRP PORTIO_8(IO_BASE + 0x25a) /* port P data direction */
#define RDRP PORTIO_8(IO_BASE + 0x25b) /* port P reduce drive */
#define PERP PORTIO_8(IO_BASE + 0x25c) /* port P pull enable */
#define PPSP PORTIO_8(IO_BASE + 0x25d) /* port P polarity select */
#define PIEP PORTIO_8(IO_BASE + 0x25e) /* port P interrupt enable */
#define PIFP PORTIO_8(IO_BASE + 0x25f) /* port P interrupt flag */
/* Port H
*/
#define PTH PORTIO_8(IO_BASE + 0x260) /* port H data register */
#define PTIH PORTIO_8(IO_BASE + 0x261) /* port H input register */
#define DDRH PORTIO_8(IO_BASE + 0x262) /* port H data direction */
#define RDRH PORTIO_8(IO_BASE + 0x263) /* port H reduce drive */
#define PERH PORTIO_8(IO_BASE + 0x264) /* port H pull enable */
#define PPSH PORTIO_8(IO_BASE + 0x265) /* port H polarity select */
#define PIEH PORTIO_8(IO_BASE + 0x266) /* port H interrupt enable */
#define PIFH PORTIO_8(IO_BASE + 0x267) /* port H interrupt flag */
/* Port J
*/
#define PTJ PORTIO_8(IO_BASE + 0x268) /* port J data register */
#define PTIJ PORTIO_8(IO_BASE + 0x269) /* port J input register */
#define DDRJ PORTIO_8(IO_BASE + 0x26a) /* port J data direction */
#define RDRJ PORTIO_8(IO_BASE + 0x26b) /* port J reduce drive */
#define PERJ PORTIO_8(IO_BASE + 0x26c) /* port J pull enable */
#define PPSJ PORTIO_8(IO_BASE + 0x26d) /* port J polarity select */
#define PIEJ PORTIO_8(IO_BASE + 0x26e) /* port J interrupt enable */
#define PIFJ PORTIO_8(IO_BASE + 0x26f) /* port J interrupt flag */
/*PIM end
*/
/* CAN4 Module
*/
#define CAN4_BASE (IO_BASE + 0x280)
#define CAN4CTL0 PORTIO_8(IO_BASE + 0x280) /* CAN4 control register 0 */
#define CAN4CTL1 PORTIO_8(IO_BASE + 0x281) /* CAN4 control register 1 */
#define CAN4BTR0 PORTIO_8(IO_BASE + 0x282) /* CAN4 bus timing register 0 */
#define CAN4BTR1 PORTIO_8(IO_BASE + 0x283) /* CAN4 bus timing register 1 */
#define CAN4RFLG PORTIO_8(IO_BASE + 0x284) /* CAN4 receiver flag register */
#define CAN4RIER PORTIO_8(IO_BASE + 0x285) /* CAN4 receiver interrupt reg */
#define CAN4TFLG PORTIO_8(IO_BASE + 0x286) /* CAN4 transmitter flag reg */
#define CAN4TIER PORTIO_8(IO_BASE + 0x287) /* CAN4 transmitter control reg */
#define CAN4TARQ PORTIO_8(IO_BASE + 0x288) /* CAN4 transmitter abort request */
#define CAN4TAAK PORTIO_8(IO_BASE + 0x289) /* CAN4 transmitter abort acknowledge */
#define CAN4TBSEL PORTIO_8(IO_BASE + 0x28a) /* CAN4 transmit buffer selection */
#define CAN4IDAC PORTIO_8(IO_BASE + 0x28b) /* CAN4 identifier acceptance */
#define CAN4RXERR PORTIO_8(IO_BASE + 0x28e) /* CAN4 transmitter control reg */
#define CAN4TXERR PORTIO_8(IO_BASE + 0x28f) /* CAN4 transmit error counter */
#define CAN4IDAR0 PORTIO_8(IO_BASE + 0x290) /* CAN4 id acceptance reg 0 */
#define CAN4IDAR1 PORTIO_8(IO_BASE + 0x291) /* CAN4 id acceptance reg 1 */
#define CAN4IDAR2 PORTIO_8(IO_BASE + 0x292) /* CAN4 id acceptance reg 2 */
#define CAN4IDAR3 PORTIO_8(IO_BASE + 0x293) /* CAN4 id acceptance reg 3 */
#define CAN4IDMR0 PORTIO_8(IO_BASE + 0x294) /* CAN4 id mask register 0 */
#define CAN4IDMR1 PORTIO_8(IO_BASE + 0x295) /* CAN4 id mask register 1 */
#define CAN4IDMR2 PORTIO_8(IO_BASE + 0x296) /* CAN4 id mask register 2 */
#define CAN4IDMR3 PORTIO_8(IO_BASE + 0x297) /* CAN4 id mask register 3 */
#define CAN4IDAR4 PORTIO_8(IO_BASE + 0x298) /* CAN4 id acceptance reg 4 */
#define CAN4IDAR5 PORTIO_8(IO_BASE + 0x299) /* CAN4 id acceptance reg 5 */
#define CAN4IDAR6 PORTIO_8(IO_BASE + 0x29a) /* CAN4 id acceptance reg 6 */
#define CAN4IDAR7 PORTIO_8(IO_BASE + 0x29b) /* CAN4 id acceptance reg 7 */
#define CAN4IDMR4 PORTIO_8(IO_BASE + 0x29c) /* CAN4 id mask register 4 */
#define CAN4IDMR5 PORTIO_8(IO_BASE + 0x29d) /* CAN4 id mask register 5 */
#define CAN4IDMR6 PORTIO_8(IO_BASE + 0x29e) /* CAN4 id mask register 6 */
#define CAN4IDMR7 PORTIO_8(IO_BASE + 0x29f) /* CAN4 id mask register 7 */
#define CAN4RXFG PORTIO_8(IO_BASE + 0x2a0) /* CAN4 receive buffer */
#define CAN4TXFG PORTIO_8(IO_BASE + 0x2b0) /* CAN4 transmit buffer */
#endif
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