memcfg.inc

2410处理器bootloader,的初试化配置和 系统调用的寄存器配置函数

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; File name	: memcfg.inc
; Author	: Hanl
; Descript	: Memory bank configuration file, for 2410init.s file 
; History	:
;			(1) Hanl, Programming start, Dec 27, 2005
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; Memory Area
; GCS6 16bit(16MB) SDRAM(0x0c000000-0x0cffffff)
; GCS7 16bit(16MB) SDRAM(0x0d000000-0x0dffffff)
;           or
; GCS6 32bit(32MB) SDRAM(0x0c000000-0x0dffffff)

_RAM_STARTADDRESS    EQU           0x30000000
_NONCACHE_STARTADDRESS    EQU      0x31000000
_ISR_STARTADDRESS    EQU           0x33ffff00     
_MMUTT_STARTADDRESS    EQU         0x33ff8000
_STACK_BASEADDRESS    EQU          0x33ff8000
HEAPEND    EQU                     0x33ff0000

;- 64MB
;- 0x30000000 ~ 0x30ffffff : Download Area (16MB) Cacheable
;- 0x31000000 ~ 0x33feffff : Non-Cacheable Area
;- 0x33ff0000 ~ 0x33ff47ff : Heap & RW Area
;- 0x33ff4800 ~ 0x33ff7fff : FIQ ~ User Stack Area
;- 0x33ff8000 ~ 0x33fffeff : Not Used Area
;- 0x33ffff00 ~ 0x33ffffff : Exception & ISR Vector Table
;The location of stacks
UserStack    EQU    	(_STACK_BASEADDRESS-0x3800)	; 0x33ff4800 ~ 
SVCStack    EQU    	(_STACK_BASEADDRESS-0x2800) ; 0x33ff5800 ~
UndefStack    EQU    (_STACK_BASEADDRESS-0x2400)	; 0x33ff5c00 ~
AbortStack    EQU    (_STACK_BASEADDRESS-0x2000) ; 0x33ff6000 ~
IRQStack    EQU     	(_STACK_BASEADDRESS-0x1000)	; 0x33ff7000 ~
FIQStack    EQU    	(_STACK_BASEADDRESS-0x0)	; 0x33ff8000 ~ 

;EXPORT BUSWIDTH	;max. bus width for the GPIO configuration
; BUSWIDTH : 16,32
BUSWIDTH    EQU        32

; BWSCON
DW8	    	EQU    	(0x0)
DW16	    EQU    	(0x1)
DW32	    EQU    	(0x2)
WAIT	    EQU    	(0x1<<2)
UBLB	    EQU    	(0x1<<3)

;IF BUSWIDTH-16
;B1_BWSCON    EQU     (DW16)
;B2_BWSCON    EQU     (DW16)
;B3_BWSCON    EQU     (DW16)
;B4_BWSCON    EQU     (DW16)
;B5_BWSCON    EQU     (DW16)
;B6_BWSCON    EQU     (DW16)
;B7_BWSCON    EQU     (DW16)
;.endif
;.ifeq BUSWIDTH-32
B1_BWSCON    EQU     (DW32)
B2_BWSCON    EQU     (DW16)
B3_BWSCON    EQU     (DW16)|UBLB
B4_BWSCON    EQU     (DW16)
B5_BWSCON    EQU     (DW16)
B6_BWSCON    EQU     (DW32)
B7_BWSCON    EQU     (DW32)
;.endif

; BANK0CON 
B0_Tacs	    EQU    	0x0	; 0clk
B0_Tcos	    EQU    	0x0	; 0clk
B0_Tacc	    EQU    	0x7	; 14clk
B0_Tcoh	    EQU    	0x0	; 0clk
B0_Tah	    EQU    	0x0	; 0clk
B0_Tacp	    EQU    	0x0	
B0_PMC	    EQU    	0x0	; normal

; BANK1CON
B1_Tacs	    EQU    	0x0	; 0clk
B1_Tcos	    EQU    	0x0	; 0clk
B1_Tacc	    EQU    	0x7	; 14clk
B1_Tcoh	    EQU    	0x0	; 0clk
B1_Tah	    EQU    	0x0	; 0clk
B1_Tacp	    EQU    	0x0	
B1_PMC	    EQU    	0x0	; normal

; Bank 2 parameter
B2_Tacs	    EQU    	0x0	; 0clk
B2_Tcos	    EQU    	0x0	; 0clk
B2_Tacc	    EQU    	0x7	; 14clk
B2_Tcoh	    EQU    	0x0	; 0clk
B2_Tah	    EQU    	0x0	; 0clk
B2_Tacp	    EQU    	0x0	
B2_PMC	    EQU    	0x0	; normal

; Bank 3 parameter
B3_Tacs	    EQU    	0x0	; 0clk
B3_Tcos	    EQU    	0x0	; 0clk
B3_Tacc	    EQU    	0x7	; 14clk
B3_Tcoh	    EQU    	0x0	; 0clk
B3_Tah	    EQU    	0x0	; 0clk
B3_Tacp	    EQU    	0x0	
B3_PMC	    EQU    	0x0	; normal

; Bank 4 parameter
B4_Tacs	    EQU    	0x0	; 0clk
B4_Tcos	    EQU    	0x0	; 0clk
B4_Tacc	    EQU    	0x7	; 14clk
B4_Tcoh	    EQU    	0x0	; 0clk
B4_Tah	    EQU    	0x0	; 0clk
B4_Tacp	    EQU    	0x0	
B4_PMC	    EQU    	0x0	; normal

; Bank 5 parameter
B5_Tacs	    EQU    	0x0	; 0clk
B5_Tcos	    EQU    	0x0	; 0clk
B5_Tacc	    EQU    	0x7	; 14clk
B5_Tcoh	    EQU    	0x0	; 0clk
B5_Tah	    EQU    	0x0	; 0clk
B5_Tacp	    EQU    	0x0	
B5_PMC	    EQU    	0x0	; normal

; Bank 6 parameter
B6_MT	    EQU    	0x3	; SDRAM
; B6_Trcd	,	0x0	; 2clk
B6_Trcd	    EQU    	0x1	; 3clk
B6_SCAN	    EQU    	0x1	; 9bit

; Bank 7 parameter
B7_MT	    EQU    	0x3	; SDRAM
; B7_Trcd	    EQU    	0x0	; 2clk
B7_Trcd	    EQU    	0x1	; 3clk
B7_SCAN	    EQU    	0x1	; 9bit

; REFRESH parameter
REFEN	    EQU    	0x1	; Refresh enable
TREFMD	    EQU    	0x0	; CBR(CAS before RAS)/Auto refresh
Trp	    EQU    	0x0	; 2clk
Trc	    EQU    	0x3	; 7clk
Tchr	    EQU    	0x2	; 3clk
REFCNT	    EQU    	1113	; period=15.6us, HCLK=60Mhz, (2048+1-15.6*60)