📄 ex88.vhd
字号:
LIBRARY ieee;
USE ieee.std_logic_1164.all;
ENTITY ex88 IS
PORT
(
in1,in2 : STD_LOGIC_vector;
pout : OUT STD_LOGIC_vector
);
END ex88;
ARCHITECTURE a OF ex88 IS
BEGIN
PROCESS (in1,in2)
BEGIN
pout<=in1 after 2 ns;
END PROCESS;
END a;
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