📄 iolpc2470.h
字号:
} __pinsel0_bits;
/* Pin function select register 1 */
typedef struct{
__REG32 P0_16 : 2;
__REG32 P0_17 : 2;
__REG32 P0_18 : 2;
__REG32 P0_19 : 2;
__REG32 P0_20 : 2;
__REG32 P0_21 : 2;
__REG32 P0_22 : 2;
__REG32 P0_23 : 2;
__REG32 P0_24 : 2;
__REG32 P0_25 : 2;
__REG32 P0_26 : 2;
__REG32 P0_27 : 2;
__REG32 P0_28 : 2;
__REG32 P0_29 : 2;
__REG32 P0_30 : 2;
__REG32 P0_31 : 2;
} __pinsel1_bits;
/* Pin function select register 2 */
typedef struct{
__REG32 P1_0 : 2;
__REG32 P1_1 : 2;
__REG32 P1_2 : 2;
__REG32 P1_3 : 2;
__REG32 P1_4 : 2;
__REG32 P1_5 : 2;
__REG32 P1_6 : 2;
__REG32 P1_7 : 2;
__REG32 P1_8 : 2;
__REG32 P1_9 : 2;
__REG32 P1_10 : 2;
__REG32 P1_11 : 2;
__REG32 P1_12 : 2;
__REG32 P1_13 : 2;
__REG32 P1_14 : 2;
__REG32 P1_15 : 2;
} __pinsel2_bits;
/* Pin function select register 3 */
typedef struct{
__REG32 P1_16 : 2;
__REG32 P1_17 : 2;
__REG32 P1_18 : 2;
__REG32 P1_19 : 2;
__REG32 P1_20 : 2;
__REG32 P1_21 : 2;
__REG32 P1_22 : 2;
__REG32 P1_23 : 2;
__REG32 P1_24 : 2;
__REG32 P1_25 : 2;
__REG32 P1_26 : 2;
__REG32 P1_27 : 2;
__REG32 P1_28 : 2;
__REG32 P1_29 : 2;
__REG32 P1_30 : 2;
__REG32 P1_31 : 2;
} __pinsel3_bits;
/* Pin function select register 4 */
typedef struct{
__REG32 P2_0 : 2;
__REG32 P2_1 : 2;
__REG32 P2_2 : 2;
__REG32 P2_3 : 2;
__REG32 P2_4 : 2;
__REG32 P2_5 : 2;
__REG32 P2_6 : 2;
__REG32 P2_7 : 2;
__REG32 P2_8 : 2;
__REG32 P2_9 : 2;
__REG32 P2_10 : 2;
__REG32 P2_11 : 2;
__REG32 P2_12 : 2;
__REG32 P2_13 : 2;
__REG32 P2_14 : 2;
__REG32 P2_15 : 2;
} __pinsel4_bits;
/* Pin function select register 5 */
typedef struct{
__REG32 P2_16 : 2;
__REG32 P2_17 : 2;
__REG32 P2_18 : 2;
__REG32 P2_19 : 2;
__REG32 P2_20 : 2;
__REG32 P2_21 : 2;
__REG32 P2_22 : 2;
__REG32 P2_23 : 2;
__REG32 P2_24 : 2;
__REG32 P2_25 : 2;
__REG32 P2_26 : 2;
__REG32 P2_27 : 2;
__REG32 P2_28 : 2;
__REG32 P2_29 : 2;
__REG32 P2_30 : 2;
__REG32 P2_31 : 2;
} __pinsel5_bits;
/* Pin function select register 6 */
typedef struct{
__REG32 P3_0 : 2;
__REG32 P3_1 : 2;
__REG32 P3_2 : 2;
__REG32 P3_3 : 2;
__REG32 P3_4 : 2;
__REG32 P3_5 : 2;
__REG32 P3_6 : 2;
__REG32 P3_7 : 2;
__REG32 P3_8 : 2;
__REG32 P3_9 : 2;
__REG32 P3_10 : 2;
__REG32 P3_11 : 2;
__REG32 P3_12 : 2;
__REG32 P3_13 : 2;
__REG32 P3_14 : 2;
__REG32 P3_15 : 2;
} __pinsel6_bits;
/* Pin function select register 7 */
typedef struct{
__REG32 P3_16 : 2;
__REG32 P3_17 : 2;
__REG32 P3_18 : 2;
__REG32 P3_19 : 2;
__REG32 P3_20 : 2;
__REG32 P3_21 : 2;
__REG32 P3_22 : 2;
__REG32 P3_23 : 2;
__REG32 P3_24 : 2;
__REG32 P3_25 : 2;
__REG32 P3_26 : 2;
__REG32 P3_27 : 2;
__REG32 P3_28 : 2;
__REG32 P3_29 : 2;
__REG32 P3_30 : 2;
__REG32 P3_31 : 2;
} __pinsel7_bits;
/* Pin function select register 8 */
typedef struct{
__REG32 P4_0 : 2;
__REG32 P4_1 : 2;
__REG32 P4_2 : 2;
__REG32 P4_3 : 2;
__REG32 P4_4 : 2;
__REG32 P4_5 : 2;
__REG32 P4_6 : 2;
__REG32 P4_7 : 2;
__REG32 P4_8 : 2;
__REG32 P4_9 : 2;
__REG32 P4_10 : 2;
__REG32 P4_11 : 2;
__REG32 P4_12 : 2;
__REG32 P4_13 : 2;
__REG32 P4_14 : 2;
__REG32 P4_15 : 2;
} __pinsel8_bits;
/* Pin function select register 9 */
typedef struct{
__REG32 P4_16 : 2;
__REG32 P4_17 : 2;
__REG32 P4_18 : 2;
__REG32 P4_19 : 2;
__REG32 P4_20 : 2;
__REG32 P4_21 : 2;
__REG32 P4_22 : 2;
__REG32 P4_23 : 2;
__REG32 P4_24 : 2;
__REG32 P4_25 : 2;
__REG32 P4_26 : 2;
__REG32 P4_27 : 2;
__REG32 P4_28 : 2;
__REG32 P4_29 : 2;
__REG32 P4_30 : 2;
__REG32 P4_31 : 2;
} __pinsel9_bits;
/* Pin function select register 10 */
typedef struct{
__REG32 : 3;
__REG32 GPIO_TRACE : 1;
__REG32 :28;
} __pinsel10_bits;
/* Pin function select register 11 */
typedef struct{
__REG32 LCDPE : 1;
__REG32 LCDM : 3;
__REG32 :28;
} __pinsel11_bits;
/* GPIO 0 Registers */
typedef struct {
__REG32 P0_0 : 1;
__REG32 P0_1 : 1;
__REG32 P0_2 : 1;
__REG32 P0_3 : 1;
__REG32 P0_4 : 1;
__REG32 P0_5 : 1;
__REG32 P0_6 : 1;
__REG32 P0_7 : 1;
__REG32 P0_8 : 1;
__REG32 P0_9 : 1;
__REG32 P0_10 : 1;
__REG32 P0_11 : 1;
__REG32 P0_12 : 1;
__REG32 P0_13 : 1;
__REG32 P0_14 : 1;
__REG32 P0_15 : 1;
__REG32 P0_16 : 1;
__REG32 P0_17 : 1;
__REG32 P0_18 : 1;
__REG32 P0_19 : 1;
__REG32 P0_20 : 1;
__REG32 P0_21 : 1;
__REG32 P0_22 : 1;
__REG32 P0_23 : 1;
__REG32 P0_24 : 1;
__REG32 P0_25 : 1;
__REG32 P0_26 : 1;
__REG32 P0_27 : 1;
__REG32 P0_28 : 1;
__REG32 P0_29 : 1;
__REG32 P0_30 : 1;
__REG32 P0_31 : 1;
} __gpio0_bits;
/* FGPIO 0 Registers*/
typedef union{
//FIO0DIR
//FIO0MASK
//FIO0PIN
//FIO0SET
//FIO0CLR
struct {
__REG32 P0_0 : 1;
__REG32 P0_1 : 1;
__REG32 P0_2 : 1;
__REG32 P0_3 : 1;
__REG32 P0_4 : 1;
__REG32 P0_5 : 1;
__REG32 P0_6 : 1;
__REG32 P0_7 : 1;
__REG32 P0_8 : 1;
__REG32 P0_9 : 1;
__REG32 P0_10 : 1;
__REG32 P0_11 : 1;
__REG32 P0_12 : 1;
__REG32 P0_13 : 1;
__REG32 P0_14 : 1;
__REG32 P0_15 : 1;
__REG32 P0_16 : 1;
__REG32 P0_17 : 1;
__REG32 P0_18 : 1;
__REG32 P0_19 : 1;
__REG32 P0_20 : 1;
__REG32 P0_21 : 1;
__REG32 P0_22 : 1;
__REG32 P0_23 : 1;
__REG32 P0_24 : 1;
__REG32 P0_25 : 1;
__REG32 P0_26 : 1;
__REG32 P0_27 : 1;
__REG32 P0_28 : 1;
__REG32 P0_29 : 1;
__REG32 P0_30 : 1;
__REG32 P0_31 : 1;
};
struct
{
union
{
//FIO0DIR0
//FIO0MASK0
//FIO0PIN0
//FIO0SET0
//FIO0CLR0
struct{
__REG8 P0_0 : 1;
__REG8 P0_1 : 1;
__REG8 P0_2 : 1;
__REG8 P0_3 : 1;
__REG8 P0_4 : 1;
__REG8 P0_5 : 1;
__REG8 P0_6 : 1;
__REG8 P0_7 : 1;
} __byte0_bit;
__REG8 __byte0;
};
union
{
//FIO0DIR1
//FIO0MASK1
//FIO0PIN1
//FIO0SET1
//FIO0CLR1
struct{
__REG8 P0_0 : 1;
__REG8 P0_1 : 1;
__REG8 P0_2 : 1;
__REG8 P0_3 : 1;
__REG8 P0_4 : 1;
__REG8 P0_5 : 1;
__REG8 P0_6 : 1;
__REG8 P0_7 : 1;
} __byte1_bit;
__REG8 __byte1;
};
union
{
//FIO0DIR2
//FIO0MASK2
//FIO0PIN2
//FIO0SET2
//FIO0CLR2
struct{
__REG8 P0_0 : 1;
__REG8 P0_1 : 1;
__REG8 P0_2 : 1;
__REG8 P0_3 : 1;
__REG8 P0_4 : 1;
__REG8 P0_5 : 1;
__REG8 P0_6 : 1;
__REG8 P0_7 : 1;
} __byte2_bit;
__REG8 __byte2;
};
union
{
//FIO0DIR3
//FIO0MASK3
//FIO0PIN3
//FIO0SET3
//FIO0CLR3
struct{
__REG8 P0_0 : 1;
__REG8 P0_1 : 1;
__REG8 P0_2 : 1;
__REG8 P0_3 : 1;
__REG8 P0_4 : 1;
__REG8 P0_5 : 1;
__REG8 P0_6 : 1;
__REG8 P0_7 : 1;
} __byte3_bit;
__REG8 __byte3;
};
};
struct
{
union
{
//FIO0DIRL
//FIO0MASKL
//FIO0PINL
//FIO0SETL
//FIO0CLRL
struct{
__REG16 P0_0 : 1;
__REG16 P0_1 : 1;
__REG16 P0_2 : 1;
__REG16 P0_3 : 1;
__REG16 P0_4 : 1;
__REG16 P0_5 : 1;
__REG16 P0_6 : 1;
__REG16 P0_7 : 1;
__REG16 P0_8 : 1;
__REG16 P0_9 : 1;
__REG16 P0_10 : 1;
__REG16 P0_11 : 1;
__REG16 P0_12 : 1;
__REG16 P0_13 : 1;
__REG16 P0_14 : 1;
__REG16 P0_15 : 1;
} __shortl_bit;
__REG16 __shortl;
};
union
{
//FIO0DIRU
//FIO0MASKU
//FIO0PINU
//FIO0SETU
//FIO0CLRU
struct{
__REG16 P0_0 : 1;
__REG16 P0_1 : 1;
__REG16 P0_2 : 1;
__REG16 P0_3 : 1;
__REG16 P0_4 : 1;
__REG16 P0_5 : 1;
__REG16 P0_6 : 1;
__REG16 P0_7 : 1;
__REG16 P0_8 : 1;
__REG16 P0_9 : 1;
__REG16 P0_10 : 1;
__REG16 P0_11 : 1;
__REG16 P0_12 : 1;
__REG16 P0_13 : 1;
__REG16 P0_14 : 1;
__REG16 P0_15 : 1;
} __shortu_bit;
__REG16 __shortu;
};
};
} __fgpio0_bits;
/* GPIO 1 Registers */
typedef struct {
__REG32 P1_0 : 1;
__REG32 P1_1 : 1;
__REG32 P1_2 : 1;
__REG32 P1_3 : 1;
__REG32 P1_4 : 1;
__REG32 P1_5 : 1;
__REG32 P1_6 : 1;
__REG32 P1_7 : 1;
__REG32 P1_8 : 1;
__REG32 P1_9 : 1;
__REG32 P1_10 : 1;
__REG32 P1_11 : 1;
__REG32 P1_12 : 1;
__REG32 P1_13 : 1;
__REG32 P1_14 : 1;
__REG32 P1_15 : 1;
__REG32 P1_16 : 1;
__REG32 P1_17 : 1;
__REG32 P1_18 : 1;
__REG32 P1_19 : 1;
__REG32 P1_20 : 1;
__REG32 P1_21 : 1;
__REG32 P1_22 : 1;
__REG32 P1_23 : 1;
__REG32 P1_24 : 1;
__REG32 P1_25 : 1;
__REG32 P1_26 : 1;
__REG32 P1_27 : 1;
__REG32 P1_28 : 1;
__REG32 P1_29 : 1;
__REG32 P1_30 : 1;
__REG32 P1_31 : 1;
} __gpio1_bits;
/* FGPIO 1 Registers*/
typedef union{
//FIO1DIR
//FIO1MASK
//FIO1PIN
//FIO1SET
//FIO1CLR
struct {
__REG32 P1_0 : 1;
__REG32 P1_1 : 1;
__REG32 P1_2 : 1;
__REG32 P1_3 : 1;
__REG32 P1_4 : 1;
__REG32 P1_5 : 1;
__REG32 P1_6 : 1;
__REG32 P1_7 : 1;
__REG32 P1_8 : 1;
__REG32 P1_9 : 1;
__REG32 P1_10 : 1;
__REG32 P1_11 : 1;
__REG32 P1_12 : 1;
__REG32 P1_13 : 1;
__REG32 P1_14 : 1;
__REG32 P1_15 : 1;
__REG32 P1_16 : 1;
__REG32 P1_17 : 1;
__REG32 P1_18 : 1;
__REG32 P1_19 : 1;
__REG32 P1_20 : 1;
__REG32 P1_21 : 1;
__REG32 P1_22 : 1;
__REG32 P1_23 : 1;
__REG32 P1_24 : 1;
__REG32 P1_25 : 1;
__REG32 P1_26 : 1;
__REG32 P1_27 : 1;
__REG32 P1_28 : 1;
__REG32 P1_29 : 1;
__REG32 P1_30 : 1;
__REG32 P1_31 : 1;
};
struct
{
union
{
//FIO1DIR0
//FIO1MASK0
//FIO1PIN0
//FIO1SET0
//FIO1CLR0
struct{
__REG8 P1_0 : 1;
__REG8 P1_1 : 1;
__REG8 P1_2 : 1;
__REG8 P1_3 : 1;
__REG8 P1_4 : 1;
__REG8 P1_5 : 1;
__REG8 P1_6 : 1;
__REG8 P1_7 : 1;
} __byte0_bit;
__REG8 __byte0;
};
union
{
//FIO1DIR1
//FIO1MASK1
//FIO1PIN1
//FIO1SET1
//FIO1CLR1
struct{
__REG8 P1_0 : 1;
__REG8 P1_1 : 1;
__REG8 P1_2 : 1;
__REG8 P1_3 : 1;
__REG8 P1_4 : 1;
__REG8 P1_5 : 1;
__REG8 P1_6 : 1;
__REG8 P1_7 : 1;
} __byte1_bit;
__REG8 __byte1;
};
union
{
//FIO1DIR2
//FIO1MASK2
//FIO1PIN2
//FIO1SET2
//FIO1CLR2
struct{
__REG8 P1_0 : 1;
__REG8 P1_1 : 1;
__REG8 P1_2 : 1;
__REG8 P1_3 : 1;
__REG8 P1_4 : 1;
__REG8 P1_5 : 1;
__REG8 P1_6 : 1;
__REG8 P1_7 : 1;
} __byte2_bit;
__REG8 __byte2;
};
union
{
//FIO1DIR3
//FIO1MASK3
//FIO1PIN3
//FIO1SET3
//FIO1CLR3
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