📄 reg166.inc
字号:
ACC19 bit CCM4.15 ; CC19 Timer 0/1 zuordnen
CCM5 equ 0ff24h
CCMOD20 bit CCM5.0 ; CC20 Modusauswahl
ACC20 bit CCM5.3 ; CC20 Timer 0/1 zuordnen
CCMOD21 bit CCM5.4 ; CC21 Modusauswahl
ACC21 bit CCM5.7 ; CC21 Timer 0/1 zuordnen
CCMOD22 bit CCM5.8 ; CC22 Modusauswahl
ACC22 bit CCM5.11 ; CC22 Timer 0/1 zuordnen
CCMOD23 bit CCM5.12 ; CC23 Modusauswahl
ACC23 bit CCM5.15 ; CC23 Timer 0/1 zuordnen
CCM6 equ 0ff26h
CCMOD24 bit CCM6.0 ; CC24 Modusauswahl
ACC24 bit CCM6.3 ; CC24 Timer 0/1 zuordnen
CCMOD25 bit CCM6.4 ; CC25 Modusauswahl
ACC25 bit CCM6.7 ; CC25 Timer 0/1 zuordnen
CCMOD26 bit CCM6.8 ; CC26 Modusauswahl
ACC26 bit CCM6.11 ; CC26 Timer 0/1 zuordnen
CCMOD27 bit CCM6.12 ; CC27 Modusauswahl
ACC27 bit CCM6.15 ; CC27 Timer 0/1 zuordnen
CCM7 equ 0ff28h
CCMOD28 bit CCM7.0 ; CC28 Modusauswahl
ACC28 bit CCM7.3 ; CC28 Timer 0/1 zuordnen
CCMOD29 bit CCM7.4 ; CC29 Modusauswahl
ACC29 bit CCM7.7 ; CC29 Timer 0/1 zuordnen
CCMOD30 bit CCM7.8 ; CC30 Modusauswahl
ACC30 bit CCM7.11 ; CC30 Timer 0/1 zuordnen
CCMOD31 bit CCM7.12 ; CC31 Modusauswahl
ACC31 bit CCM7.15 ; CC31 Timer 0/1 zuordnen
DefIntBits CR,0ff6ah ; CAPREL Interruptsteuerregister
DefIntBits CC0,0ff78h ; Interruptsteuerung CAPCOM-Kanaele
DefIntBits CC1,0ff7ah
DefIntBits CC2,0ff7ch
DefIntBits CC3,0ff7eh
DefIntBits CC4,0ff80h
DefIntBits CC5,0ff82h
DefIntBits CC6,0ff84h
DefIntBits CC7,0ff86h
DefIntBits CC8,0ff88h
DefIntBits CC9,0ff8ah
DefIntBits CC10,0ff8ch
DefIntBits CC11,0ff8eh
DefIntBits CC12,0ff90h
DefIntBits CC13,0ff92h
DefIntBits CC14,0ff94h
DefIntBits CC15,0ff96h
if _n>=167
DefIntBits CC16,0f160h ; Interruptsteuerung weiterer CAPCOM-Kanaele
DefIntBits CC17,0f162h
DefIntBits CC18,0f164h
DefIntBits CC19,0f166h
DefIntBits CC20,0f168h
DefIntBits CC21,0f16ah
DefIntBits CC22,0f16ch
DefIntBits CC23,0f16eh
DefIntBits CC24,0f170h
DefIntBits CC25,0f172h
DefIntBits CC26,0f174h
DefIntBits CC27,0f176h
DefIntBits CC28,0f178h
DefIntBits CC29,0f184h
DefIntBits CC30,0f18ch
DefIntBits CC31,0f194h
endif
PECC0 equ 0fec0h ; PEC Kanalsteuerregister
PECC1 equ 0fec2h
PECC2 equ 0fec4h
PECC3 equ 0fec6h
PECC4 equ 0fec8h
PECC5 equ 0fecah
PECC6 equ 0fecch
PECC7 equ 0feceh
SRCP0 equ 0fce0h ; PEC Quell-Register
SRCP1 equ 0fce4h
SRCP2 equ 0fce8h
SRCP3 equ 0fcech
SRCP4 equ 0fcf0h
SRCP5 equ 0fcf4h
SRCP6 equ 0fcf8h
SRCP7 equ 0fcfch
DSTP0 equ 0fce2h ; PEC Ziel-Register
DSTP1 equ 0fce6h
DSTP2 equ 0fceah
DSTP3 equ 0fceeh
DSTP4 equ 0fcf2h
DSTP5 equ 0fcf6h
DSTP6 equ 0fcfah
DSTP7 equ 0fcfeh
;----------------------------------------------------------------------------
; Pulsweitenmodulator:
if _n>=167
PP0 equ 0f038h ; PWM Periode 0
PT0 equ 0f030h ; PWM Zaehler 0
PW0 equ 0fe30h ; PWM Pulsweite 0
PP1 equ 0f03ah ; PWM Periode 1
PT1 equ 0f032h ; PWM Zaehler 1
PW1 equ 0fe30h ; PWM Pulsweite 1
PP2 equ 0f03ch ; PWM Periode 2
PT2 equ 0f034h ; PWM Zaehler 2
PW2 equ 0fe30h ; PWM Pulsweite 2
PP3 equ 0f03eh ; PWM Periode 3
PT3 equ 0f036h ; PWM Zaehler 3
PW3 equ 0fe30h ; PWM Pulsweite 3
PWMCON0 equ 0ff30h ; PWM Seuerregister 0
PTR0 bit PWMCON0.0 ; PT0 laufen lassen
PTR1 bit PWMCON0.1 ; PT1 laufen lassen
PTR2 bit PWMCON0.2 ; PT2 laufen lassen
PTR3 bit PWMCON0.3 ; PT3 laufen lassen
PTI0 bit PWMCON0.4 ; PT0 Eingangswahl
PTI1 bit PWMCON0.5 ; PT1 Eingangswahl
PTI2 bit PWMCON0.6 ; PT2 Eingangswahl
PTI3 bit PWMCON0.7 ; PT3 Eingangswahl
PIE0 bit PWMCON0.8 ; PT0 Interupts freigeben
PIE1 bit PWMCON0.9 ; PT1 Interupts freigeben
PIE2 bit PWMCON0.10 ; PT2 Interupts freigeben
PIE3 bit PWMCON0.11 ; PT3 Interupts freigeben
PIR0 bit PWMCON0.12 ; PT0 Interupt aufgetreten
PIR1 bit PWMCON0.13 ; PT1 Interupt aufgetreten
PIR2 bit PWMCON0.14 ; PT2 Interupt aufgetreten
PIR3 bit PWMCON0.15 ; PT3 Interupt aufgetreten
PWMCON1 equ 0ff32h ; PWM Steuerregister 1
PEN0 bit PWMCON1.0 ; PT0 Ausgang freigeben
PEN1 bit PWMCON1.1 ; PT1 Ausgang freigeben
PEN2 bit PWMCON1.2 ; PT2 Ausgang freigeben
PEN3 bit PWMCON1.3 ; PT3 Ausgang freigeben
PM0 bit PWMCON1.4 ; PT0 Modus
PM1 bit PWMCON1.5 ; PT1 Modus
PM2 bit PWMCON1.6 ; PT2 Modus
PM3 bit PWMCON1.7 ; PT3 Modus
PB01 bit PWMCON1.12 ; PT0&1 Burst-Modus
PS2 bit PWMCON1.14 ; PT2 Einzelimpulsmodus
PS3 bit PWMCON1.15 ; PT3 Einzelimpulsmodus
DefIntBits PWM,0f17eh ; PWM Interruptsteuerung
endif
;----------------------------------------------------------------------------
; A/D-Wandler:
ADDAT equ 0fea0h ; A/D-Wandler Ergebnis
if _n>=167
ADDAT2 equ 0f0a0h ; A/D-Wandler Ergebnis 2
endif
DefIntBits ADC,0ff98h ; A/D-Wandler Interruptsteuerung fuer Wandlungsende
DefIntBits ADE,0ff9ah ; A/D-Wandler Interruptsteuerung fuer Fehler
ADCON equ 0ffa0h ; A/D-Wandler Steuerregister
ADCH bit ADCON.0 ; A/D-Wandler Kanalwahl
ADM bit ADCON.4 ; A/D-Wandler Modus
ADST bit ADCON.7 ; A/D-Wandlung starten
ADBSY bit ADCON.8 ; A/D-Wandler beschaeftigt
if _n>=167
ADWR bit ADCON.9 ; A/D-Wandler erst wieder starten, wenn gelesen
ADCIN bit ADCON.10 ; A/D-Wandler Kanalinjektion (??...)
ADCRQ bit ADCON.11 ; A/D-Wandler Kanalinjektion angefordert
endif
;----------------------------------------------------------------------------
; Watchdog:
WDT equ 0feaeh ; Watchdog-Zaehler
WDTCON equ 0ffaeh ; Watchdog Steuerregister
WDTIN bit WDTCON.0 ; Watchdog Eingangsfrequenz
WDTR bit WDTCON.1 ; Reset durch Watchdog ?
if _n>=167
SWR bit WDTCON.2 ; Software-Reset?
SHWR bit WDTCON.3 ; Kurzer Hardware-Reset?
LHWR bit WDTCON.4 ; Langer Hardware-Reset?
PONR bit WDTCON.5 ; PowerON-Reset? (Flash-Varianten)
endif
WDTREL bit WDTCON.8 ; Reload-Wert Watchdog
;----------------------------------------------------------------------------
; Serielles:
S0TBUF equ 0feb0h ; SIO0 Senderegister
S0RBUF equ 0feb2h ; SIO0 Empfangsregister
S0BG equ 0feb4h ; SIO0 Baudrateneinstellung
DefIntBits S0T,0ff6ch ; Interruptsteuerung Sendeteil SIO0
DefIntBits S0R,0ff6eh ; Interruptsteuerung Empfangsteil SIO0
DefIntBits S0E,0ff70h ; Interruptsteuerung Fehlererkennung SIO0
if _n>=167
DefIntBits S0TB,0f19ch ; Interruptsteuerung Sendepuffer
endif
S0CON equ 0ffb0h ; Steuerregister SIO0
S0M bit S0CON.0 ; SIO0 Modus
S0STP bit S0CON.3 ; SIO0 Anzahl Stopbits
S0REN bit S0CON.4 ; SIO0 Empfaenger freigeben
S0PEN bit S0CON.5 ; SIO0 mit Paritaet
S0FEN bit S0CON.6 ; SIO0 mit Rahmenpruefung
S0OEN bit S0CON.7 ; SIO0 mit Ueberlaufpruefung
S0PE bit S0CON.8 ; SIO0 Paritaetsfehler
S0FE bit S0CON.9 ; SIO0 Rahmenfehler
S0OE bit S0CON.10 ; SIO0 Ueberlauffehler
if _n>=167
S0ODD bit S0CON.12 ; SIO0 Odd Parity
S0BRS bit S0CON.13 ; SIO0 Baudratenfaktor
endif
S0LB bit S0CON.14 ; SIO0 Rueckkopplung
S0R bit S0CON.15 ; SIO0 Baudratengenerator freigeben
if _n>=167
SSCTB equ 0f0b0h ; SSC Senderegister
SSCRB equ 0f0b2h ; SSC Empfangsregister
SSCBR equ 0f0b4h ; SSC Baudrateneinstellung
DefIntBits SSCT,0ff72h ; Interruptsteuerung Sendeteil SSC
DefIntBits SSCR,0ff74h ; Interruptsteuerung Empfangsteil SSC
DefIntBits SSCE,0ff76h ; Interruptsteuerung Fehlererkennung SSC
SSCCON equ 0ffb2h ; Steuerregister SSC
SSCBM bit SSCCON.0 ; Wortbreite
SSCBC bit SSCCON.0 ; Bitzahl
SSCHB bit SSCCON.4 ; Startbitsteuerung
SSCPH bit SSCCON.5 ; Taktphase
SSCP0 bit SSCCON.6 ; Taktpolaritaet
SSCTEN bit SSCCON.8 ; Sendefehler freigeben
SSCTE bit SSCCON.8 ; Sendefehler aufgetreten ?
SSCREN bit SSCCON.9 ; Empfangsfehler freigeben
SSCRE bit SSCCON.9 ; Empfangsfehler aufgetreten ?
SSCPEN bit SSCCON.10 ; Phasenfehler freigeben
SSCPE bit SSCCON.10 ; Phasenfehler aufgetreten ?
SSCBEN bit SSCCON.11 ; Baudratenfehler freigeben
SSCBE bit SSCCON.11 ; Baudratenfehler freigegeben ?
SSCBSY bit SSCCON.12 ; SSC beschaeftigt ?
SSCMS bit SSCCON.14 ; SSC als Master betreiben
SSCEN bit SSCCON.15 ; SSC freigeben
elseif
S1TBUF equ 0feb8h ; SIO1 Senderegister
S1RBUF equ 0febah ; SIO1 Empfangsregister
S1BG equ 0febch ; SIO1 Baudrateneinstellung
DefIntBits S1T,0ff72h ; Interruptsteuerung Sendeteil SIO1
DefIntBits S1R,0ff74h ; Interruptsteuerung Empfangsteil SIO1
DefIntBits S1E,0ff76h ; Interruptsteuerung Fehlererkennung SIO1
S1CON equ 0ffb8h ; Steuerregister SIO1
S1M bit S1CON.0 ; SIO1 Modus
S1STP bit S1CON.3 ; SIO1 Anzahl Stopbits
S1REN bit S1CON.4 ; SIO1 Empfaenger freigeben
S1PEN bit S1CON.5 ; SIO1 mit Paritaet
S1FEN bit S1CON.6 ; SIO1 mit Rahmenpruefung
S1OEN bit S1CON.7 ; SIO1 mit Ueberlaufpruefung
S1PE bit S1CON.8 ; SIO1 Paritaetsfehler
S1FE bit S1CON.9 ; SIO1 Rahmenfehler
S1OE bit S1CON.10 ; SIO1 Ueberlauffehler
S1LB bit S1CON.14 ; SIO1 Rueckkopplung
S1R bit S1CON.15 ; SIO1 Baudratengenerator freigeben
endif
;----------------------------------------------------------------------------
; Canbus 1 und 2
if _n>=167
;bitram; DefIntBits C1, 0ef02h ; CAN1 Interrupt Kontroll-Register
C1BTR equ 0ef04h ; CAN1 Bit Timing Register
C1CSR equ 0ef00h ; CAN1 Kontroll-Status-Register
C1GMS equ 0ef06h ; CAN1 Global Mask Short
C1LAR1 equ 0ef14h ; CAN1 Lower Arbitration Register
C1LAR2 equ 0ef24h
C1LAR3 equ 0ef34h
C1LAR4 equ 0ef44h
C1LAR5 equ 0ef54h
C1LAR6 equ 0ef64h
C1LAR7 equ 0ef74h
C1LAR8 equ 0ef84h
C1LAR9 equ 0ef94h
C1LAR10 equ 0efa4h
C1LAR11 equ 0efb4h
C1LAR12 equ 0efc4h
C1LAR13 equ 0efd4h
C1LAR14 equ 0efe4h
C1LAR15 equ 0eff4h
C1LGML equ 0ef0ah ; CAN1 Lower Global Mask Support Long
C1LMLM equ 0ef0eh ; CAN1 Lower Mask Of Last Message
C1MCFG1 equ 0ef16h ; CAN1 Message Configuration Register
C1MCFG2 equ 0ef26h
C1MCFG3 equ 0ef36h
C1MCFG4 equ 0ef46h
C1MCFG5 equ 0ef56h
C1MCFG6 equ 0ef66h
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