FPGA开发板上写的Verilog代码功能是从电脑端发送一个字节 - 免费下载

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2013-08-15 11:30

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FPGA开发板上写的Verilog代码：\r\n功能是从电脑端发送一个字节，然后把它接收回来。\r\n

源码文件列表

📂 共 46 个源码文件点击文件名可在线查看源代码

1 📄

first_0.v

大小: 426 B

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2 📄

first_0_tb.tf

大小: 359 B

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3 📄

mul4_1_case_tb.tf

大小: 589 B

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4 📄

mul4_1_case.v

大小: 497 B

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5 📄

adder8_for.v

大小: 827 B

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6 📄

adder8_for_tb.tf

大小: 749 B

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7 📄

mul3_1_casz_tb.tf

大小: 569 B

查看源码

8 📄

mul3_1_casez.v

大小: 430 B

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9 📄

adder4.v

大小: 555 B

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10 📄

bcdadder4.v

大小: 896 B

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11 📄

bcdadder4_tb.tf

大小: 651 B

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12 📄

latch4_if.v

大小: 333 B

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13 📄

sevenseg_case_tb.tf

大小: 462 B

查看源码

14 📄

sevenseg_case.v

大小: 1.27 KB

查看源码

15 📄

shl4_for_tb.tf

大小: 772 B

查看源码

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