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综合时序约束的FPGA和ASIC

  • 资源大小:221 K
  • 上传时间: 2024-04-13
  • 上传用户:sheng199241
  • 资源积分:2 下载积分
  • 标      签: FPGA ASIC 时序约束

资 源 简 介

电子系统设计人员使用FPGA来实现他们的原型开发,利用器件的可编程能力验证硬件和软件。一旦设计准备好进行量产时,设计人员寻找某类ASIC以达到功耗、性能和成本目标,特别是,能够提供硬件平台和工具包的ASIC,支持目前采用了FPGA的设计,可以使用相同的I/O、存储器资源和IP。依据这些标准,设计人员降低了ASIC设计出现功能或者时序错误的风险。

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