PLL锁相环DSP

PLL(Phase Locked Loop)： 为锁相回路或锁相环，用来统一整合时钟信号，使高频器件正常工作，如内存的存取资料等。PLL用于振荡器中的反馈技术。 许多电子设备要正常工作，通常需要外部的输入信号与内部的振荡...

提供《XS128之锁相环PLL》完整技术工程技术资料下载（归档大小 121 K），包含相关硬件原理图参考、开发文档或源代码工程。

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此文件是数字处理算法的一种，锁相环PLL算法，用来统一整合时脉讯号，使内存能正确的存取资料。PLL用于振荡器中的反馈技术。用C语言编写，可直接用于C开发的软件中。省去了自己按照原理编写程序的麻烦。

锁相环（PLL）simulink仿真，加深对PLL的理解

锁相环是一种反馈系统，其中电压控制振荡器(VCO)和相位比较器相互连接，使得振荡器可以相对于参考信号维持恒定的相位角度。锁相环可用来从固定的低频信号生成稳定的输出高频信号等。