💻 组合逻辑单元设计电路 - 源码文件列表

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源码文件总数： 33 个
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序号
文件名
文件大小
操作
51
📄 lab3.eds_overflow
3 B
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52
📄 prev_cmp_lab3.fit.qmsg
11.84 KB
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53
📄 prev_cmp_lab3.asm.qmsg
1.78 KB
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54
📄 lab3.db_info
137 B
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55
📄 wed.wsf
8.28 KB
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56
📄 lab3.cmp_bb.logdb
4 B
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57
📝 lab3.cbx.xml
86 B
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58
📄 lab3.map.hdb
0 B
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59
📄 prev_cmp_lab3.tan.qmsg
27.89 KB
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60
📄 lab3.sim.cvwf
0 B
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61
📄 lab3.cmp.logdb
4 B
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62
📄 lab3.map.logdb
4 B
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63
📄 lab3.fit.qmsg
11.84 KB
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64
📄 lab3.sld_design_entry_dsc.sci
0 B
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65
📄 lab3.pre_map.hdb
0 B
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66
📄 lab3.cmp.ecobp
0 B
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67
📄 lab3.cmp.bpm
0 B
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68
📄 lab3.cmp_bb.rcf
0 B
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69
📄 lab3.sgdiff.hdb
0 B
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70
📄 lab3.sld_design_entry.sci
0 B
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71
📄 lab3.map.qmsg
15.84 KB
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72
📄 lab3.eco.cdb
0 B
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73
📄 lab3.map.bpm
0 B
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74
📄 lab3.pss
35 B
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75
📄 lab3.cmp.rdb
0 B
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76
📄 lab3.cmp.cdb
0 B
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77
📄 lab3.rtlv.hdb
0 B
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78
📄 lab3.cmp.hdb
0 B
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79
📄 lab3.flow.rpt
4.65 KB
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80
📄 lab3.tan.rpt
45.3 KB
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81
📄 lab3.vhd
919 B
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82
📃 dfgadg.txt
919 B
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83
📄 lab3.tan.summary
1.16 KB
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